文件名称:
带硬件地址识别的UART IP的设计和实现
开发工具:
文件大小: 207kb
下载次数: 0
上传时间: 2020-10-25
详细说明：本UART IP全部采用Verilog HDL设计，可以在采用FPGA实现的通讯和控制系统中作为系统多点通讯控制器，也可以用于片上系统（SoC）的设计。用于多点通信时，可以有效降低CPU的额外负担，提高CPU系统的利用率。由于采用语言描述，移植性强，可以用于不同厂家、不同型号的FPGA芯片中，提高了系统的设计速度和效率。
(系统自动生成,下载前可以参看下载内容)
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