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  1. 8位RISC CPU的Verilog代码

  2. 8位RISC CPU的Verilog代码 8位RISC CPU的Verilog代码
  3. 所属分类:专业指导

    • 发布日期:2009-05-03
    • 文件大小:833536
    • 提供者:szlyang
  1. VHDL实现简单的8位CPU2

  2. VHDL 实现简单的8 位CPU 设计者: E-MAIL:huyugv_830913@163.com
  3. 所属分类:其它

    • 发布日期:2010-03-18
    • 文件大小:95232
    • 提供者:zjy286152565
  1. 精简8位CPU电路设计

  2. 8位cpu电路的设计,加减法 16*8的ROM设计与仿真
  3. 所属分类:其它

    • 发布日期:2011-04-28
    • 文件大小:916480
    • 提供者:ylpj2011
  1. 基于FPGA的8位CPU顶层原理图解

  2. 本WORD是计算机组成原理(潘松、潘明版)基本FPGA的8位CPU顶层原理图中的各器件的相关说明,包括器件作用,引脚连接,器件的实现方法。
  3. 所属分类:其它

  1. 精简指令集的8位CPU的verilog源代码

  2. verilog设计的精简指令集8位CPU源代码,里面有验证平台,以及后端DC的综合报告,门级网表,以及覆盖率报告。
  3. 所属分类:硬件开发

    • 发布日期:2012-04-06
    • 文件大小:195584
    • 提供者:j85148315
  1. 计算机组成原理16位改8位CPU

  2. 计算机组成原理16位改8位CPU,含报告。
  3. 所属分类:嵌入式

    • 发布日期:2014-05-24
    • 文件大小:1048576
    • 提供者:u011944514
  1. Lattice超精简8位CPU设计,源代码和例程

  2. Lattice超精简8位CPU设计,仅用100个左右LUTS,可在CPLD上运行,可谓超牛的设计,无论是设计还是学习都有极高的参考价值
  3. 所属分类:硬件开发

    • 发布日期:2014-05-25
    • 文件大小:11534336
    • 提供者:u011499280
  1. 16位CPU到8位CPU的改造

  2. 一个综合性实验,放上来让大家可以参考一下里面的思路,其实搞硬件这个,还真是很刺激的。16位到8位的CPU改造,希望大家喜欢!
  3. 所属分类:硬件开发

    • 发布日期:2014-07-17
    • 文件大小:7340032
    • 提供者:u011639085
  1. 8位CPU软核设计与应用研究

  2. 本文首先介绍了SoC中的架构设计,概述了SOC中的软硬件结构,包括处理 器、片上总线等等。然后结合ASIC设计方法对RTL设计、逻辑综合方法进行了 较为深入的研究,同时对CPU的设计方法进行了一定的研究。最后通过研究生阶 段的项目80C51软核的设计及应用说明了IC设计的流程及8位CPU软核的设计 与应用。 本论文的主要研究结果为: 1、深入研究了当前lC前端设计的方法,包括RTL设计、逻辑综合和验证等。 2、研究了8位CPU软核的设计方法。 3、详细研究了80C51软核设计改进方法和验证方法
  3. 所属分类:其它

    • 发布日期:2015-01-18
    • 文件大小:7340032
    • 提供者:qq_25419287
  1. 8 位 CPU vhdl实现(含全部源代码)

  2. 我是2014级复旦的研究生。这是一个8位的CPU设计VHDL实现。本CPU基于RISC架构,实现了cpu的基本功能如:加减乘除运算,跳转等。此外,里面有一个17位的ROM区,是存储指令的。你可以写出一段17位的指令代码,并放入ROM区,该CPU即可自动运行出结果。压缩包里是源代码和我们当时的设计要求。本源代码的最后调试时在地址0--17是放入的斐波纳契数字(Fibonacci Numbers)指令。通过modelsim仿真即可看到结果。
  3. 所属分类:其它

    • 发布日期:2015-02-10
    • 文件大小:520192
    • 提供者:enjoylife2018
  1. 8 位cpu的verilog实现

  2. 8 位cpu的verilog实现 verilog代码
  3. 所属分类:其它

  1. 计算机组成原理8位CPU

  2. 计算组成原理由16位CPU实验改成8CPU实验的代码和其报告
  3. 所属分类:专业指导

  1. 8位MINI cpu试验报告

  2. 根据《自己动手写CPU》编写的5级流水线的MINI 8位CPU
  3. 所属分类:硬件开发

    • 发布日期:2015-12-16
    • 文件大小:15728640
    • 提供者:qq_19876131
  1. VHDL实现简单的8位CPU

  2. VHDL实现简单的8位CPU,CPU具有的功能:能完成一些简单的指令。
  3. 所属分类:专业指导

    • 发布日期:2009-04-23
    • 文件大小:103424
    • 提供者:zhouhongxi
  1. 8位CPU的设计与实现

  2. 参考所给的16位实验CPU的设计与实现,体会其整体设计思路,并理解该CPU的工作原理。在此基础上,对该16位的实验CPU(称为ExpCPU-16)进行改造,以设计得到一个8位的CPU。总的要求是将原来16位的数据通路,改成8位的数据通路,即: 1.将原来8位的OP码,改成4位的OP码; 2.将原来8位的地址码(包含2个操作数),改成4位的地址码(包含2个操作数)。 在上述总要求的基础上,对实验CPU的指令系统、ALU、控制器、寄存器、存储器进行相应的改造。
  3. 所属分类:专业指导

    • 发布日期:2018-06-04
    • 文件大小:1048576
    • 提供者:g971105
  1. 用Verilog语言编写的8位简易CPU

  2. 这是一个非常简单的8位CPU,完成的功能基于《计算机速成课》7/8集,包括add、load、store、sub、jump、jump_neg、halt指令。
  3. 所属分类:其它

    • 发布日期:2020-08-20
    • 文件大小:2048
    • 提供者:qq_42914110
  1. 8bit-cpu:基于74LS的8位MK1 CPU的原理图和代码-源码

  2. MK1 8位计算机 我的自制8位CPU及其配套板的原理图和代码。 关于该项目的文章: 概述 在过去的一个月中,我从基本系列74LS逻辑IC中从头开始设计并构建了一个可编程的8位CPU。 该存储库包含该项目及其配套板的图片,示意图和代码。 V 1.0组装: V 2.0b组装: 正在运行的Helix显示界面: V 1.0的实际应用: 演示视频(YouTube) 建筑学 MK1 CPU由几个模块组成,所有模块都通过一条公共的8位BUS连接,每个模块的状态由专用的LED指示。 时钟模块旨在允许逐步
  3. 所属分类:其它

    • 发布日期:2021-03-20
    • 文件大小:15728640
    • 提供者:weixin_42120275
  1. 6502:6502 8位CPU仿真器-源码

  2. 6502:6502 8位CPU仿真器
  3. 所属分类:其它

    • 发布日期:2021-02-05
    • 文件大小:57344
    • 提供者:weixin_42125826
  1. cpu-emulator:在Ruby中模拟8位CPU-源码

  2. 在Ruby中模拟8位计算机设计 最初是一台4位计算机,但随着我想做更多事情而发展。 这里的原始想法: CPU使用带有条件跳转和子例程规定的最小指令集。 每个操作码为4位,指令长度为8位或16位。 原理图 使用说明 单字节指令 +-------------------+ | o o o o | d d d d | +-------------------+ +-------------------+ | op-code | ignored | RET ignores data. +----
  3. 所属分类:其它

    • 发布日期:2021-02-05
    • 文件大小:22528
    • 提供者:weixin_42173205
  1. 汇编程序模拟器:具有Angular.js的简单8位汇编程序模拟器-源码

  2. 简单的8位汇编器模拟器 提供简化的汇编器语法(基于NASM)并模拟x86(如cpu)的模拟器。 在模拟器中按“帮助”以查看有关受支持说明的概述。 #### 产品特点 8位CPU 4个通用寄存器 256个字节的内存 控制台输出 如何建造 确保已安装来编译asmsimulator.js脚本。 运行grunt构建项目。 背景 我的博客上提供了技术介绍: 。 执照 麻省理工学院执照 版权所有(c)2015 Marco Schweighauser 特此免费授予获得该软件和相关文档文件(“软件”)副
  3. 所属分类:其它

    • 发布日期:2021-02-04
    • 文件大小:34816
    • 提供者:weixin_42121086
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