为降低新一代高效视频编码(HEVC)标准中解码端多尺寸逆离散余弦变换(Inverse Discrete Cosine Transform，IDCT)中的资源消耗，设计了一种IDCT硬件电路结构。通过使用现场可编程门阵列(Field-Programmable Gate Array，FPGA)内部嵌入式RAM单元进行矩阵转置运算，从而减少了对内部寄存器的使用。对IDCT系数矩阵进行分解得到不同尺寸下的统一运算电路结构，利用流水线技术实现对运算单元的加速，同时采用并行数据调度减少数据处理等待时间。设计