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  1. 温控装置中的锁相过零控制

  2. 探讨了温控装置中主电路、驱动电路的形式和过零控制问题。借助单片微机和锁相技术实现 了过零驱动。
  3. 所属分类:专业指导

    • 发布日期:2009-08-17
    • 文件大小:312320
    • 提供者:xiaoxiaoha
  1. 窄带滤波_单片锁相环的位同步提取电路

  2. 详细介绍了位同步信号提取电路的设计,很有价值哦!期待您的青睐!
  3. 所属分类:专业指导

    • 发布日期:2009-12-23
    • 文件大小:154624
    • 提供者:jixuanbing
  1. 用CD4046 组成的高倍锁相倍频器

  2. 摘要:本文介绍了锁相环集成电路CD4046 的内部结构功能及特点,并给出在高倍锁相倍频器中的应用。 1. 概述 CD4046 是一种低频多功能单片数字集成锁相环集成电路,最高工作频率为1MHz ,电源电压5~15V , 当f0 = 10kHz 时, 功耗为0. 15~9mW。与类似的双极性单片集成锁相环相比,功耗降低了数十至数百倍,这对于要求功耗小的设备来说,是非常重要的。
  3. 所属分类:专业指导

  1. 通用单片集成芯片介绍

  2. BH1417F是一款新推出的非常优秀的FM无线发射集成电路芯片,这款集成电路是由提高信噪比(S/N)的预加重电路、防止信号过调的限幅电路、控制输入信号频率的低通滤波电路(LPF)、产生立体声复合信号的立体声调制电路、调频发射的锁相环电路(PLL)组成。BH1417F的频率特性非常出色,它可工作于87MHz~108MHz频段,与简单的外围电路配合使用,可发射音频FM信号,它可以将计算机声卡、游戏机、CD、DVD、MP3、调音台等立体声音频信号进行立体声调制发射传输,配合普通的调频立体声接收机就可
  3. 所属分类:嵌入式

    • 发布日期:2010-05-31
    • 文件大小:456704
    • 提供者:yirunlinda
  1. 宽频带数字锁相环的设计及基于FPGA的实现

  2. 数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。随着集成电路技术的发展,不仅能够制成频率较高的单片集成锁相环路,而且可以把整个系统集成到一个芯片上去。在基于FPGA的通信电路中,可以把全数字锁相环路作为一个功能模块嵌入FPGA中,构成片内锁相环。
  3. 所属分类:硬件开发

    • 发布日期:2010-09-20
    • 文件大小:358400
    • 提供者:AAA12505
  1. 经典的锁相环和锁相技术

  2. 第一章:锁相环路的基本工作原理 第1节:锁定与跟踪的概念 第2节:环路组成 第3节:环路的动态方程 第4节:一阶锁相环路的捕获、锁定与失锁 第二章:环路跟踪性能 第1节:线性相位模型与传递函数 第2节:二阶线性系统的一般性能 第3节:环路对输入暂态信号的响应 第4节:环路对输入正弦相位信号的响应 第5节:环路的稳定性 第6节:非线性跟踪 第三章:环路噪声性能 第1节:环路噪声相位模型 第2节:对输入白高斯噪声的线性过滤特性 第3节:环路对压控振荡器相位噪声的线性过滤 第4节:环路对各类噪声与干
  3. 所属分类:专业指导

    • 发布日期:2010-12-22
    • 文件大小:2097152
    • 提供者:xiaobaitu8629
  1. 数字锁相环及其FPGA的实现

  2. 锁相环 (PLL) 的理论与研究日趋完善,应用范围遍及整个电子技术领域,如信号处理,调制解调,时钟同步,倍频,频率综合等都应用到了锁相环技术。 随着集成电路技术的发展,集成锁相环和数字锁相环技术日趋成熟,不仅能够制成频率较高的单片集成锁相环路,还可以把整个系统集成到一个芯片上去,实现所谓的片上系统 SOC 。 因此,可以把全数字锁相环路 (ADPLL) 作为一个功能模块嵌入 SOC ,构成片内锁相环。这里在简单介绍片内全数字锁相环系列结构的同时,给出一种智能控制捕获范围中全数字锁相环( ADP
  3. 所属分类:专业指导

    • 发布日期:2015-12-13
    • 文件大小:394240
    • 提供者:qq_33364719
  1. FPGA内全数字延时锁相环的设计

  2. 现场可编程门阵YSJ(FPGA)的发展已经有二十多年,从最初的1200门发展到了 目前数百万门至上千万门的单片FPGA芯片。现在,FPGA已广泛地应用于通信、 消费类电子和车用电子类等领域,但国内市场基本上是国外品牌的天下。 在高密度FPGA中,芯片上时钟分布质量变的越来越重要,时钟延迟和时钟 偏差已成为影响系统性能的重要因素。目前,为了消除FPGA芯片内的时钟延迟, 减小时钟偏差,主要有利用延时锁相环(DLL)和锁相环(PLL)两种方法,而其 各自又分为数字设计和模拟设计。虽然用模拟的方法实
  3. 所属分类:硬件开发

    • 发布日期:2018-01-10
    • 文件大小:2097152
    • 提供者:drjiachen
  1. 智能全数字锁相环的设计

  2. 智能全数字锁相环,在单片FPGA中就可以实现,借助锁相环状态监测电路,通过CPU可以缩短锁相环锁定时间,并逐渐改进其输出频率的抖动特性。解决了锁定时间与相位抖动之间的矛盾,对信息的传输质量都有很大的提高。此锁相环已用于我校研发的数字通信产品中。
  3. 所属分类:其它

    • 发布日期:2020-08-11
    • 文件大小:97280
    • 提供者:weixin_38628626
  1. 基于锁相环的频率合成电路设计

  2. 从20世纪70年代起,随着集成电路的发展,开始出现集成的锁相环器件、通用和专用集成单片锁相环,使锁相环逐渐变成一个低成本、使用简便的多功能器件。如今,PLL技术主要应用在调制解调、频率合成、彩电色幅载波提取、雷达、FM立体声解码等各个领域。随着数字技术的发展,还出现了各种数字PLL器件,它们在数字通信中的载波同步、位同步、相干解调等方面起着重要的作用。
  3. 所属分类:其它

    • 发布日期:2020-08-26
    • 文件大小:232448
    • 提供者:weixin_38746293
  1. FPGA内全数字延时锁相环的设计.pdf

  2. 现场可编程门阵列(FPGA)的发展已经有二十多年,从最初的1200门发展到了目前数百万门至上千万门的单片FPGA芯片.现在,FPGA已广泛地应用于通信,消费类电子和车用电子类等领域,但国内市场基本上是国外品牌的天下. 在高密度FPGA中,芯片上时钟分布质量变的越来越重要,时钟延迟和时钟偏差已成为影响系统性能的重要因素.目前,为了消除FPGA芯片内的时钟延迟,减小时钟偏差,主要有利用延时锁相环(DLL)和锁相环(PLL)两种方法,而其各自又分为数字设计和模拟设计.虽然用模拟的方法实现的DLL所占用
  3. 所属分类:硬件开发

    • 发布日期:2020-08-22
    • 文件大小:2097152
    • 提供者:kid040
  1. EDA/PLD中的基于锁相环的频率合成电路设计

  2. 0 引言   锁相环简称PLL,是实现相位自动控制的一门技术,早期是为了解决接收机的同步接收问题而开发的,后来应用在电视机的扫描电路中。由于锁相技术的发展,该技术已逐渐应用到通信、导航、雷达、计算机到家用电器的各个领域。自从20世纪70年代起,随着集成电路的发展,开始出现集成的锁相环器件、通用和专用集成单片锁相环,使锁相环逐渐变成一个低成本、使用简便的多功能器件。如今,PLL技术主要应用在调制解调、频率合成、彩电色幅载波提取、雷达、FM立体声解码等各个领域。随着数字技术的发展,还出现了各种数字
  3. 所属分类:其它

    • 发布日期:2020-10-20
    • 文件大小:258048
    • 提供者:weixin_38639615
  1. 基于DSP的高阶COSTAS锁相环的设计

  2. 本文主要介绍了一种新型的适用于MPSK载波提取的高阶COSTAS环路,能满足MPSK相干解调的需要,且便于DSP实现。针对COSTAS环算法的DSP实时实现问题,进行了详细的讨论。最后,针对一个具有较高数据速率8PSK调制解调实例,在单片C6416上完成了基于高阶COSTAS环的载波同步及相干解调,并给出了通过CCS工具观察到的DSP实现结果,证明高阶COSTAS锁相环具有较好的载波同步性能。
  3. 所属分类:其它

    • 发布日期:2020-10-20
    • 文件大小:224256
    • 提供者:weixin_38732744
  1. ADI发布三款全新的锁相环(PLL)器件

  2. 导读:Analog Devices, Inc. 近日发布三款全新的锁相环(PLL)器件ADF5355/ADF4355-2/ADF4155.   其中一款具有业界最宽的频率覆盖范围和最低的压控振荡器(VCO)相位噪声,且在单个器件中实现这些性能。ADF5355 PLL具有同类最宽的55 MHz至14 GHz频谱范围;而ADF4355-2 PLL的频谱范围为55 MHz至4.4 GHz.这些器件可供需要单片高性能宽带频率合成器的RF和微波通信系统设计人员使用。这两款PLL均集成超低相位噪声VCO,
  3. 所属分类:其它

    • 发布日期:2020-10-20
    • 文件大小:155648
    • 提供者:weixin_38718307
  1. 宽频带数字锁相环的设计及基于FPGA的实现

  2. 数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。随着集成电路技术的发展,不仅能够制成频率较高的单片集成锁相环路,而且可以把整个系统集成到一个芯片上去。
  3. 所属分类:其它

    • 发布日期:2020-10-19
    • 文件大小:473088
    • 提供者:weixin_38563552
  1. 基于锁相环的频率合成电路设计

  2. 锁相环简称PLL,是实现相位自动控制的一门技术,早期是为了解决接收机的同步接收问题而开发的,后来应用在电视机的扫描电路中。由于锁相技术的发展,该技术已逐渐应用到通信、导航、雷达、计算机到家用电器的各个领域。自从20世纪70年代起,随着集成电路的发展,开始出现集成的锁相环器件、通用和专用集成单片锁相环,使锁相环逐渐变成一个低成本、使用简便的多功能器件。如今,PLL技术主要应用在调制解调、频率合成、彩电色幅载波提取、雷达、FM立体声解码等各个领域。随着数字技术的发展,还出现了各种数字PLL器件,它们
  3. 所属分类:其它

    • 发布日期:2020-10-18
    • 文件大小:541696
    • 提供者:weixin_38680671
  1. RFID技术中的松下推出集成了射频电路及微计算机的单片LSI

  2. 松下公司推出一种超小型低功率无线模块,可将射频电路和微计算机集成到单片CMOS LSI芯片中。这是首个采用400MHz频带低功率无线技术实现的产品。   该单芯片大小为12×16×1.3mm,体积为0.25cc,其中不包括新开发的高效天线。与GB-E01相比,该器件的外部元件数量减少了75%,从而减少了器件尺寸,降低生产成本。   该芯片采用高速锁相环(PLL)技术和高速处理技术,使射频信号检测时间缩短为3ms,模块每三秒钟将检测一次射频波。没有检测到外来信号时,它将降低待机期间的平均电
  3. 所属分类:其它

    • 发布日期:2020-12-01
    • 文件大小:37888
    • 提供者:weixin_38575536
  1. EDA/PLD中的智能全数字锁相环的设计

  2. 1 引言 数字锁相环路已在数字通信、无线电电子学及电力系统自动化等领域中得到了极为广泛的应用。随着集成电路技术的发展,不仅能够制成频率较高的单片集成锁相环路,而且可以把整个系统集成到一个芯片上去。在基于FPGA的通信电路中,可以把全数字锁相环路作为一个功能模块嵌入FPGA中,构成片内锁相环。 锁相环是一个相位误差控制系统。它比较输入信号和振荡器输出信号之间的相位差,从而产生误差控制信号来调整振荡器的频率,以达到与输入信号同频同相。所谓全数字锁相环路(DPLL)就是环路部件全部数字化,采用
  3. 所属分类:其它

    • 发布日期:2020-12-13
    • 文件大小:76800
    • 提供者:weixin_38687343
  1. ADI发布三款全新的锁相环(PLL)器件

  2. 导读:Analog Devices, Inc. 近日发布三款全新的锁相环(PLL)器件ADF5355/ADF4355-2/ADF4155.   其中一款具有业界宽的频率覆盖范围和的压控振荡器(VCO)相位噪声,且在单个器件中实现这些性能。ADF5355 PLL具有同类宽的55 MHz至14 GHz频谱范围;而ADF4355-2 PLL的频谱范围为55 MHz至4.4 GHz.这些器件可供需要单片高性能宽带频率合成器的RF和微波通信系统设计人员使用。这两款PLL均集成超低相位噪声VCO,6 GH
  3. 所属分类:其它

    • 发布日期:2021-01-20
    • 文件大小:160768
    • 提供者:weixin_38614812
  1. 基于锁相环的频率合成电路设计

  2. 0 引言   锁相环简称PLL,是实现相位自动控制的一门技术,早期是为了解决接收机的同步接收问题而开发的,后来应用在电视机的扫描电路中。由于锁相技术的发展,该技术已逐渐应用到通信、导航、雷达、计算机到家用电器的各个领域。自从20世纪70年代起,随着集成电路的发展,开始出现集成的锁相环器件、通用和专用集成单片锁相环,使锁相环逐渐变成一个低成本、使用简便的多功能器件。如今,PLL技术主要应用在调制解调、频率合成、彩电色幅载波提取、雷达、FM立体声解码等各个领域。随着数字技术的发展,还出现了各种数字
  3. 所属分类:其它

    • 发布日期:2021-01-19
    • 文件大小:232448
    • 提供者:weixin_38719702
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