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  1. 同步电路设计中CLOCK SKEW的分析.doc

  2. 本文比较了在同步电路设计中0clock shew和非0clock shew时钟分布对电路性能的影响，分析了通过调整时钟树中CLOCK SKEW来改善电路性能的方法，从而说明非0clock shew时钟分布是如何提高同步电路运行的最大时钟频率的。

  3. 所属分类：硬件开发

    • 发布日期：2020-04-18
    • 文件大小：184320
    • 提供者：csdn_txy