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  1. 基于ARM+FPGA的GPS接收机设计

  2. 针对GPS接收机在民用和军事领域的重要应用,设计了一种基于ARM+FPGA的GPS接收机。接收机的射频前端采用GP2015芯片,基带处理部分采用ARM9内核的AT91SAM9261芯片和Cyclone II系列的EP2C70F672I8芯片。同时阐述来接收机的软件设计,包括捕获引擎、跟踪引擎、解调电文,定位解算等。该接收机通过现场实验定位精度为6m(经度)/8m(纬度),动态性能达2000m/s,可以实现高动态导航定位,同时体积小,功耗低。 更多还原
  3. 所属分类:嵌入式

  1. 基于FPGA的1553B总线RT终端IP核设计

  2. 随着MIL-STD-1553B总线在航天和军工领域日益广泛应用,对其灵活性、可扩展性,低成本和小型化提出了更加苛刻的要求,传统的专用协议芯片实现方案已经不能完全满足需求.从新需求的角度出发,提出了一种以低成本FPGA为平台的1553B总线RT终端IP核方案,以片内逻辑实现1553B的全部RT终端协议.详细介绍了基于FPGA的1553B总线RT终端IP核硬件总体设计方案,IP核设计方法以及基于FPGA的1553B总线RT终端IP核的特性分析等.应用表明该终端节约了1553B总线的成本、降低功耗,提
  3. 所属分类:其它

    • 发布日期:2020-05-05
    • 文件大小:959488
    • 提供者:weixin_38693657
  1. 基于FPGA和STM32的CAN总线运动控制器设计

  2. 运用低功耗COrtex—M3微控制器STM32F103VBT6和FPGA芯片设计一种基于CAN总线的运动控制器。介绍系统的体系结构、主要硬件设计和软件结构。利用FPGA高速处理能力实现控制算法,与外界通信采用STM32和CAN总线技术,系统稳定可靠,另外,将设计好的FPGA程序或是C程序进行封装,系统的可移植性强。
  3. 所属分类:其它

    • 发布日期:2020-07-21
    • 文件大小:93184
    • 提供者:weixin_38710566
  1. 基于FPGA的图像采集模块设计

  2. 该设计是在深入研究传统的图像采集模块的基础上,针对传统的PCI图像采集卡的弊端,设计适用于便携式嵌入式系统的图像采集模块。该系统实现了图像原始数据采集及缓存,保证了图像数据的连续和完整性,具有体积小、功耗低、速度快、接口简单的优点。
  3. 所属分类:其它

    • 发布日期:2020-07-31
    • 文件大小:86016
    • 提供者:weixin_38577551
  1. 基于京微雅格低功耗FPGA的8b/10b SERDES的接口设计

  2. 本方案是以CME最新的低功耗系列FPGA的HR03为平台,实现8/10b的SerDes接口,包括SERDES收发单元,通过完全数字化的方法实现SERDES的CDR(Clock Data Recovery,时钟数据恢复),完成100~200Mhz的板间SERDES单通道通信。
  3. 所属分类:其它

    • 发布日期:2020-07-30
    • 文件大小:69632
    • 提供者:weixin_38674050
  1. 基于FPGA的实时无损数据压缩系统设计

  2. 针对某些特殊的测试实验,既要求测试系统微体积、低功耗,还要求记录大量数据的问题,提出基于FPGA的数据压缩解决方案。介绍了LZW压缩算法的基本理论及其用FPGA硬件实现的方法。
  3. 所属分类:其它

    • 发布日期:2020-07-25
    • 文件大小:95232
    • 提供者:weixin_38559866
  1. 基于FPGA实现的低功耗设计

  2. 利用FPGA的结构来降低功耗还有赖于所使用的软件工具。用户可以从众多综合工具经销商那里进行选择,那些能够使用专用模块电路并智能地设计逻辑功能的综合工具,将有助于用户降低动态功耗。
  3. 所属分类:其它

    • 发布日期:2020-08-07
    • 文件大小:95232
    • 提供者:weixin_38738506
  1. 基于FPGA+DSP的视频处理系统设计

  2. 实时图像处理技术在工业、医学、军事和商业等领域有广泛的应用。基于FPGA+DSP架构的视频处理系统充分发挥了各自器什的长处,不仪设计周期短,开发费用低,而且设计灵活,更改方便,功耗较低,便于实现系统的小型化。因此对基与FPGA+DSP架构的视频处理系统进行研究和设计具有重要的意义。
  3. 所属分类:其它

    • 发布日期:2020-08-29
    • 文件大小:149504
    • 提供者:weixin_38562492
  1. 一种基于FPGA的低功耗高速解码器设计

  2. 针对传统编解码算法复杂度高、不易扩展等问题,对自编码神经网络前向传播算法和结构进行了研究,提出了一种以自编码神经网络为编解码算法,以FPGA为实现平台的低功耗高速解码器系统。该系统实现了字符的编解码,同时可被应用于各种多媒体信息的编解码。通过ModelSim仿真,Xilinx ISE实现后进行硬件实测,对计算精度、资源消耗、计算速度和功耗等进行分析。实验测试结果表明,所设计的解码器能够正确完成数据解码功能,算法简洁高效,扩展能力强,系统具有低功耗、速度快等特点,可广泛应用于各种低功耗、便携式产品
  3. 所属分类:其它

    • 发布日期:2020-10-16
    • 文件大小:610304
    • 提供者:weixin_38515362
  1. 一种低存储容量Turbo码译码器结构设计及FPGA实现

  2. 为满足高性能低功耗无线通信的要求,基于反向重算和线性估算的Turbo码译码器结构,通过改变其前向状态度量的存储方式,提出了一种低存储容量的低功耗译码器结构设计方案,并给出了FPGA实现结构。结果表明,与已有的Turbo码译码器结构相比,本设计的译码器结构使存储容量降低了65%,译码性能与Log-MAP算法接近;并且在25 MHz、50 MHz、75 MHz、100 MHz、125 MHz频率下,较传统的译码器结构相比,动态的存储容量功耗均下降50%左右,而总功耗分别降低了4.97%、8.78%、
  3. 所属分类:其它

    • 发布日期:2020-10-15
    • 文件大小:812032
    • 提供者:weixin_38748718
  1. EDA/PLD中的TipsforFPGA低功耗设计

  2. FPGA的功耗高度依赖于用户的设计,没有哪种单一的方法能够实现这种功耗的降低,如同其它多数事物一样,降低功耗的设计就是一种协调和平衡艺术,在进行低功耗器件的设计时,人们必须仔细权衡性能、易用性、成本、密度以及功率等诸多指标。   目前许多终端市场对可编程逻辑器件设计的低功耗要求越来越苛刻。工程师们在设计如路由器、交换机、基站及存储服务器等通信产品时,需要密度更大、性能更好的FPGA,但满足功耗要求已成为非常紧迫的任务。而在消费电子领域,OEM希望采用FPGA的设计能够实现与ASIC相匹敌的低功
  3. 所属分类:其它

    • 发布日期:2020-10-22
    • 文件大小:99328
    • 提供者:weixin_38545961
  1. 基于FPGA实现的短波发射机自动调谐系统的设计

  2. 本设计采用现场可编程门阵列来完成电子系统集成化,以使整个系统达到高可靠性、高集成度、优品质、低成本、微功耗、小体积的目的,以便实现对电台的远程监控和管理。
  3. 所属分类:其它

    • 发布日期:2020-10-22
    • 文件大小:99328
    • 提供者:weixin_38744962
  1. 基于京微雅格低功耗FPGA的8b/10b SERDES的接口设计

  2. 摘要  串行接口常用于芯片至芯片和电路板至电路板之间的数据传输。随着系统带宽不断增加至多吉比特范围,并行接口已经被高速串行链接,或SERDES (串化器/ 解串器)所取代。起初, SERDES 是独立的ASSP 或ASIC 器件。在过去几年中已经看到有内置SERDES 的FPGA 器件系列,但多见于高端FPGA芯片中,而且价格昂贵。  本方案是以CME最新的低功耗系列FPGA的HR03为平台,实现8/10b的SerDes接口,包括SERDES收发单元,通过完全数字化的方法实现SERDES的CDR
  3. 所属分类:其它

    • 发布日期:2020-10-19
    • 文件大小:143360
    • 提供者:weixin_38680664
  1. 利用Freeze技术的FPGA实现低功耗设计

  2. 基于闪存的全功能可编程FPGA越来越多地成为便携式市场的首选解决方案。这些新出现的产品满足便携式市场严格的设计要求,例如以ASIC的单位成本,获得低功耗、最大的设计安全性、小的外形尺寸、上电即用以及快速面市的好处。
  3. 所属分类:其它

    • 发布日期:2020-10-19
    • 文件大小:119808
    • 提供者:weixin_38733355
  1. 通信与网络中的基于FPGA+DSP的软件无线电通用平台设计

  2. 0、引言   软件无线电是具有可重配置硬件平台的无线设备,可以跨多种通信标准,其基本思想是以开放性、可扩展、结构最简的硬件为通用平台,把尽可能多的通信功能用可升级、可替换的软件来实现。因为更低的成本、更大的灵活性和更高的性能,已迅速成为军事、公共安全和商用无线领域的事实标准。软件无线电能够对多种波形进行基带处理和数字中频处理,而数字中频处理能够将数字信号处理的领域从基带扩展到射频。同时,支持基带和中频处理的能力又增加了系统的灵活性,也减小了制造成本。   目前用于数字信号处理的器件有三种:A
  3. 所属分类:其它

    • 发布日期:2020-11-04
    • 文件大小:243712
    • 提供者:weixin_38614112
  1. EDA/PLD中的基于FPGA的语音信号实时处理

  2. 随着语音识别技术的应用越来越广, 对其实时性的要求也越来越高。专用的DSP 语音芯片虽然有硬件加速功能, 但其指令依然是串行计算, 在实时性方面有所欠缺。如今, 具有并行运算能力的FPGA 主频不断提高,加上其设计灵活、功耗低、体积小等优点, 可以满足语音信号实时处理的要求。目前很多语音处理算法都是基于软件平台的, 真正的语音处理硬件实现很少。本文针对非特定人的语音信号, 研究当前主流的语音处理算法, 并将这些基于软件平台的算法“ 硬件化” 。在保证一定精度的前提下将浮点运算转换成便于FPGA
  3. 所属分类:其它

    • 发布日期:2020-11-03
    • 文件大小:48128
    • 提供者:weixin_38653602
  1. 基于京微雅格低功耗FPGA的8b/10b SERDES的接口设计

  2. 摘要  串行接口常用于芯片至芯片和电路板至电路板之间的数据传输。随着系统带宽不断增加至多吉比特范围,并行接口已经被高速串行链接,或SERDES (串化器/ 解串器)所取代。起初, SERDES 是独立的ASSP 或ASIC 器件。在过去几年中已经看到有内置SERDES 的FPGA 器件系列,但多见于高端FPGA芯片中,而且价格昂贵。  本方案是以CME的低功耗系列FPGA的HR03为平台,实现8/10b的SerDes接口,包括SERDES收发单元,通过完全数字化的方法实现SERDES的CDR(C
  3. 所属分类:其它

    • 发布日期:2021-01-20
    • 文件大小:344064
    • 提供者:weixin_38685538
  1. 基于MAX1951实现Stratix II FPGA系统供电的设计方案

  2. MAX1951是MAXIM公司的一款高效的DC-DC电源转换芯片,主要用于DSP、FPGA、ASIC的内核及I/O口供电。其高达94%的转换效率、8脚的SOP表贴封装及连续工作时956mW的低功耗使其特别适合于便捷式电子设备的应用。MAX1951的输入电压范围为2.6~5.5V,输出电压范围为0.8V~Vin(可调输出),输出电流可达2A,   可达1%,开关频率为1MHz,输出效率达94%,且内含过载及过热保护电路。  基于MAX1951的诸多特点,本文给出了采用该器件为StraTIxIIFP
  3. 所属分类:其它

    • 发布日期:2021-01-20
    • 文件大小:121856
    • 提供者:weixin_38655347
  1. 基于FPGA的语音信号实时处理

  2. 随着语音识别技术的应用越来越广, 对其实时性的要求也越来越高。专用的DSP 语音芯片虽然有硬件加速功能, 但其指令依然是串行计算, 在实时性方面有所欠缺。如今, 具有并行运算能力的FPGA 主频不断提高,加上其设计灵活、功耗低、体积小等优点, 可以满足语音信号实时处理的要求。目前很多语音处理算法都是基于软件平台的, 真正的语音处理硬件实现很少。本文针对非特定人的语音信号, 研究当前主流的语音处理算法, 并将这些基于软件平台的算法“ 硬件化” 。在保证一定精度的前提下将浮点运算转换成便于FPGA
  3. 所属分类:其它

    • 发布日期:2021-01-19
    • 文件大小:48128
    • 提供者:weixin_38550334
  1. TipsforFPGA低功耗设计

  2. FPGA的功耗高度依赖于用户的设计,没有哪种单一的方法能够实现这种功耗的降低,如同其它多数事物一样,降低功耗的设计就是一种协调和平衡艺术,在进行低功耗器件的设计时,人们必须仔细权衡性能、易用性、成本、密度以及功率等诸多指标。   目前许多终端市场对可编程逻辑器件设计的低功耗要求越来越苛刻。工程师们在设计如路由器、交换机、基站及存储服务器等通信产品时,需要密度更大、性能更好的FPGA,但满足功耗要求已成为非常紧迫的任务。而在消费电子领域,OEM希望采用FPGA的设计能够实现与ASIC相匹敌的低功
  3. 所属分类:其它

    • 发布日期:2021-01-19
    • 文件大小:98304
    • 提供者:weixin_38539018
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