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  1. 基于 FPGA 的高速串行通信嵌入式系统的研究与设计

  2. 基于 FPGA 的高速串行通信嵌入式系统的研究与设计

  3. 所属分类：硬件开发

    • 发布日期：2011-10-28
    • 文件大小：688128
    • 提供者：emerpor

  1. 基于 FPGA 的高速串行通信嵌入式系统的研究与设计.pdf

  2. 基于 FPGA 的高速串行通信嵌入式系统的研究与设计.pdf

  3. 所属分类：Dell

    • 发布日期：2012-05-29
    • 文件大小：688128
    • 提供者：q123456789098

  1. 基于FPGA的高速通信系统研究

  2. 随着半导体工艺进步，现场可编程逻辑阵列(FPGA)的性能和集成度在不断提高，同时成本在下降。FPGA片内资源丰富且灵活性强。通过配置逻辑资源和I／O，可以生成支持各种标准的接口，适合完成接口间的通信工作。FPGA的可重构性使相同的硬件环境可以实现不同的功能，节约了系统升级和更改的成本。

  3. 所属分类：其它

    • 发布日期：2020-07-29
    • 文件大小：101376
    • 提供者：weixin_38677808

  1. 基于FPGA的IEEE-1394b双向数据传输系统设计

  2. 本系统，采用800 Mb·s-1的总线传输速率，利用FPGA内嵌的NIOSII处理器作为控制核心，实现了双向传输，用异步传输方式传输主机端指令和摄像头方位及状态信息，用等时传输方式将摄像头数据传输到主机端进行实时显示。实验表明，相对于1394a，该方案具有高速通信、可靠性高、实时性强等优点，达到了预定目标，运行良好。本系统研究的是1394设备与主机间的通信，在此基础上还可以研究在脱离计算机的环境下，两个1394设备间的通信传输以及多个设备的组网传输。

  3. 所属分类：其它

    • 发布日期：2020-10-23
    • 文件大小：235520
    • 提供者：weixin_38752907

  1. DSP中的基于FPGA的OFDM系统研究

  2. 第四代移动通信（4G 或称为Beyond 3G）中将提供高达100Mbit/s 甚至更高的数据传输速率，能够满足人们从语音扩展到数据、图像、视频等大量信息的高质量的多媒体业务。随着无线通信业务的飞速发展，为了在可用频带日趋紧张的情况下提高频带利用率，正交频分复用OFDM（Orthogonal Frequency Division Multiplexing）技术已成为第四代移动通信系统的核心技术。 　　实际上OFDM是MCM Multi-CarrierModulation，多载波调制的一种。其主要

  3. 所属分类：其它

    • 发布日期：2020-10-23
    • 文件大小：247808
    • 提供者：weixin_38720050

  1. 嵌入式系统/ARM技术中的基于FPGA 的ARM 并行总线研究与仿真

  2. 摘要：通过EP2C20Q240 器件和LPC2478 处理器，研究ARM 应用系统外部并行总线的工作原理和时序特性，以及在FPGA 中进行双向总线设计的原则，设计并实现了FPGA 并行总线.借助Quartus II 仿真工具，对FPGA 并行总线进行了时序仿真，并用SignalTap II 逻辑分析仪进行在线测试，验证设计的正确性. 　　0 引言 　　在数字系统的设计中，FPGA+ARM 的系统架构得到了越来越广泛的应用，FPGA 主要实现高速数据的处理；ARM 主要实现系统的流程控制.人机

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：184320
    • 提供者：weixin_38557727

  1. 通信与网络中的基于FPGA的AFDX终端系统模块设计

  2. 摘要：本文在研究航空全双工交换式以太网实时传输协议的基础上，研究了带有CPCI接口的AFDX终端板卡通讯模块的设计，充分利用PCI总线传输速度快和CPCI接口支持热插拔的特点，使得设计能满足双冗余AFDX的高速数据传输，使用方便和设备体积相对较小，便于携带，该板卡已经实现AFDX通信协议并批量生产销售。 　　1  引言 　　本文在研究航空全双工交换式以太网（Avionics Full Duplex Switched Ethernet,AFDX）实时传输协议的基础上，分析了基于CPCI接口的双

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：136192
    • 提供者：weixin_38663701

  1. 接口/总线/驱动中的基于FPGA的车电总线接口技术研究

  2. 导读：为提高集成架构中车电总线通信速率，结合综合化处理系统项目要求，采用双总线结合的方式，利用CAN总线和FlexRay总线实现功能及搭配上的互补，提出一种基于现场可编程门阵列(FPGA)的总线接口单元设计方案。通过FPGA完成CAN总线控制器、FlexRay总线控制器、RapidIO总线接口等模块功能，实现高速接口的控制和扩展，并使模块接口具备可配置能力。测试结果表明，CAN接口及FlexRay接口在指定的波特率下均工作正常，满足项目要求的各项性能指标。 　　1 概述 　　CAN

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：557056
    • 提供者：weixin_38711643

  1. EDA/PLD中的基于FPGA的RS（255，239）编译码器设计

  2. RS（Reed-Solomon）编码是一种具有较强纠错能力的多进制BCH编码，其既可纠正随机错误，又可纠正突发错误。RS编译码器广泛应用于通信和存储系统，为解决高速存储器中数据可靠性的问题，文中提出了RS编码的实现方法，并对编码进行了时序仿真。仿真结果表明，该译码器可实现良好的纠错功能。 　　RS（Reed-Solomon）码是差错控制领域中的一种重要线性分组码，既能纠正随机错误，又能纠正突发错误，且由于其出色的纠错能力，已被NASA、ESA、CCSDS等空间组织接受，用于空间信道纠错。本文研

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：362496
    • 提供者：weixin_38729269

  1. 基于Aurora协议的高速通信技术的研究

  2. 介绍了基于模块化方法在FPGA上实现高速通信的设计方案。系统在Aurora协议下采用高速串行收发器Rocket I/O，解决了不同端口收发时钟补偿带来的数据丢失问题，并结合SFP光模块对高速AD采样信号进行有效的传输。实验证明了方案的可行性，其对提高雷达信号处理带宽、改进雷达的探测性能具有较大的意义。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：219136
    • 提供者：weixin_38674763

  1. 基于FPGA的高速通信系统研究

  2. 基于FPGA的高速通信系统研究,0 引言远程通信系统和远程监控系统对信号传输有两方面的要求：一方面要求接口灵活且有较高的数据传输带宽

  3. 所属分类：其它

    • 发布日期：2020-10-25
    • 文件大小：293888
    • 提供者：weixin_38708105

  1. 一种基于FPGA的高速通信系统研究与设计

  2. 0引言远程通信系统和远程监控系统对信号传输有两方面的要求：一方面要求接口灵活且有较高的数据传...

  3. 所属分类：其它

    • 发布日期：2020-10-25
    • 文件大小：96256
    • 提供者：weixin_38519234

  1. 基于FPGA的嵌入式脉象采集仪硬件电路设计

  2. 脉诊作为中医最重要的一种诊断方式，具有模糊性、不确定性的特点，是近年来中医现代化研究中的热点。随着电子、计算机技术的快速进步，将嵌入式技术、FPGA技术、IP核技术结合在一起，融合电子技术、信号处理方法等学科知识，在中医基本理论的指导下，设计脉象诊断设备，构建一个灵活高效，可扩展性强，可靠性高，功耗低，可便携的脉象采集仪具有重要的现实意义和良好的市场前景。1仪器总体设计嵌入式脉象采集仪的前期设计目标是脉搏信号的采集、存储、显示、简单处理、通信等，后期要对所采集到的信号处理，得到脉象特征，对病人做

  3. 所属分类：其它

    • 发布日期：2020-10-24
    • 文件大小：321536
    • 提供者：weixin_38661800

  1. EDA/PLD中的基于FPGA的高速通信系统研究

  2. 0 引言 　　远程通信系统和远程监控系统对信号传输有两方面的要求：一方面要求接口灵活且有较高的数据传输带宽；另一方面要求系统的传输距离远。传统接口如UART，USB，以太网等在传输带宽和传输距离上均无法满足要求。 　　低压差分信号(LVDS)是一种低摆幅的差分信号技术。LVDS的恒流源模式及低摆幅输出使传输速度可以从数百Mb／s到2 Gb／s以上。差分传输方式使LVDS信号对共模输入噪声有更强的抵抗能力。LVDS技术功耗低，100Ω的负载电阻功耗仅有1．2 mW。这些特点使得LVDS技术广泛

  3. 所属分类：其它

    • 发布日期：2020-11-05
    • 文件大小：242688
    • 提供者：weixin_38723513

  1. EDA/PLD中的基于FPGA的高速时钟数据恢复电路的实现

  2. 0 引言 　　时钟数据恢复电路是高速收发器的核心模块，而高速收发器是通信系统中的关键部分。随着光纤在通信中的应用，信道可以承载的通信速率已经可以达到GHz，从而使得接收端的接收速率成为限制通信速率的主要瓶颈。因此高速时钟数据恢复电路的研究是目前通信领域的研究热点。目前时钟数据恢复电路主要是模拟IC和数字IC，其频率已经可以达到几十GHz。而由于FPGA器件的可编程性、低成本、短的设计周期以及越来越大的容量和速度，在数字领域的应用逐渐有替代数字IC的趋势，已经广泛作为数字系统的控制核心。但利用中

  3. 所属分类：其它

    • 发布日期：2020-11-10
    • 文件大小：249856
    • 提供者：weixin_38737283

  1. EDA/PLD中的基于FPGA的多功能信号源生成系统设计与实现

  2. 摘 要：为了满足科研与实验需要，提出并实现了一种以FPGA和高速D／A为核心，其结构简单，控制灵活，信号质量高的多功能信号源生成系统。该信号源生成系统能够实时产生中心频率在30～130 MHz的各种雷达、通信、导航和白噪声等信号，且产生的各种信号频率、幅度、相位和其他参数均可控。信号源作为基带信号单元配以混频模块，可实现在任意频段的信号。另外，该信号源还可以作为一个通用平台，通过FPGA内部程序的更新来实现其他复杂信号。 　　产品级的信号源往往满足不了科研和实验的需要，尤其在复杂电磁环境的研究

  3. 所属分类：其它

    • 发布日期：2020-11-09
    • 文件大小：391168
    • 提供者：weixin_38716519

  1. EDA/PLD中的基于FPGA的高速数字锁相环的设计与实现

  2. 摘 要：本文提出了一种利用边沿触发鉴相缩短锁相环捕获时间的方案，并详细介绍了该方案基于FPGA的实现方法。通过对所设计的锁相环进行计算机仿真和硬件测试，表明该方案确实可以提高锁相环的捕获性能。关键词：数字锁相环(DPLL)；捕获时间；FPGA；VHDL 引言捕获时间是锁相环的一个重要参数，指的是锁相环从起始状态到达锁定状态所需时间。在一些系统中，如跳频通信系统，由于系统工作频率不断地发生快速变化(每秒几百次到几千次，甚至高达上万次)，要求锁相环能够对信号相位快速捕获。因此研究具有较短捕获时

  3. 所属分类：其它

    • 发布日期：2020-12-09
    • 文件大小：69632
    • 提供者：weixin_38607311

  1. 基于FPGA的高速时钟数据恢复电路的实现

  2. 0 引言 　　时钟数据恢复电路是高速收发器的模块，而高速收发器是通信系统中的关键部分。随着光纤在通信中的应用，信道可以承载的通信速率已经可以达到GHz，从而使得接收端的接收速率成为限制通信速率的主要瓶颈。因此高速时钟数据恢复电路的研究是目前通信领域的研究热点。目前时钟数据恢复电路主要是模拟IC和数字IC，其频率已经可以达到几十GHz。而由于FPGA器件的可编程性、低成本、短的设计周期以及越来越大的容量和速度，在数字领域的应用逐渐有替代数字IC的趋势，已经广泛作为数字系统的控制。但利用中低端FP

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：330752
    • 提供者：weixin_38617451

  1. 基于FPGA的高速通信系统研究

  2. 0 引言 　　远程通信系统和远程监控系统对信号传输有两方面的要求：一方面要求接口灵活且有较高的数据传输带宽；另一方面要求系统的传输距离远。传统接口如UART，USB，以太网等在传输带宽和传输距离上均无法满足要求。 　　低压差分信号(LVDS)是一种低摆幅的差分信号技术。LVDS的恒流源模式及低摆幅输出使传输速度可以从数百Mb／s到2 Gb／s以上。差分传输方式使LVDS信号对共模输入噪声有更强的抵抗能力。LVDS技术功耗低，100Ω的负载电阻功耗仅有1．2 mW。这些特点使得LVDS技术广泛

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：320512
    • 提供者：weixin_38657465

  1. 基于FPGA的AFDX终端系统模块设计

  2. 摘要：本文在研究航空全双工交换式以太网实时传输协议的基础上，研究了带有CPCI接口的AFDX终端板卡通讯模块的设计，充分利用PCI总线传输速度快和CPCI接口支持热插拔的特点，使得设计能满足双冗余AFDX的高速数据传输，使用方便和设备体积相对较小，便于携带，该板卡已经实现AFDX通信协议并批量生产销售。 　　1  引言 　　本文在研究航空全双工交换式以太网（Avionics Full Duplex Switched Ethernet,AFDX）实时传输协议的基础上，分析了基于CPCI接口的双

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：152576
    • 提供者：weixin_38692184
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