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搜索资源列表

  1. 基于FPGA的数字秒表设计

  2. 本科生毕业论文(设计)开题报告书 题 目： 基于FPGA的数字秒表设计 学生姓名： *********** 学 号： ********** 专业班级： 自动化******班 指导老师： ************ 2010年 3 月 20 日 论文（设计）题目 ISP技术及其应用研究 课题目的、意义及相关研究动态： 课题设计的主要目的：运用所学的数字电子技术的基本知识和数字电子电路的设计方法，将数字电子技术的基础知识与EDA技术有机地联系起来，EDA电子仿真软件的仿真功能强大，具有完备的文件库，

  3. 所属分类：嵌入式

    • 发布日期：2010-06-16
    • 文件大小：747520
    • 提供者：sanpao2010

  1. 基于FPGA的高速高密度PCB设计中的信号完整性分析.pdf

  2. 基于FPGA的高速高密度PCB设计中的信号完整性分析.pdf

  3. 所属分类：硬件开发

    • 发布日期：2012-07-19
    • 文件大小：878592
    • 提供者：tuoyunfeng

  1. 基于FPGA的高速高密度PCB设计中的信号完整性分析

  2. 基于FPGA的高速高密度PCB设计中的信号完整性分析

  3. 所属分类：嵌入式

    • 发布日期：2014-09-21
    • 文件大小：734208
    • 提供者：u012064037

  1. 基于USB2.0和FPGA的图像采集、存储系统研究

  2. 图像信号的采集和处理在科学研究、工农业生产、医疗卫生、公共安全等领域得到了越来越广泛的应用,而这些工作都需要一套高速的图像系统来完成。同时图像采集也是进行图像处理、图像压缩、图像识别的基础,所以图像采集系统的研制有着重要的现实意义和价值。要对图像进行采集就需要一种高速的,能进行长时间、大吞吐量数据传送的计算机接口。USB 2.0接口就是一种符合图像采集要求的计算机接口。同时USB接口还具有支持热插拔、占用系统资源少、易于扩展、使用方便等优点。当前,计算机的许多外围设备都采用了USB接口来实现与计

  3. 所属分类：硬件开发

    • 发布日期：2010-08-16
    • 文件大小：3145728
    • 提供者：jzd19851102

  1. 基于高速FPGA的PCB 设计技术

  2. 如果高速PCB 设计能够像连接原理图节点那样简单，以及像在计算机显示器上所看到的那样优美的话，那将是一件多么美好的事情。然而，除非设计师初入PCB 设计，或者是极度的幸运，实际的PCB 设计通常不像他们所从事的电路设计那样轻松。

  3. 所属分类：其它

    • 发布日期：2020-08-18
    • 文件大小：196608
    • 提供者：weixin_38526914

  1. 基于FPGA的通用网络下载器硬件设计

  2. 网络下载器作为航天计算机地面检测系统的重要组成部分，发挥着重要的作用。文中主要介绍了网络下栽器的总体设计思路，给出了硬件模块的设计原理图。并在PCB设计中，对于LVDS接口、高速总线以及叠层的设计中给出了应用参考，保证了系统硬件的可靠性，且在实际应用中取得了稳定的性能表现。

  3. 所属分类：其它

    • 发布日期：2020-08-30
    • 文件大小：290816
    • 提供者：weixin_38659248

  1. 基于FPGA的高速串行数据收发接口设计

  2. 针对传统ADC/DAC应用中采样数据并行传输存在线间串扰大、同步难等问题，设计了一种基于高速串行协议——JESD204B的数据收发接口。以Xilinx公司V7系列FPGA为核心控制单元设计电路，在单通道传输速率为6 Gb/s的条件下完成数据收发测试，验证了传输过程中数据的同步性、准确性及整体方案的可行性。设计结果表明，这种串行传输方式不仅解决了并行传输所带来的诸多问题，还降低了制板设计时PCB布线的复杂程度、减少了板层数量、节约了成本。

  3. 所属分类：其它

    • 发布日期：2020-10-16
    • 文件大小：549888
    • 提供者：weixin_38688969

  1. 基于FPGA的时统模块可靠性设计

  2. 本文详细介绍了作战系统时间统一同步的可靠性设计，从EMC设计、高速电路PCB设计、FPGA逻辑编程设计等几个方面介绍了时统接收处理模块的抗干扰设计及其实现方法，并用仿真技术进行仿真，从而将时统系统可能受到的干扰减到最低，提高了整个作战系统的可靠性。文中的时统模块已经应用于实际的作战系统中，效果良好。

  3. 所属分类：其它

    • 发布日期：2020-10-21
    • 文件大小：219136
    • 提供者：weixin_38636461

  1. 基于FPGA的时统模块可靠性设计[图]

  2. 文章从FPGA逻辑编程设计技术、EMC技术、高速电路PCB设计技术等几个方面介绍了时统接收处理模块的抗干扰设计及其实现方法，实现了同步脉冲的提取、对时功能、自守时、脉宽调制等功能，提高了同步精度和抗干扰性。解决了传统时统模块定时精度不高、设置固定只能满足单一需求等问题。

  3. 所属分类：其它

    • 发布日期：2020-10-21
    • 文件大小：223232
    • 提供者：weixin_38627603

  1. PCB技术中的基于高速 FPGA 的 PCB 设计技术

  2. 如果高速PCB设计能够像连接原理图节点那样简单，以及像在计算机显示器上所看到的那样优美的话，那将是一件多么美好的事情。然而，除非设计师初入PCB设计，或者是极度的幸运，实际的PCB设计通常不像他们所从事的电路设计那样轻松。深圳捷多邦科技有限公司作为PCB打样行业的一匹黑马，始终走在PCB打样行业的前列。捷多邦的高级工程师在谈到这样一个问题时说到，在设计最终能够正常工作、有人对性能作出肯定之前，PCB设计师都面临着许多新的挑战。这正是目前高速PCB设计的现状--设计规则和设计指南不断发展，如果幸运

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：116736
    • 提供者：weixin_38724106

  1. 基于FPGA的NoC硬件系统设计

  2. 设计了基于FPGA的片上网络系统硬件平台。系统由大容量的FPGA、存储器、高速A/D与D/A、通信接口和一个扩展的ARM９系统组成。完成了集高速数字信号处理、视频编解码和网络传输功能与一体的多核系统设计。针对典型的3×3 2D Mesh结构的NoC系统应用进行了探讨，阐述了NoC系统设计过程中的关键技术，并使用SigXplorer软件对系统的信号完整性解决方案进行了PCB的反射与串扰仿真。

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：191488
    • 提供者：weixin_38684892

  1. 基于FPGA的NoC硬件系统设计

  2. 设计了基于FPGA的片上网络系统硬件平台。系统由大容量的FPGA、存储器、高速A/D与D/A、通信接口和一个扩展的ARM９系统组成。完成了集高速数字信号处理、视频编解码和网络传输功能与一体的多核系统设计。针对典型的3×3 2D Mesh结构的NoC系统应用进行了探讨，阐述了NoC系统设计过程中的关键技术，并使用SigXplorer软件对系统的信号完整性解决方案进行了PCB的反射与串扰仿真。

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：310272
    • 提供者：weixin_38679233

  1. 基于FPGA的嵌入式串行千兆以太网设计

  2. 本设计以XilinxFPGA为棱心芯片，利用内嵌硬核处理器PowerPC、嵌入式操作系统Xilkernel和LwIP协议功能函数，完成嵌入式串行千兆以太网系统的设计。本设计能够满足以太网通信对高速数据传输的要求，同时在电路设计时，具有PCB布线简单以及信号完整性好等优点。

  3. 所属分类：其它

    • 发布日期：2020-10-18
    • 文件大小：184320
    • 提供者：weixin_38625464

  1. PCB技术中的基于高速FPGA的PCB设计技术

  2. 如果高速PCB设计能够像连接原理图节点那样简单，以及像在计算机显示器上所看到的那样优美的话，那将是一件多么美好的事情。然而，除非设计师初入PCB设计，或者是极度的幸运，实际的PCB设计通常不像他们所从事的电路设计那样轻松。在设计最终能够正常工作、有人对性能作出肯定之前，PCB设计师都面临着许多新的挑战。这正是目前高速PCB设计的现状--设计规则和设计指南不断发展，如果幸运的话，它们会形成一个成功的解决方案。 　　绝大多数PCB是精通PCB器件的工作原理和相互影响以及构成电路板输入和输出的

  3. 所属分类：其它

    • 发布日期：2020-11-20
    • 文件大小：115712
    • 提供者：weixin_38617602

  1. EDA/PLD中的基于FPGA系统易测试性的研究

  2. 引 言 　　现代科技对系统的可靠性提出了更高的要求，而FPGA技术在电子系统中应用已经非常广泛，因此FPGA易测试性就变得很重要。要获得的FPGA内部信号十分有限、FPGA封装和印刷电路板(PCB)电气噪声，这一切使得设计调试和检验变成设计中最困难的一个流程。另一方面，当前几乎所有的像CPU、DSP、ASIC等高速芯片的总线，除了提供高速并行总线接口外，正迅速向高速串行接口的方向发展，FPGA也不例外。每一条物理链路的速度从600 Mbps到10 Gbps，高速I／O的测试和验证更成为传统专

  3. 所属分类：其它

    • 发布日期：2020-12-07
    • 文件大小：153600
    • 提供者：weixin_38502722

  1. EDA/PLD中的基于FPGA的SoftSerdes设计与实现

  2. 0引言       在高速源同步应用中，时钟数据恢复是基本的方法。最普遍的时钟恢复方法是利用数字时钟模块(DCM、)产生的多相位时钟对输入的数据进行过采样。但是由于DCM的固有抖动，在频率很高时，利用DCM作为一种数据恢复的方法并不一定合适。DCM的这种附加抖动会引起数据有效窗口的相应减小，这样就会限制高速电路的性能。常用的串行I／O技术需要时钟数据恢复(CDR)技术，而CDR技术需要模拟的PLL，其局限性是低噪声容限、高功率损耗及严格的PCB布局布线要求。基于对上述缺点的考虑，本文介绍了一

  3. 所属分类：其它

    • 发布日期：2020-12-06
    • 文件大小：87040
    • 提供者：weixin_38699726

  1. 基于高速FPGA的PCB设计技术

  2. 如果高速PCB设计能够像连接原理图节点那样简单，以及像在计算机显示器上所看到的那样优美的话，那将是一件多么美好的事情。然而，除非设计师初入PCB设计，或者是极度的幸运，实际的PCB设计通常不像他们所从事的电路设计那样轻松。在设计终能够正常工作、有人对性能作出肯定之前，PCB设计师都面临着许多新的挑战。这正是目前高速PCB设计的现状--设计规则和设计指南不断发展，如果幸运的话，它们会形成一个成功的解决方案。 　　绝大多数PCB是精通PCB器件的工作原理和相互影响以及构成电路板输入和输出的各

  3. 所属分类：其它

    • 发布日期：2021-01-20
    • 文件大小：113664
    • 提供者：weixin_38560502

  1. 基于FPGA的高速PCB的设计

  2. 随着现场可编程门阵列(FPGA)已发展成为真正的可编程系统级芯片，利用这些芯片设计印制电路板(PCB)的任务变得愈加复杂。要完全实现FPGA 的功能，需要对PCB 板进行精心设计。采用高速FPGA 进行设计时，在板开发之前和开发期间对若干设计问题进行考虑是十分重要的。由于I/O 的信号的快速切换会导致噪声产生、信号反射、串扰、EMI 问题，所以设计时必须注意：（一）电源过滤和分布所有电路板和器件上干净、平台分布电源Vcc 可以减少系统噪声。滤除由供电源处产生的低频（<1kHz）噪声，建议就

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：193536
    • 提供者：weixin_38570278

  1. 基于FPGA的SoftSerdes设计与实现

  2. 0引言       在高速源同步应用中，时钟数据恢复是基本的方法。普遍的时钟恢复方法是利用数字时钟模块(DCM、)产生的多相位时钟对输入的数据进行过采样。但是由于DCM的固有抖动，在频率很高时，利用DCM作为一种数据恢复的方法并不一定合适。DCM的这种附加抖动会引起数据有效窗口的相应减小，这样就会限制高速电路的性能。常用的串行I／O技术需要时钟数据恢复(CDR)技术，而CDR技术需要模拟的PLL，其局限性是低噪声容限、高功率损耗及严格的PCB布局布线要求。基于对上述缺点的考虑，本文介绍了一种

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：86016
    • 提供者：weixin_38748555

  1. 基于FPGA系统易测试性的研究

  2. 引 言 　　现代科技对系统的可靠性提出了更高的要求，而FPGA技术在电子系统中应用已经非常广泛，因此FPGA易测试性就变得很重要。要获得的FPGA内部信号十分有限、FPGA封装和印刷电路板(PCB)电气噪声，这一切使得设计调试和检验变成设计中困难的一个流程。另一方面，当前几乎所有的像CPU、DSP、ASIC等高速芯片的总线，除了提供高速并行总线接口外，正迅速向高速串行接口的方向发展，FPGA也不例外。每一条物理链路的速度从600 Mbps到10 Gbps，高速I／O的测试和验证更成为传统专注

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：171008
    • 提供者：weixin_38527987
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