针对机载信息采集系统可靠性、数据管理高效性以及硬件成本的需求，介绍了基于硬件描述语言Verilog HDL设计的SDX总线与Wishbo ne总线接口转化的设计与实现，并通过Modelsim进行功能仿真，在QuartusⅡ软件平台上综合，最终在Altera公司的CycloneⅢ系列FPGA上调试。实验证明了设计的可行性。

摘要 针对机载信息采集系统可靠性、数据管理高效性以及硬件成本的需求，介绍了基于硬件描述语言Verilog HDL设计的SDX总线与Wishbo ne总线接口转化的设计与实现，并通过Modelsim进行功能仿真，在QuartusⅡ软件平台上综合，终在Altera公司的CycloneⅢ系列FPGA上调试。实验证明了设计的可行性。 　　随着微电子设计技术与工艺的迅速发展，数字集成电路逐步发展到专用集成电路（ASIC），其中超大规模、高速、低功耗的新型FPGA的出现，降低了产品的成本，提高了系统的可靠