本文设计了基于NiosII的EEPROM Controller Core，设计包括了HDL语言描述的硬件部分和软件驱动程序，并将Controller Core添加到SOPC Builder的库中，最后下载到Stratix1S10的 FPGA上，通过读写函数对其进行了验证。同时，本次设计也为开发其它基于SOPC的Controller Core提供了一个范例。

1  引言       由于FPGA的出现，使得我们不需要承担较大风险和较高的流片费用将小规模的或处于研发阶段的芯片制成ASIC芯片了。而基于FPGA的SOC——SOPC（可编程片上系统），由于其可编程性，按照用户特定需要构建的SOPC是一个在某种程度上替代SOC的较好方案。       Altera公司为其FPGA开发了第二代软核嵌入式处理器NiosII，同时开发了用以构建基于NiosII处理器的SOPC Builder，使得用户可以通过自定义逻辑的方法方便地开发基于NiosII的SOP