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具有高动态性能和锁相精确度的改进PLL设计.pdf
提高锁相环(phase—locked loop,PLL)的动态性能和锁相精确度,提出一种基于dq变换 的改进锁相环,其通过平均值环节而不是延时信号消除(delayed signal cancellation,DSC)或低通滤 波器(10w pass filter,LPF)预先将负序与谐波分离出去,大幅缩短了暂态响应时间,同时亦消除了 系统电压不平衡或畸变对锁相精确度的影响。详述了该PLL的工作原理;给出了关于负序与谐波 分离方法的讨论;推导了控制环的线性化模型及其PI参数的整定方法。仿真与实验结
所属分类:
嵌入式
发布日期:2021-03-03
文件大小:2097152
提供者:
qq_40611693
基于dq变换的锁相环设计与仿真.pdf
针对一般锁相环在电网电压波动时存在锁相误差的问题,提出了一种基于 dq 变换的锁相环新方案,并对 锁相环参数进行了整定.对于电网电压频率变化、相位变化以及谐波注入的影响,利用 matlab 进行了仿真分析. 仿真结果表明,新方案有很好的跟踪效果,跟踪速度快,精度高,能较好实现相位锁定.
所属分类:
嵌入式
发布日期:2021-03-03
文件大小:995328
提供者:
qq_40611693