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使用verilog语言，结合quartus II,在FPGA开发板上实现串口通信，能显示信号的收发，实现数字、汉字的发送与显示。

基于 Verilog HDL 编写的 UART 串口综合例程，包含仿真测试程序，开发环境为 Vivado。涉及串口发送模块、串口接收模块，以及多字节协议帧收发。相关说明请参阅本人的【Verilog串口系列】博客。博客地址： https://blog.csdn.net/poetryTang