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搜索资源列表

  1. 基于vhdl的串口通信接收模块

  2. 基于vhdl的串口通信接收模块，即异步收发机，可实现单片机核fpga的收发串口通信，遵从rs232协议，已经调试过，很不错的资源

  3. 所属分类：硬件开发

    • 发布日期：2011-04-09
    • 文件大小：4096
    • 提供者：blcablca

  1. EDA/SOPC 技术实验讲义

  2. 第一章 EDA_VHDL 实验/设计与电子设计竞赛 4 1-1、 应用QuartusII 完成基本组合电路设计 5 1-2. 应用QuartusII 完成基本时序电路的设计 6 1-3. 设计含异步清0 和同步时钟使能的加法计数器 7 1-4. 7 段数码显示译码器设计 8 1-5. 8 位数码扫描显示电路设计 9 1-6. 数控分频器的设计 10 1-7. 32 位并进/并出移位寄存器设计 10 1-8. 在QuartusII 中用原理图输入法设计8 位全加器 11 1-9. 在Quartu

  3. 所属分类：硬件开发

    • 发布日期：2012-04-18
    • 文件大小：3145728
    • 提供者：xiaosong89

  1. 数字通信同步技术的MTALAB与FPGA实现》PPT版

  2. ppt是书的辅助 书上目录 第1章 同步技术的概念及FPGA基础 1 1.1 数字通信中的同步技术 2 1.2 同步技术的实现方法 4 1.2.1 两种不同的实现原理 4 1.2.2 常用的工程实现途径 5 1.3 FPGA概念及其在信号处理中的应用 6 1.3.1 基本概念及发展历程 6 1.3.2 FPGA的结构和工作原理 8 1.3.3 FPGA在数字信号处理中的应用 14 1.4 Xilinx器件简介 15 1.4.1 Xilinx器件概况 15 1.4.2 Spartan系列器件 1

  3. 所属分类：讲义

    • 发布日期：2015-02-12
    • 文件大小：14680064
    • 提供者：dai891011

  1. 数据采集系统中基于FPGA消除尖峰脉冲干扰.pdf

  2. 数据采集系统中基于FPGA消除尖峰脉冲干扰pdf,48 化工自动化及仪表 第36卷 WHEN C00]n= >daTA data dAtA datAdaTA NULL 号经过倍频、辨向、计数后的时序图。 END CASE 2μ4 3 5μs6 END IF 在该描述中可见,电路中还引人了一个时钟信 B 号来同步计数器的操作,此时钟信号除了驱动该计 数模块的比较和计数操作按一定的时间问隔执行 Ok 外,还起到了抗干扰的功能。采用了外部时钟来使 clk count 计数操作同步,只有在同步时

  3. 所属分类：其它

    • 发布日期：2019-09-14
    • 文件大小：271360
    • 提供者：weixin_38744207

  1. 基于FPGA单片机的多机串行通信网络

  2. 本文的主要目的是基于FPGA设计一个集成16个简单UART(通用异步接收发送设备)的模块，该模块采用VHDL语言描述。主单片机通过并口与FPGA相连，FPGA通过16个UART分别与16个从单片机相连，实现单片机串行通信网络系统。

  3. 所属分类：其它

    • 发布日期：2020-08-05
    • 文件大小：76800
    • 提供者：weixin_38547882

  1. FPGA的单片机多机串行通信网络

  2. 本文的主要目的是基于FPGA设计一个集成16个简单UART（通用异步接收发送设备）的模块，该模块采用VHDL语言描述。主单片机通过并口与FPGA相连，FPGA通过16个UART分别与16个从单片机相连，实现单片机串行通信网络系统。

  3. 所属分类：其它

    • 发布日期：2020-08-05
    • 文件大小：76800
    • 提供者：weixin_38646914