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搜索资源列表

  1. 计算机组成与结构课程设计(FD-CES)

  2. 计算机组成与结构 课程设计 外设 运算器采用多累加器结构 操作数寻址.......

  3. 所属分类：专业指导

    • 发布日期：2009-05-31
    • 文件大小：250880
    • 提供者：waixinreng

  1. Verilog_HDL教程

  2. 第1章 EDA技术综述 1 本章内容简介 1 1.1 引言 1 1.2 EDA技术及其发展 2 1.3 设计方法与设计技术 3 1.3.1 Top-down设计 3 1.3.2 Bottom-up设计 5 1.3.3 IP复用技术与SOC 5 1.4 EDA设计的实现 6 1.5 硬件描述语言 7 思考与练习 9 第2章 EDA设计软件与设计流程 10 本章内容简介 10 2.1 EDA软件工具概述 10 2.1.1 集成的CPLD/FPGA开发工具 10 2.1.2 输入工具（Design

  3. 所属分类：嵌入式

    • 发布日期：2009-12-21
    • 文件大小：4194304
    • 提供者：yanlihui13579

  1. 计算机组成与结构课程设计 题四

  2. 适合计算机组成结构课程设计 第四题 （1）不带外部设备 （2）采用多累加器 （3）寻址方式：直接寻址、立即数寻址、寄存器直接寻址 （4）指令由8条指令组成（详见文档） （5）将某一单元扩大4倍存入另一个单元

  3. 所属分类：专业指导

    • 发布日期：2010-06-11
    • 文件大小：174080
    • 提供者：prettybnbs

  1. 计算机组成结构课程设计 题二

  2. 计算机组成结构课程设计 第二题 （1）不带外部设备 （2）运算器采用多累加器组成 （3）采用直接寻址 （4）指令由4条指令组成（详见文本） （5）能将内存两个单元（addr1、addr2）内容想减……

  3. 所属分类：专业指导

    • 发布日期：2010-06-11
    • 文件大小：222208
    • 提供者：prettybnbs

  1. 计算机组成与结构课程设计 题六（3个自己看着办）

  2. 研制一台性能如下的实验计算机。 （1）具有键盘和打印机两种外部设备。 （2）外设和内存统一操作指令，程序查询法使用外设。 （3）运算器采用单累加器多通用寄存器结构。 （4）操作数寻址方式有： 直接地址寻址 立即数寻址 寄存器直接寻址 寄存器间接寻址 （5）指令系统至少含有以下指令（详见文本）

  3. 所属分类：嵌入式

    • 发布日期：2010-06-12
    • 文件大小：217088
    • 提供者：prettybnbs

  1. 计算机组成与结构课程设计 题7

  2. 研制一台性能如下的计算机： ①　具有键盘和打印机两种外部设备。 ②　运算器采用多累加器结构。 ③　操作数寻址方式有： 累加器直接寻址； 累加器间接寻址； 直接地址寻址； 立即数寻址。

  3. 所属分类：嵌入式

    • 发布日期：2010-06-12
    • 文件大小：250880
    • 提供者：wangqing0306

  1. 计算机组成与结构课程设计 题九

  2. 研制一台性能如下的实验计算机： (1) 能使用键盘和打印机两种外设 (2) 运算器采用单累加器多寄存器结构。 (3) 能实现PC相对寻址和变址器变址寻址这两种操作寻址方式，指令系统中有相应的指令。 如： SJMP rel ;(PC) + rel -> PC LD A,addr[Rx] ;(addr + (Rx)) -> A 提示：需要自己设置IAB到IDB的数据缓冲通路 (4) 指令系统中有子程序调用指令（CALL addr）和子程序返回指令（RET）. 提示：需要自己设置堆栈。

  3. 所属分类：嵌入式

    • 发布日期：2010-06-18
    • 文件大小：226304
    • 提供者：prettybnbs

  1. 计算机组成与结构课程设计

  2. 研制一台性能如下的实验计算机。 具有键盘和打印机两种外部设备。 外设和内存统一操作指令，程序查询法使用外设。 运算器采用单累加器多通用寄存器结构。 操作数寻址方式有： 直接地址寻址 立即数寻址 寄存器直接寻址 寄存器间接寻址 指令系统至少含有以下指令：

  3. 所属分类：嵌入式

    • 发布日期：2010-06-20
    • 文件大小：366592
    • 提供者：xuhaitao2

  1. 计算机组成原理课程设计 题7

  2. 研制一台性能如下的实验计算机： 具有键盘和打印机两种外部设备。 运算器采用多累加器结构。 操作数寻址方式有： 累加器直接地址寻址 累加器间接寻址 立即数寻址 直接地址寻址

  3. 所属分类：嵌入式

    • 发布日期：2010-06-20
    • 文件大小：758784
    • 提供者：xuhaitao2

  1. 计算机组成与结构课程设计 题七

  2. 设计一台如下的计算机： 1,具有键盘和打印机两个外设 2，运算器采用多累加器结构 3，具有16条指令 4，能执行将键盘输入的两个一位十进制数相乘并打印输出

  3. 所属分类：专业指导

    • 发布日期：2010-06-20
    • 文件大小：823296
    • 提供者：lf13855304595

  1. 计算机组成与结构课程设计

  2. 研制一台性能如下的实验计算机： （1） 不使用外设。 （2） 运算器采用多累加器结构。 （3） 操作数寻址方式有： 直接地址寻址 立即数寻址 寄存器直接寻址 （4） 指令系统由如下8条指令组成：

  3. 所属分类：嵌入式

    • 发布日期：2010-06-21
    • 文件大小：788480
    • 提供者：wangqing0306

  1. 计算机组成与结构 课程设计

  2. 研制一台性能如下的实验计算机： （1）、具有键盘和打印机两种外部设备 （2）、外设和内存统一操作指令，程序查询法使用外设 （3）、运算器采用单累加器多通用寄存器结构 （4）、操作数寻址方式有： 直接地址寻址 立即数地址寻址 寄存器直接寻址 寄存器间接寻址 （5）、指令系统含如下8条指令 指令编码 指令助记符 指令功能 第一字节 第二字节 I7I6I5I4I3I2I1I0 000 XXX Ri MOV Ri,A (A) →Ri 001 XX0 Ri MOV A,@Ri (I2.I1.I0(Ri)

  3. 所属分类：专业指导

    • 发布日期：2011-03-16
    • 文件大小：1048576
    • 提供者：xuwenli2010

  1. Verilog_HDL经典教程实用手册

  2. 第1章 EDA技术综述 1 本章内容简介 1 1.1 引言 1 1.2 EDA技术及其发展 2 1.3 设计方法与设计技术 3 1.3.1 Top-down设计 3 1.3.2 Bottom-up设计 5 1.3.3 IP复用技术与SOC 5 1.4 EDA设计的实现 6 1.5 硬件描述语言 7 思考与练习 9 第2章 EDA设计软件与设计流程 10 本章内容简介 10 2.1 EDA软件工具概述 10 2.1.1 集成的CPLD/FPGA开发工具 10 2.1.2 输入工具（Design

  3. 所属分类：嵌入式

    • 发布日期：2011-06-02
    • 文件大小：4194304
    • 提供者：heirfr

  1. DSP精简 实用

  2. 精简 实用DSP芯片的发展概况 ：第一阶段，DSP的雏形阶段；第二阶段，DSP的成熟阶段；第三阶段，DSP的完善阶段。 DSP芯片的特点：1．采用哈佛结构2．采用多总线结构3．采用流水线技术4. 配有专用的硬件乘法-累加器5. 具有特殊的DSP指令6．快速的指令周期7．硬件配置强8．支持多处理器结构9．省电管理和低功耗 冯诺依曼结构：该结构采用单存储空间，即程序指令和数据共用一个存储空间，使用单一的地址和数据总线，取指令和取操作数都是通过一条总线分时进行。当进行高速运算时，不但不能同时进行取指

  3. 所属分类：专业指导

    • 发布日期：2011-11-29
    • 文件大小：218112
    • 提供者：by99999

  1. 计算机组成与结构课程设计

  2. 1． 实验计算机整机应由如下几个模块组成：运算器、指令部件、内存、微程序控制器、总线缓冲电路、启停和时序控制电路。 2． 运算器采用多累加器结构。 3． 操作数寻址方式采用以下几种： 直接地址寻址 (addr)-﹥Ai，或（Ai）-﹥addr 累加器直接寻址 (Ai)-﹥A，或 （A）-﹥Ai 累加器间接寻址 ((Ai))-﹥A，或 （A）-﹥(Ai) 立即数寻址 data-﹥A，或data-﹥Ai 4． 指令系统按16条指令规模设计，主要设计如下几条指令： MOV Ai，DATA MOV A

  3. 所属分类：其它

    • 发布日期：2011-12-17
    • 文件大小：250880
    • 提供者：wanglei_134

  1. 计算机组成与结构课程设计

  2. 利用 FD—CES 实验仪提供的硬件资源（功能模块、控制台及外设等），按设计、组装、调试等步骤研制一台微程序控制的实验计算机研制一台性能如下的计算机： 具有键盘和打印机两种外部设备。 运算器采用多累加器结构。 操作数寻址方式有： 累加器直接寻址； 累加器间接寻址； 直接地址寻址； 立即数寻址。 指令系统由以下16条指令组成：

  3. 所属分类：嵌入式

    • 发布日期：2008-12-22
    • 文件大小：250880
    • 提供者：englishguigui

  1. 计算机组成与结构课程设计

  2. 题四：研制一台性能如下的实验计算机。 （1） 不使用外设。 （2） 运算器采用多累加器结构。 （3） 操作数寻址方式有： 直接地址寻址 立即数寻址 寄存器直接寻址 （4(5) 能执行将内存某一单元内容（非零）扩大4倍后存入另一个单元（程序自编）。 ） 指令系统如下8条指令组成：

  3. 所属分类：嵌入式

    • 发布日期：2008-12-24
    • 文件大小：422912
    • 提供者：woshihuangqing

  1. 实验计算机的课程设计

  2. 研制一台性能如下的实验计算机： （1） 不使用外设。 （2） 运算器采用多累加器结构。 （3） 操作数寻址方式有： 直接地址寻址 立即数寻址 寄存器直接寻址 （4） 指令系统由如下8条指令组成： 指令编码 助记符 指令功能 第一字节 第二字节 I7 I6 I5 I4 I3 I2 I1 I0 0 0 0 Ai X Aj ADD Ai,Aj (Ai)+(Aj)->Ai 0 0 1 Ai X Aj MOV Ai,Aj (Ai)->(Ai) 0 1 0 Ai X Aj SL Ai,Aj (

  3. 所属分类：嵌入式

    • 发布日期：2008-12-25
    • 文件大小：794624
    • 提供者：w516000013

  1. 计算机组成与结构课程设计

  2. 本课题研究的主要内容: 研制一台性能如下的实验计算机： （1） 不使用外设。 （2） 运算器采用多累加器结构。 （3） 操作数寻址方式有：直接地址寻址立即数寻址.寄存器直接寻址 （4） 指令系统由如下8条指令组成： 指令编码 助记符 指令功能 第一字节 第二字节 I7 I6 I5 I4 I3 I2 I1 I0 0 0 0 Ai X Aj ADD Ai,Aj (Ai)+(Aj)->Ai 0 0 1 Ai X Aj MOV Ai,Aj (Ai)->(Ai) 0 1 0 Ai X Aj

  3. 所属分类：嵌入式

    • 发布日期：2008-12-25
    • 文件大小：664576
    • 提供者：zmlhy

  1. 单片机与DSP中的基于多速率DA的根升余弦滤波器的FPGA实现

  2. 0 引 言 　　根升余弦成形滤波器是数字信号处理中的重要部件，它能对数字信号进行成形滤波，压缩旁瓣，减少干扰的影响，从而降低误码率。根据文献[1]，它的传统FP-GA实现方式基于乘累加器(Multiplier Add Cell，MAC)结构，设计方便，只需要乘法器、加法器和移位寄存器即可实现，但是在FPGA中实现硬件乘法器十分耗费资源。特别是当滤波器阶数很高时，资源耗费不可忽视。若采用乘法器复用的结构，运算速度较慢。分布式算法(Distribute Arithmetic，DA)是另一种应用在F

  3. 所属分类：其它

    • 发布日期：2020-11-09
    • 文件大小：505856
    • 提供者：weixin_38517728
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