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搜索资源列表

  1. 嵌入式硬件系统设计与应用实例

  2. 本书重点介绍了嵌入式应用系统硬件的设计与开发，主要包括嵌入式应用系统硬件设计与开发的基础知识、各种典型嵌入式处理器及其典型应用、嵌入式应用系统硬件设计原理图及其分析。本书分为三篇共9章：第一篇基础知识（第1章），主要介绍嵌入式硬件设计的基础知识和总体设计原则；第二篇实例分析（第2章至第6章），主要介绍各种典型嵌入式处理器及其应用、与嵌入式硬件系统设计有关的总线技术和接口技术及其应用、嵌入式硬件系统电源器件选择及电路的设计、嵌入式硬件系统外围接口电路的设计；第三篇提高与应用（第7章至9章），通过

  3. 所属分类：硬件开发

    • 发布日期：2009-05-03
    • 文件大小：10485760
    • 提供者：chwnin

  1. 大型数据库设计优化技巧

  2. 关于大型数据库设计与优化的专业文章，很不错，值得学习

  3. 所属分类：专业指导

    • 发布日期：2009-05-06
    • 文件大小：275456
    • 提供者：myqiantu

  1. 新型大型超市管理信息系统研究与设计

  2. 新型大型超市管理信息系统研究与设计新型大型超市管理信息系统研究与设计

  3. 所属分类：专业指导

    • 发布日期：2009-05-06
    • 文件大小：179200
    • 提供者：hyq182209268

  1. C#设计模式(附源码)

  2. 该书首先简明扼要地介绍了c#，面向对象程序设计和UML图；然后分别说明了23种设计模式以及何时使用这些模式，并阐明了模式在大型设计中的作用，每种模式的应用都用简单的示例程序加以论证。

  3. 所属分类：其它

    • 发布日期：2007-08-30
    • 文件大小：6291456
    • 提供者：cellcomcn

  1. 大型设计中FPGA 的多时钟设计策略

  2. 大型设计中FPGA 的多时钟设计策略~~~~~~~~~~~~

  3. 所属分类：硬件开发

    • 发布日期：2009-11-02
    • 文件大小：216064
    • 提供者：llljjlj

  1. 大型设计中FPGA 的多时钟设计策略-经验篇

  2. 利用 FPGA 实现大型设计时，可能需要FPGA 具有以多个时钟运行的多重数据通路，这种 多时钟 FPGA 设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟 设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何 进行布线，本文将对这些设计策略深入阐述。

  3. 所属分类：硬件开发

    • 发布日期：2011-03-01
    • 文件大小：216064
    • 提供者：luno1

  1. 大型设计中FPGA 的多时钟设计策略

  2. 利用FPGA实现大型设计时，可能需要FPGA具有以多个时钟运行的多重数据通路，这种多时钟FPGA设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何进行布线，本文将对这些设计策略深入阐述。

  3. 所属分类：其它

    • 发布日期：2011-07-03
    • 文件大小：216064
    • 提供者：safan008

  1. 大型设计中FPGA 的多时钟设计策略

  2. 大型设计中FPGA 的多时钟设计策略,讲述了FPGA设计时处理多时钟产生的一些问题

  3. 所属分类：硬件开发

    • 发布日期：2011-11-12
    • 文件大小：216064
    • 提供者：nnectar

  1. 大型设计中FPGA的多时钟设计策略

  2. 大型设计中FPGA的多时钟设计策略，值得参考。

  3. 所属分类：硬件开发

    • 发布日期：2013-01-05
    • 文件大小：216064
    • 提供者：diego01

  1. 大型设计中FPGA 的多时钟设计策略.pdf

  2. 大型设计中FPGA 的多时钟设计策略.pdf

  3. 所属分类：硬件开发

    • 发布日期：2008-09-02
    • 文件大小：216064
    • 提供者：q042096

  1. 大型设计中FPGA 的多时钟设计策略

  2. 大型设计中FPGA 的多时钟设计策略,多时钟的解决方案

  3. 所属分类：硬件开发

    • 发布日期：2013-10-07
    • 文件大小：235520
    • 提供者：dongdahanzhiwei

  1. web投票系统大型设计周

  2. web投票系统 大型设计周 软件工程 需求分析说明书 概要设计说明书 详细设计说明书 用户手册 可执行文件

  3. 所属分类：C#

    • 发布日期：2014-06-18
    • 文件大小：1048576
    • 提供者：a6206486

  1. 300Java设计模式部分学习笔记

  2. 该pdf是本人系统学习尚学堂推出的300Java大型设计模式部分后自己整理的学习笔记，希望对大家有帮助！！！

  3. 所属分类：Java

  1. 大型设计企业实行EPC工程总承包项目管理的思考

  2. 在市场竞争当中,大型设计企业逐步实行EPC工程总承包是调整经营结构,增强综合实力,向国际工程公司转变的有效途径。文章分析了大型设计企业开展EPC工程总承包的内外动力,并提出了对设计企业开拓EPC工程总承包市场需解决理性项目参与和追求利益最大化之间的平衡、传统重技术轻管理业务模式对现代EPC工程总承包管理发展的瓶颈制约、项目经理负责制异化与理性回归之间矛盾等问题的思考。

  3. 所属分类：其它

    • 发布日期：2020-06-02
    • 文件大小：650240
    • 提供者：weixin_38499503

  1. 基于AutoCAD Projector辅助软件的夹具设计

  2. 借助AutoCAD平台上二次开发后形成的Projector软件进行加工工件及其夹具零件的设计,具有简便易行的特性,克服了在短时间内熟练使用大型设计软件的困难。结合Projector软件设计拨叉工件及其夹具零件,简化了设计过程,为其他设计研究提供了新的思路。

  3. 所属分类：其它

    • 发布日期：2020-06-29
    • 文件大小：233472
    • 提供者：weixin_38572960

  1. 大型设计中FPGA的多时钟设计策略

  2. 利用FPGA实现大型设计时，可能需要FPGA具有以多个时钟运行的多重数据通路，这种多时钟FPGA设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何进行布线，本文将对这些设计策略深入阐述。

  3. 所属分类：其它

    • 发布日期：2020-08-28
    • 文件大小：150528
    • 提供者：weixin_38690149

  1. FPGA大型设计应用的多时钟设计策略阐述

  2. 利用FPGA实现大型设计时，可能需要FPGA具有以多个时钟运行的多重数据通路，这种多时钟FPGA设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何进行布线，本文将对这些设计策略深入阐述。

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：179200
    • 提供者：weixin_38718307

  1. EDA/PLD中的大型设计中FPGA的多时钟设计策略

  2. FPGA设计的第一步是决定需要什么样的时钟速率，设计中最快的时钟将确定FPGA必须能处理的时钟速率。最快时钟速率由设计中两个触发器之间一个信号的传输时间P来决定，如果P大于时钟周期T，则当信号在一个触发器上改变后，在下一个逻辑级上将不会改变，直到两个时钟周期以后才改变，如图1所示。      　　传输时间为信号在第一个触发器输出处所需的保持时间加上两级之间的任何组合逻辑的延迟，再加两级之间的布线延迟以及信号进入第二级触发器的设置时间。无论时钟速率为多少，每一个FPGA设计所用的时钟必须具有低

  3. 所属分类：其它

    • 发布日期：2020-11-25
    • 文件大小：182272
    • 提供者：weixin_38748239

  1. gzzd:java应用故障诊断工具预研demo，基于开源项目bistoury修改，99.999％代码保持一致，原项目明显是为多变量大型设计，对于小体积的配置和调试略复杂。和服务时开发和部署，支持kubernetes部署-源码

  2. zz 故障诊断介绍 java应用故障诊断工具预研demo，基于开源项目bistoury修改，99.999％代码保持一致，原项目明显是为多变量大型设计，对于小体积的配置和调试略复杂。和服务时开发和部署，支持kubernetes部署。 故障诊断工具的使用场景是定位解决一些极端情况下的问题，作为传统策略无法分析故障时的诊断工具，我们并不追求日常场景下的变频使用，还是建议大家好好写代码，认真做测试。 通过在线诊断工具发现，定位和解决应用问题。主要措施包括：实例信息的全方位展示，故障点的精确观察，故障代码

  3. 所属分类：其它

    • 发布日期：2021-03-23
    • 文件大小：42991616
    • 提供者：weixin_42133452

  1. 大型设计中FPGA的多时钟设计策略

  2. FPGA设计的步是决定需要什么样的时钟速率，设计中快的时钟将确定FPGA必须能处理的时钟速率。快时钟速率由设计中两个触发器之间一个信号的传输时间P来决定，如果P大于时钟周期T，则当信号在一个触发器上改变后，在下一个逻辑级上将不会改变，直到两个时钟周期以后才改变，如图1所示。      　　传输时间为信号在个触发器输出处所需的保持时间加上两级之间的任何组合逻辑的延迟，再加两级之间的布线延迟以及信号进入第二级触发器的设置时间。无论时钟速率为多少，每一个FPGA设计所用的时钟必须具有低抖动特性。抖

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：219136
    • 提供者：weixin_38723027
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