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  1. 浮点数转定点数Verilog

  2. 浮点数转定点数 FPGA Verilog

  3. 所属分类：硬件开发

    • 发布日期：2014-08-25
    • 文件大小：2048
    • 提供者：huangyc1988

  1. fix_to_float32.v

  2. 用Verilog HDL编写的定点数转单精度浮点数的程序模块，modelsim仿真和上板实验成功，在输出端口加了几个寄存器延时来匹配xilinx官方的输出时序，经测试和xilinx官方IP核时序基本保持一致。

  3. 所属分类：嵌入式

    • 发布日期：2019-09-02
    • 文件大小：4096
    • 提供者：suifeng654456

  1. 定点数转浮点数verilog

  2. 本文目的是记录学习《数字信号处理的FPGA实现》过程中，用verilog语言实现简单的定点数到浮点数转换的经历。

  3. 所属分类：其它

    • 发布日期：2020-08-02
    • 文件大小：44032
    • 提供者：weixin_38619207