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对FPGA的计算机防视频信息泄漏系统设计
假如显示终端为数字微镜DMD(Digital MicromirrorDevice)显示器。该显示器将计算机每个像素点的图像信号经过数字光处理DLP(Digital Light Processing)后,存入SDRAM双向缓存器,当一帧图像接收完毕时,内部数据处理电路同时激发各像素点对应的微镜运动,完成一帧图像的显示。DMD显示器峰值数字驱动电压不超过33.5V,电磁辐射很低,且各微镜片同时驱动,形成相互干扰的向外辐射信号,解码难度极大,从而使其成为无信息泄漏的显示器。此时,视频电缆的辐射在整个视
所属分类:
其它
发布日期:2020-12-05
文件大小:390144
提供者:
weixin_38680957