在现代通信、雷达和声纳系统中，随着实时处理要求的不断提高，对数字信号处理系统也提出了更高的要求。板载多片高性能的DSP芯片，配合大容量的SDRAM，可以很好地满足上述要求，并且已经成为了数字信号处理系统发展的趋势。采用CPCI总线集成系统，可以方便主机进行调试，控制和管理DSP系统。系统中的主机接口可以使主机通过CPCI总线访问板上的DSP和SDRAM芯片，这是多DSP系统设计的关键点之一。 　　不同于以往简单地使用一个CPLD进行粘合逻辑设计，本文提出了一种基于双状态机＋Cache，预存预取