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VHDL 程序举例打包,应该有你想要的
VHDL 程序举例 文件夹中包括下面程序 -------------------------------------------------------------------------------- NOTE:该程序参考FPGA中文网站 重要说明:不同软件对VHDL语法的支持范围是不一样的,以下程序中的某些语句可能不能运行在所有的软件平台之上,因此程序可能要作一些修改,同时务必注意阅读程序中的注释。以下部分程序为txt格式,请自行另存为vdh后缀的文件。有些EDA软件要求ENTITY的名称
所属分类:
网络攻防
发布日期:2009-07-23
文件大小:43008
提供者:
engddy
三种高速乘法器的FPGA实现及性能比较
乘法是数字信号处理中重要的基本运算,在很大程度上影响着系统的性能。本文将介绍三种高速乘法器实现原理:阵列乘法器、华莱士(WT)乘法器、布斯华莱士树超前进位乘法器。而且通过FPGA技术实现了这三种乘法器,并对基于以上三种架构的乘法器性能进行了分析比较。
所属分类:
硬件开发
发布日期:2009-09-01
文件大小:793600
提供者:
tianhongli72
三种高速乘法器的FPGA实现及性能比较
乘法是数字信号处理中重要的基本运算,在很大程度上影响着系统的性能。本文将介绍三种高速乘法器实现原理:阵列乘法器、华莱士(WT)乘法器、布斯华莱士树超前进位乘法器。而且通过FPGA技术实现了这三种乘法器,并对基于以上三种架构的乘法器性能进行了分析比较。
所属分类:
硬件开发
发布日期:2010-10-27
文件大小:794624
提供者:
feiniao200201
VHDL 的实例程序
在里面包含了42葛vhdl的实例 有8位总LED七段译码线收发器:74245,fifo存储器举例:(注3),布斯乘法器,加法器源程序,莫尔型状态机1,一个游戏程序,等等
所属分类:
其它
发布日期:2011-03-13
文件大小:45056
提供者:
L243068794
booth算法乘法器实现
布斯乘法实现实例mul14x15 算法实现PDF文档
所属分类:
硬件开发
发布日期:2011-10-14
文件大小:428032
提供者:
caojunmafia
verilog的布斯乘法器
verilog的布斯乘法器daima entity booth16 is port ( rst: in std_logic; -- active high; to reset the system clk: in std_logic; go: in std_logic;-- if go rises from ‘0’ to ‘1’, multiplier starts operation y: in std_logic_vector(15 downto 0); x: in std_logic_v
所属分类:
其它
发布日期:2011-11-10
文件大小:22528
提供者:
daniel_zhe
布斯乘法器及其仿真模块
布斯乘法器及其仿真模块,该资源在工程中应用过的,有需要的朋友也可以在工程中直接应用……
所属分类:
硬件开发
发布日期:2012-09-25
文件大小:1024
提供者:
dongzainanfang55
具体程序 VHDL程序实例
程序中主要包括: 最高优先级编码器 8位相等比较器 三人表决器 加法器描述 8位总线收发器 地址译码 多路选择器 LED七段译码 多路选择器 双2-4译码器 多路选择器 汉明纠错码编码器 双向总线 汉明纠错吗译码器 三态总线 时序逻辑: 四D触发器 用状态机实现的计数器 简单的锁存器 各种功能的计数器 简单的12位寄存器 通用寄存器 带load、clr等功能的寄存器 带三态输出的8位D寄存器 移位寄存器 存储器举例 状态机举例 一个简单的状态机 莫尔型状态机1 使用列举类型的状态机 莫尔型状态
所属分类:
网络攻防
发布日期:2009-02-25
文件大小:20480
提供者:
rxiaolu
乘法器的布斯算法原理与verilog实现.docx
原创文档,比较详细的布斯编码硬件乘法器的原理讲解与实现,附完整的可仿真可综合示例代码,适合对集成电路基本运算模块设计感兴趣的工程师或初学者参考
所属分类:
硬件开发
发布日期:2020-04-08
文件大小:14680064
提供者:
yuhua841015