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搜索资源列表

  1. 高性能异构多处理器平台及其应用

  2. 在视频编解码领域，随着视频图像分辨率的提高对处理平台的计算能力、存储、传输带宽的需求急剧增 加。为满足高分辨率视频编解码对处理平台的巨大性能需求，本文结合流处理器在媒体处理上的独特优势以及FPGA 灵活的可配置性构建了一个由流处理器和FPGA 组成的可配置异构多处理器平台。为了对平台进行性能测试，将MOTION JPEG 算法并行化后映射到该平台上，对分辨率为4096x2160 的高清数字电影源文件进行视频编码，达到了30.3 帧/s 的压缩速率。

  3. 所属分类：3G/移动开发

    • 发布日期：2012-04-25
    • 文件大小：492544
    • 提供者：jmgao2

  1. 基于粒子群优化的异构多处理器任务调度算法

  2. 出一种基于粒子群优化的 异构多处理器任务调度算法———ＦＰＳＯＴＴＳ算法

  3. 所属分类：嵌入式

    • 发布日期：2014-08-08
    • 文件大小：1048576
    • 提供者：panyuanyuan013

  1. 创龙带您解密TI、Xilinx异构多核SoC处理器核间通讯-20200327.pdf

  2. 1什么是异构多核SoC处理器 顾名思义，单颗芯片内集成多个不同架构处理单元核心的SoC处理器，我们称之为异构多核SoC处理器，比如： TI的OMAP-L138（DSP C674x + ARM9）、AM5708（DSP C66x + ARM Cortex-A15）SoC处理器等； Xilinx的ZYNQ（ARM Cortex-A9 + Artix-7/Kintex-7可编程逻辑架构）SoC处理器等。

  3. 所属分类：嵌入式

    • 发布日期：2020-03-27
    • 文件大小：2097152
    • 提供者：Tronlong_

  1. 异构多核的全高清H264解码系统设计

  2. 利用异构多核处理器OMAP4430在多媒体视频编解码上的运算优势,实现了全高清H264视频的实时解码。采用virtio缓存队列和RPMsg消息框架来实现基于异步通知的异构多核间数据通信，并结合TI公司IVAHD多媒体硬件加速引擎和针对多核进行的合理任务分配机制来提高解码器的工作效率。

  3. 所属分类：其它

    • 发布日期：2020-07-27
    • 文件大小：109568
    • 提供者：weixin_38708841

  1. 基于异构多核全高清H264解码系统设计

  2. 本文采用移动Soc OMAP4430异构多核处理器为实验平台，通过基于virtio缓存队列和RPMsg消息框实现了异构多核间多媒体数据通信，同时结合IVA-HD多媒体硬件加速引擎设计了一款全高清H264视频硬解码系统。

  3. 所属分类：其它

    • 发布日期：2020-08-05
    • 文件大小：102400
    • 提供者：weixin_38703955

  1. 基于异构多核的全高清H264解码系统设计

  2. 随着移动互联网时代的到来，在移动终端上流畅播放全高清视频成为任务日常需求。为此本文采用移动Soc OMAP4430异构多核处理器为实验平台，通过基于virtio缓存队列和RPMsg消息框实现了异构多核间多媒体数据通信，同时结合IVA-HD多媒体硬件加速引擎设计了一款全高清H264视频硬解码系统。

  3. 所属分类：其它

    • 发布日期：2020-08-12
    • 文件大小：350208
    • 提供者：weixin_38694006

  1. 异构多处理器嵌入式计算平台的设计

  2. 提出了采用异构多处理器体系结构构建嵌入式计算平台的思想，并基于该思想采用Cortex M3主处理器和MSP430协处理器构建了异构多处理器体系结构的433 MHz有源RFID读写机具。实际验证结果表明,采用异构多处理器构建的嵌入式计算平台实现了计算密集型应用与控制密集型应用的有效分离，大大提高了系统的灵活性和资源分配的合理性。

  3. 所属分类：其它

    • 发布日期：2020-08-31
    • 文件大小：416768
    • 提供者：weixin_38678394

  1. 面向SAR雷达信号处理的异构多核SoC研究

  2. 首先介绍了目前星载SAR(合成孔径雷达) 系统构成，从中分析出开展高性能多核处理器的必要性和紧迫性。接下来介绍了正在研发的面向SAR雷达信号处理的异构多核SoC，详细介绍了芯片的系统结构和片上网络总线。芯片内总线采用多层二维网格总线，每层总线内部存在两种传递模式：动态传递和静态传递。动态面向数据包的灵活传递，静态面向高速数据流传递。最后，在性能和功耗等方面与目前常用的数字信号处理器进行了对比，并说明此异构多核SoC对SAR雷达信号处理结果。

  3. 所属分类：其它

    • 发布日期：2020-10-16
    • 文件大小：412672
    • 提供者：weixin_38653040

  1. 基于异构多核运动控制器的高速接口设计

  2. 随着制造领域对嵌入式运动控制系统应用范围的扩大，基于异构多核的嵌入式控制器必为重要发展方向之一。首先说明异构多核控制器取得成效，以及现有控制器在数据通信接口方面存在缺陷。本设计运动控制器以异构处理器——OMAPL138+FPGA为核心，OMAPL138内部集成ARM9和DSP C6748处理器核。ARM9内嵌Liunx操作系统，以增强控制器多任务协调能力；DSP不运行操作系统，可保证运算实时性。重点阐述ARM与DSP、DSP与FPGA以及控制器与PC之间通信的高速接口设计和固件设计。通过实验表明

  3. 所属分类：其它

    • 发布日期：2020-10-16
    • 文件大小：363520
    • 提供者：weixin_38689922

  1. 嵌入式系统/ARM技术中的基于异构多核处理器的静态任务调度研究（二）

  2. 接上文： 基于异构多核处理器的静态任务调度研究（一） 　　3 实验验证 　　3.1 性能评价参数 　　在静态任务调度中，任务调度的开销比较小，任务调度的总长度成为评价一个任务调度算法的性能标准，除此之外还有任务调度长度比率、算法的效率等，具体的评定标准和公式如下： 　　（1）调度长度makespan,为所有处理器上的最大任务调度长度。 　　（2）调度长度比率SLR,计算公式如式（9）所示，分母为所有关键路径任务执行时间的最小值之和。SLR的值总是大于等于1的，且值越小，任务调度算法性

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：63488
    • 提供者：weixin_38519619

  1. 嵌入式系统/ARM技术中的基于异构多核处理器的静态任务调度研究（一）

  2. 摘 要：针对现存任务调度算法优先级选取过于单一、冗余任务处理较晚的问题，提出一种基于加权优先级的任务调度算法-WPTS算法。该算法综合考虑任务3个属性的加权值以决定任务被处理的先后次序，从而克服了任务选取时的单一性问题。在将任务分配到处理器的过程中，保证任务优先调度到完成时间最早的处理器上。同时，引入冗余任务处理过程，及时消除冗余任务，达到对处理器空闲时间段进行有效回收、减少处理器调度长度的效果。性能对比实验表明，WPTS算法较CPFD算法、HCPFD算法和HDEFT算法能取得更好的性能。 　

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：182272
    • 提供者：weixin_38537689

  1. 嵌入式系统/ARM技术中的针对异构多核的嵌入式软件解决方案

  2. 异构多核架构即结合两种或多种不同类型的微处理器或微控制器的架构。因其能够提供更高的处理器性能、更有效的电源利用率，并且占用更少的物理空间，近来在嵌入式领域得到了大范围推广，特别是在强调整合功能性和连通性的高性能嵌入式设备方面。但是，与异构多核硬件平台的发展速度相比，相应的软件支持比较滞后。毕竟只有软硬件兼具的解决方案才能充分发挥这一架构的优势，真正实现芯片的性能、面积、功耗之间的最佳组合。 　　针对这一现状，Mentor推出了嵌入式软件行业首款针对异构多核SoC开发的全面解决方案，该方案可为包

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：155648
    • 提供者：weixin_38638002

  1. 存储/缓存技术中的基于异构多核全高清H264解码系统设计

  2. 移动互联网时代的到来，高清多媒体视频的普及，3D大型手机游戏对的出现，单核嵌入式硬件平台已经难以满足复杂的实际计算需求。而异构多核处理器在视频编解码运算上具有强大的优势，已经成为了嵌入式处理器架构发展的趋势。目前普遍高清视频编解码都采用异构多核处理器内的DSP进行协同处理，通过片上通信机制实现核间多媒体数据传输。DSP相比软解码在速度和性能上得到了一定的提升，如DaVinci平台内置DSP能够实现720P视频实时解码。但DSP运行时需要对信箱以及DMA进行配置，占用较多的片上通信带宽，导致核间通

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：282624
    • 提供者：weixin_38715097

  1. 异构多处理器嵌入式计算平台的设计

  2. 提出了采用异构多处理器体系结构构建嵌入式计算平台的思想，并基于该思想采用Cortex M3主处理器和MSP430协处理器构建了异构多处理器体系结构的433 MHz有源RFID读写机具。实际验证结果表明,采用异构多处理器构建的嵌入式计算平台实现了计算密集型应用与控制密集型应用的有效分离，大大提高了系统的灵活性和资源分配的合理性。基于该体系结构重构传统嵌入式计算平台时对应用系统透明，使其具有广泛的应用前景。

  3. 所属分类：其它

    • 发布日期：2020-10-18
    • 文件大小：423936
    • 提供者：weixin_38600460

  1. 异构多核图形处理器存储系统设计与实现

  2. 提出了异构多核图形处理器(HMGPU)存储管理系统的硬件实现方法，采用固定分区与分页式分区两种方式分别对大片连续数据与小片非连续数据进行管理，使用Verilog语言进行硬件设计和仿真，并在FPGA开发板上进行了验证。实验结果表明，该系统为HMGPU提供了2 021.2 MB/s的有效存储带宽。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：185344
    • 提供者：weixin_38592758

  1. 基于SystemC的异构多核通信模块设计及MP3解码程序的多核测试

  2. 异构多核处理器系统的几种主要通信机制，事实上都可以通过一个共享存储区来实现，例如邮箱、消息、信号量实际上都是以共享存储区作为传播载体。同时，也考虑到 SystemC 的设计方法可以支持设计者在不同层次上建模减小了代码量和工作量，提供了更高的工作效 率。因此本文在采用共享存储器通信机制[3]的同时，基于SystemC 提出且建立事务级多核通 信模型，并利用MP3 解码程序实例证明了本模型有效的实现了多核间的通信。

  3. 所属分类：其它

    • 发布日期：2020-10-26
    • 文件大小：247808
    • 提供者：weixin_38532629

  1. 异构多核SoC中FFT处理器的优化与实现研究

  2. 异构多核SoC中FFT处理器的优化与实现研究

  3. 所属分类：其它

    • 发布日期：2021-03-18
    • 文件大小：2097152
    • 提供者：weixin_38747233

  1. 考虑时间限制，通过在异构多核处理器上进行有效的任务分配来最大程度地降低系统成本

  2. 高性能计算系统通常采用异构多核设计来提高执行性能和效率。 任务分配对于利用异构多核处理器上的计算能力，能耗以及通信成本的多样性至关重要。 在本文中，我们探索了在异构多核处理器上进行任务分配的机会，以在考虑时间限制的情况下最大程度地减少执行和通信成本。 一般的异构任务分配问题是NP-Complete。 但是，我们发现使用动态编程可以为广泛使用的树形任务图实现最佳任务分配。 我们首先提出一种动态规划算法，即最佳树分配（OTA）算法，以生成树的最佳分配。 然后，我们开发了有向无环图的一般任务分配问题的

  3. 所属分类：其它

    • 发布日期：2021-03-10
    • 文件大小：650240
    • 提供者：weixin_38686677

  1. 基于ZYNQ异构多核处理器的人体动作识别系统

  2. 基于ZYNQ异构多核处理器的人体动作识别系统

  3. 所属分类：其它

    • 发布日期：2021-03-08
    • 文件大小：1048576
    • 提供者：weixin_38730331

  1. 基于改进的混洗蛙跳算法的异构多核处理器任务调度

  2. 针对异构多核环境下的任务调度问题,为充分发挥异构多核平台优势,提出一种基于改进的混洗蛙跳算法的异构多核处理器任务调度算法——ISFLA算法。ISFLA算法通过建立合适的个体编码方案和位置更新方法实现个体搜索空间到离散空间的映射,通过调整子群更新方法规避在离散空间下标准算法中子群更新易于停滞在最差值的情况,使得标准SFLA算法可以应用于异构多核环境下的任务调度问题。同时算法引入了遗传算法的交叉操作,通过将全局较优解群体的信息扩散到种群,增加了算法跳出局部极优值的能力,优化了算法的全局搜索能力。最后

  3. 所属分类：其它

    • 发布日期：2021-03-02
    • 文件大小：225280
    • 提供者：weixin_38654589
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