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折叠共源共栅运算放大器原理及设计
本文介绍的运放是一种采用TSMC 0.18 μm Mixed Signal SALICIDE（1P6M，1.8V/3.3V）CMOS工艺的折叠共源共栅运放，并对其进行了DC，AC及瞬态分析，最后与设计指标进行比较。
所属分类：
其它
发布日期：2020-08-11
文件大小：197632
提供者：
weixin_38620314
