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  1. 数字语音解码器的低功耗设计策略

  2. 数字语音解码器的低功耗设计策略,近年来,随着个人手持多媒体设备的快速增长,低功耗设计变得越来越重要,甚至成为决定产品是否成功的关键,
  3. 所属分类:其它

    • 发布日期:2020-10-25
    • 文件大小:103424
    • 提供者:weixin_38727579
  1. 模拟技术中的数字语音解码器的低功耗设计策略

  2. 近年来,随着个人手持多媒体设备的快速增长,低功耗设计变得越来越重要,甚至成为决定产品是否成功的关键,如笔记本电脑、PDA、移动电话等时尚消费和商务类电子产品,对电池的供电时间要求越来越高,高功耗成为延长电池使用时间突出的制约因素。   CMOS数字电路的功耗主要由3部分组成:跳变功耗、短路功耗和静态漏电功耗。其中占系统功耗比例大于90%的为跳变功耗,也称动态功耗。对于SoC而言,所有的设计方法都是围绕着动态功耗来进行。如何从各个层次、各个方面尽量减少动态功耗,将是语音解码设计中的重点内容。
  3. 所属分类:其它

    • 发布日期:2020-11-05
    • 文件大小:103424
    • 提供者:weixin_38590784
  1. 数字语音解码器的低功耗设计方案

  2. 近年来,随着个人手持多媒体设备的快速增长,变得越来越重要,甚至成为决定产品是否成功的关键,如笔记本电脑、PDA、移动电话等时尚消费和商务类电子产品,对电池的供电时间要求越来越高,高功耗成为延长电池使用时间突出的制约因素。CMOS数字电路的功耗主要由3部分组成:跳变功耗、短路功耗和静态漏电功耗。其中占系统功耗比例大于90%的为跳变功耗,也称动态功耗。对于SoC而言,所有的设计方法都是围绕着动态功耗来进行。如何从各个层次、各个方面尽量减少动态功耗,将是语音解码设计中的重点内容。1 语音的低功耗设计策
  3. 所属分类:其它

    • 发布日期:2021-01-20
    • 文件大小:78848
    • 提供者:weixin_38725734
  1. 数字语音解码器的低功耗设计策略

  2. 近年来,随着个人手持多媒体设备的快速增长,低功耗设计变得越来越重要,甚至成为决定产品是否成功的关键,如笔记本电脑、PDA、移动电话等时尚消费和商务类电子产品,对电池的供电时间要求越来越高,高功耗成为延长电池使用时间突出的制约因素。   CMOS数字电路的功耗主要由3部分组成:跳变功耗、短路功耗和静态漏电功耗。其中占系统功耗比例大于90%的为跳变功耗,也称动态功耗。对于SoC而言,所有的设计方法都是围绕着动态功耗来进行。如何从各个层次、各个方面尽量减少动态功耗,将是语音解码设计中的重点内容。
  3. 所属分类:其它

    • 发布日期:2021-01-20
    • 文件大小:106496
    • 提供者:weixin_38686860