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资源分类
搜索资源列表
EDA数字钟设计(报告+ppt)
EDA数字钟设计,有报告和ppt,程序是没有问题的啊
所属分类:
专业指导
发布日期:2009-05-14
文件大小:312320
提供者:
duncan01
EDA技术多功能数字钟系统的设计
本设计为通过EDA仿真软件MAX+PLUSII设计一个多功能数字钟,并下载到硬件中实现。本系统的设计电路由计时电路、动态显示电路、闹钟电路、控制电路、显示电路等部分组成。本系统采用动态显示的原理在数码管上显示12小时计时的时刻,具有清零、保持、校时、报时的功能,并在此基础上增加了闹铃、秒表、12小时制计时、A/P显示等功能。
所属分类:
嵌入式
发布日期:2009-05-15
文件大小:521216
提供者:
liujilong8
简易电子琴(数字逻辑与数字系统课程设计报告)
摘 要 随着基于CPLD的EDA技术的发展和应用领域的扩大与深入,EDA技术在电子信息、通信、自动控制用计算机等领域的重要性日益突出。作为一个学电子信息专业的学生,我们必须不断地了解更多的新产品信息,这就更加要求我们对EDA有个全面的认识。本程序设计的是简易电子琴的设计。采用EDA作为开发工具,VHDL语言为硬件描述语言,MAX + PLUS II作为程序运行平台,所开发的程序通过调试运行、波形仿真验证,初步实现了设计目标。本程序使用的硬件描述语言VHDL,可以大大降低了硬件数字系统设计的入门
所属分类:
C
发布日期:2009-05-22
文件大小:225280
提供者:
chflh
EDA技术数据选择器电路设计
1、数据选择器的工作原理。 2、基于FPGA和EDA软件的数字电路设计方法与工作流程 3、使用VHDL设计数据选择器的方法。 4、VHDL相关语法知识 5、EDA实验开发系统相关知识。 6、在EDA软件( Max+PlusII软件)平台上VHDL程序的功能仿真的方法。
所属分类:
嵌入式
发布日期:2009-05-25
文件大小:616448
提供者:
s617015380
EDA数字分频器 EDA的分频设计
EDA的分频设计 1. 四位十进制数字频率计; 2. 测量范围:1Hz~10kHz; 3. 显示时间不少于1S; 4. 具有记忆显示的功能,即在测量过程中不刷新数据,等结束后才显示测量结果,给出待测信号的频率值,并保存到下一次测量结束。
所属分类:
专业指导
发布日期:2009-05-29
文件大小:220160
提供者:
ZXBzhangxiaobo
基于VHDL的数字时钟的设计
随着EDA技术的发展和应用领域的扩大与深入,EDA技术在电子信息、通信、自动控制及计算机应用领域的重要性日益突出.EDA技术就是依赖功能强大的计算机,在EDA工具软件平台上,对以硬件描述语言VHDL为系统逻辑描述手段完成的设计文件,自动地完成逻辑优化和仿真测试,直至实现既定的电子线路系统功能.本文介绍了基于VHDL硬件描述语言设计的多功能数字时钟的思路和技巧.在QuartusⅡ开发环境中编译和仿真了所设计的程序,并逐一调试验证程序的运行状况.仿真和验证的结果表明,该设计方法切实可行,该数字时钟
所属分类:
嵌入式
发布日期:2009-05-30
文件大小:293888
提供者:
armxing
基于EDA技术的多功能数字时钟的ASIC设计
采用EDA技术设计了一个在FPGA芯片上实现的数字时钟,它可以显示年、月、日、时、分、秒、星期,并且可以设定闹钟和整点报时.数字时钟的输入设备是一个4×4的编码键盘,输出设备是用于显示的15个七段数码管、若干LED指示灯及蜂鸣器,数字时钟的内部功能模块可以分为三个部分:综合计时电路、显示控制电路、调整控制电路.其中综合计时电路用于完成各种计时功能,显示控制电路用于完成计时结果的显示,调整控制电路用于调整计时系统的有关参数.
所属分类:
硬件开发
发布日期:2009-05-30
文件大小:268288
提供者:
armxing
基于VHDL的数字时钟设计
VHDL是一种标准的硬件描述语言,该语言可以描述硬件电路的功能、信号连接关系及定时关系,是当今电子设计自动化(EDA)的核心技术.本文通过简易电子表的设计实例,详细介绍了利用VHDL设计电路的流程和方法.
所属分类:
专业指导
发布日期:2009-05-30
文件大小:205824
提供者:
armxing
基于EDA技术的出租车费计价单片系统
本文介绍了出租车费计价电路的组成及工作原理,简述了在EDA平台上用单片CPLD器件构成该数字系统的设计思想和实现过程;
所属分类:
专业指导
发布日期:2009-06-03
文件大小:137216
提供者:
chffjj
基于VHDL数字钟的设计
EDA技术在电子系统设计领域越来越普及,本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟,它的计时周期为24小时,显示满刻度为23时59分59秒,另外还具有校时功能和闹钟功能。总的程序由几个各具不同功能的单元模块程序拼接而成,其中包括时分秒以及星期计数模块和重置时间模块。
所属分类:
专业指导
发布日期:2009-06-06
文件大小:201728
提供者:
yuanteng
基于EDA的数字钟设计 黄石理工 毕业设计
基于EDA的数字钟设计 黄石理工 毕业设计
所属分类:
专业指导
发布日期:2009-06-06
文件大小:2097152
提供者:
wang_boxiang
基于VHDL数字钟的设计
EDA技术在电子系统设计领域越来越普及,本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟,它的计时周期为24小时,显示满刻度为23时59分59秒,另外还具有校时功能和闹钟功能。总的程序由几个各具不同功能的单元模块程序拼接而成,其中包括时分秒以及星期计数模块和重置时间模块。
所属分类:
专业指导
发布日期:2009-06-06
文件大小:304128
提供者:
yuanteng
EDA大作业 数字钟设计
EDA大作业 数字钟设计EDA大作业 数字钟设计EDA大作业 数字钟设计EDA大作业 数字钟设计
所属分类:
专业指导
发布日期:2009-06-09
文件大小:81920
提供者:
zhaoran0612
6位数字频率计的设计原理及元件参考
EDA课程设计比较详细的指导和原理及元件介绍……
所属分类:
专业指导
发布日期:2009-06-09
文件大小:931840
提供者:
dleprocope
基于FPGA的数字钟设计报告
EDA技术在电子系统设计领域越来越普及,本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟,它的计时周期为24小时,显示满刻度为23时59分59秒,另外还具有校时功能和闹钟功能。总的程序由几个各具不同功能的单元模块程序拼接而成,其中包括分频程序模块、时分秒计数和设置程序模块、比较器程序模块、三输入数据选择器程序模块、译码显示程序模块和拼接程序模块。并且使用QuartusII软件进行电路波形仿真,下载到EDA实验箱进行验证。该设计采用自顶向下、混合输入方式(原理图输入—顶层文件连接和VH
所属分类:
硬件开发
发布日期:2009-06-10
文件大小:540672
提供者:
shiyun123
有VHDL实现数字频率计
采用测频法设计一个4位十进制数字显示的数字频率计,其测频的范围为1-9999HZ,设计的精度为1HZ,并能用4位数码管显示其频率。频率计有闸门电路,计数器和显示电路构成。
所属分类:
专业指导
发布日期:2009-06-13
文件大小:160768
提供者:
newming2008
加法器是数字EDA课程设计
加法器是数字系统中的基本逻辑器件,减法器和硬件乘法器都可由加法器来构成。多位加法器的构成有两种方式:并行进位和串行进位。
所属分类:
专业指导
发布日期:2010-04-11
文件大小:138240
提供者:
fdsaqq110011
北航数字EDA技术基础教学大纲
北京航空航天大学 电子信息工程学院 数字EDA技术基础教学大纲
所属分类:
硬件开发
发布日期:2013-01-26
文件大小:23552
提供者:
firstfly_7
北航 数字EDA基础 全套课件
第一讲 Verilog 概述 第二讲 模块 第三讲 VerlogHDL基本语法 第四讲 VerilogHDL建模 ················· 第九讲 QuartuII使用介绍
所属分类:
专业指导
发布日期:2013-01-26
文件大小:973824
提供者:
firstfly_7
EDA,VerilogHDL
内部包含教学课件,设计XilinxISE软件,讲解EDA的起源以及涵盖VerilogHDL的教学课件
所属分类:
讲义
发布日期:2018-08-15
文件大小:10485760
提供者:
qq_36215315
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