系统总体设计方案　　本系统的总体设计框图如图1所示。 图1 系统框图　　Nios II处理器在SDRAM中开辟帧缓冲(Frame buffer)，可以是单缓冲也可以是双缓冲。以单缓冲为例。处理器将一帧图像数据(640×480×2Bytes，RGB565，16bit)存入帧缓冲，然后将帧缓冲的首地址写入到LCD控制器，并启动LCD控制器。该控制器自动从传来的首地址处开始读取数据，并按照TFT的格式输出。图中各模块由Avalon Bus连接在一起。Avalon Bus是一种简单的总线结构，Ni