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数字时钟课程设计,用到振荡器;分频器;计数器;译码器;显示管等仪器,要的来下。
数字时钟课程设计,用到振荡器;分频器;计数器;译码器;显示管等仪器,要的来下。
所属分类:
专业指导
发布日期:2009-05-05
文件大小:536576
提供者:
ysamj
模60计数器 proteus 仿真
这个计数器是模60的,是用7.4画的,然后通过译码器用数码管显示的。
所属分类:
嵌入式
发布日期:2009-06-16
文件大小:109568
提供者:
glaveyu
题++目%3A++++彩灯循环显示控制电路设计
是一个关于彩灯循环显示控制电路的设计 74LS160计数器、74HC390计数器、74HC139译码管、脉冲发生器、数码管和必要的门电路,可以选用其他的计数器和集成电路,但必须给出原理说明 要求完成的主要任务: 以LED数码管作为控制器的显示元件,它能自动地依次显示出数字0、1、2、3、4、5、6、7、8、9(自然数列),1、3、5、7、9(奇数列),0、2、4、6、8(偶数列)和0、1、2、3、4、5、6、7、0、1(音乐符号数列),然后由依次显示出自然数列、奇数列、偶数列和音乐符号数列..
所属分类:
嵌入式
发布日期:2009-07-07
文件大小:347136
提供者:
woaini131415926
十进制计数器+七段译码器
用VHDL语言实现十进制计数器,并用七段译码器显示
所属分类:
其它
发布日期:2009-09-30
文件大小:515
提供者:
songsiqi2006
基于FPGA数字显示电子钟
关键词:FPGA技术,VHDL语言,计数器,译码器,比较器
所属分类:
硬件开发
发布日期:2009-12-19
文件大小:820224
提供者:
shacuicui
实训七 计数、译码、显示电路 用十进制计数器、译码器、显示器组成一个十进制计数显示电路
实训七 计数、译码、显示电路 熟悉通用型十进制计数器、译码器、显示器的逻辑功能; 2.掌握计数器、译码器、显示器的应用。 二、实训内容 1.用十进制计数器、译码器、显示器组成一个十进制计数显示电路。
所属分类:
专业指导
发布日期:2009-12-20
文件大小:2097152
提供者:
lhl8787
微机原理与接口技术 8253计数器
8253计数器实验 一、实验要求:利用8086外接8253可编程定时器/计数器,可以实现对外部事件进行计数。 二、实验目的:1、学习8086与8253的连接方法。2、学习8086对8253的控制方法。 三、实验电路及连线图:用硬导线将8253片选信号CS53接至138译码200-207,将8279的片选信号CS79接至208-20F,GATE0接至电源+5V,CLK0接至脉冲源上的UP,OUT0接至一个发光管(L0)。 四、实验说明: 本实验中计数器按方式0工作。即十六位二进制计数器。当计数设
所属分类:
专业指导
发布日期:2009-12-30
文件大小:1048576
提供者:
JUNYUN1314
VHDL实验段数码管译码器设计与实现
一.实验目的 1. 掌握7段数码管译码器的设计与实现 2. 掌握模块化的设计方法 二.实验内容 设计一个7段数码管译码器,带数码管的4位可逆计数器 [具体要求] 1. 7段数码管译码器 使用拨码开关SW3, SW2, SW1, SW0作为输入,SW3为高位,SW0为低位。 将输出的结果在HEX1,HEX0显示。当输入为‘0000’~‘1111’显示为00~15, 2. 带数码管的4位可逆计数器 将实验三的结果在数码管上显示。结合上次实验,将4位可逆计数器,数码管显示,分别作为两个子模块,实现在
所属分类:
专业指导
发布日期:2010-03-31
文件大小:1024
提供者:
woshishuiaabbb
用VHDL设计的计数显示电路
设计输出为3位BCD码的计数显示电路。由三个模块构成:十进制计数器(BCD_CNT)、分时总线切换电路(SCAN)和七段显示译码器电路(DEC_LED)。
所属分类:
专业指导
发布日期:2010-06-22
文件大小:126976
提供者:
iddudumegaoyuan
Verilog计数器
此计数器是999,用数码管实现,包括分频模块,从20M分到1HZ,计数模块,动态扫描,显示译码等,完全可以在硬件上实现,只要改一下数,即可完成任意计数器
所属分类:
专业指导
发布日期:2008-01-24
文件大小:317440
提供者:
expren0
光控计数器-加减-方向判断
数字电路课程设计,模块化的设计图。 触发-发光管和接收管-NPN反向 延时-NE555CN 时钟计数-NE555CN 锁存-74LS74 计数74192 译码4511 显示-共阴七段管
所属分类:
硬件开发
发布日期:2011-04-19
文件大小:3145728
提供者:
heshuhon
VHDL 数字显示电路
VHDL 数字显示电路的设计1 用VHDL设计具有清除端、使能端,计数范围为0~999的计数器,输出为8421BCD码; 2.用VHDL设计十进制计数器(BCD_CNT)模块、七段显示译码器电路(BEC_LED)模块和分时总线切换电路(SCAN)模块。 3.用MAX+plusⅡ进行时序仿真
所属分类:
专业指导
发布日期:2011-05-25
文件大小:267264
提供者:
xiyuemiao
0到99 十进制 显示译码计数器
0到99 十进制 显示译码计数器.dsn
所属分类:
教育
发布日期:2011-06-11
文件大小:88064
提供者:
ccr11
verilog HDL设计实例
【例 3.1】4 位全加器 【例 3.2】4 位计数器 【例 3.3】4 位全加器的仿真程序 【例 3.4】4 位计数器的仿真程序 【例 3.5】“与-或-非”门电路 【例 5.1】用 case语句描述的 4 选 1 数据选择器 【例 5.2】同步置数、同步清零的计数器 【例 5.4】用 initial过程语句对测试变量 A、B、C 赋值 【例 5.5】用 begin-end 串行块产生信号波形 【例 5.6】用 fork-join 并行块产生信号波形 【例 5.7】持续赋值方式定义的 2 选
所属分类:
专业指导
发布日期:2011-06-14
文件大小:158720
提供者:
wwe12580
彩灯循环显示控制器
彩灯循环显示控制器 计算机组成原理课程设计 内有实验要求、实验报告、quartus工程文件
所属分类:
专业指导
发布日期:2011-11-18
文件大小:851968
提供者:
ahuanghaoran
彩灯变换控制电路设计
摘 要 II 引 言 1 第1章 题目及要求 2 第2章 总体方案选择 3 第3章 单元电路设计 7 3.1矩形波发生器计 7 3.1.1 74LS290管脚功能 7 3.1.2 555多谐振荡器 10 3.1.3 矩形波发生器参数 12 3.2接通电源清零电路设计 12 3.3状态计数器设计 13 3.4逻辑电路图 15 3.5控制门电路设计 16 3.3.1控制门Ⅰ 17 3.3.2控制门Ⅱ 18 3.6译码显示电路 20 3.6.1 7448七段显示译码器 20 3.6.2 BS201引
所属分类:
硬件开发
发布日期:2011-12-28
文件大小:903168
提供者:
cw2859
计数和译码以及显示电路
用十进制计数器、译码器、显示器组成一个十进制计数显示电路。 熟悉通用型十进制计数器、译码器、显示器的逻辑功能; 掌握计数器、译码器、显示器的应用。
所属分类:
嵌入式
发布日期:2012-05-04
文件大小:2097152
提供者:
huicc789
Xilinx Basy2板子动态显示译码加计数器Verilog HDL程序
Verilog HDL 计数器加数码管动态显示程序。数电作业,自己编写的。
所属分类:
其它
发布日期:2017-01-19
文件大小:3145728
提供者:
qq_30047765
集成电路计数器·译码和显示
集成电路计数器·译码和显示集成电路计数器·译码和显示
所属分类:
专业指导
发布日期:2010-06-27
文件大小:125952
提供者:
mualqiqi
六位十进制计数器的制作
本文介绍用6 片CD4026 及0.8 英寸共阴极LED数码管等组成的计数器,此模块加上时间控制就很容易制作出如频率计、相位计等测试仪器。由于结构简单元件少,很容易制作。 一、主要元件 1. CD4026引脚 如图1 示,其内部可分为计数器和7 段显示译码器两部分。输出以“1”为有效电平点亮数码管相应的段。可以不串连限流电阻直接带数码管,电流不会超过10mA。 图1 CD4026引脚 INH=“0”时,时钟脉冲从CLOCK 端引入,时钟脉冲的上升沿使计数器翻转;IN
所属分类:
其它
发布日期:2020-10-23
文件大小:125952
提供者:
weixin_38697063
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