开始有计划写这本书的时候， Altera 还叫 Altera， 还没有加入 Intel 的大家庭， Xilinx 的 ZYNQ 也才刚刚开始有人探索， Altera 大学计划第一次将亚洲创新大赛由传统的 SOPC 大赛 换成了 SOC 大赛，软核变硬核，性能翻几番。 那个时候，能出一本认认真真讲 FPGA 设计的 书， 会得到非常高的评价。 而我，则由于工作变动， 中间拖沓了半年，当半年后再来准备动 笔时，才恍然领悟到， Altera 即将成为 Intel 的可编程事业部， 基于嵌入式硬核的 S

摘 要： LVDS是一种小振幅差分信号技术，使用这种技术传输速率可以达到数百兆，甚至更高； LVDS具有更低的功耗、更好的噪声性能和更可靠的稳定性。简要地介绍了LVDS的原理及优势，分析了LVDS接口设计要注意的问题，着重研究了LVDS与LVPECL、CML间的接口设计；同时给出了不同耦合方式下的电路设计图。 　　1 引 言 　　对于高速电路，尤其是高速数据总线，常用的器件一般有ECL、BTL和GTL等。这些器件的工艺成熟，应用也较为广泛，但都存在一个共同的弱点，即功耗大。此外， 采用单端信

低压差分信号(LVDS)是一种低压、差分信号传输方案，主要用于高速数据传输。根据 ANSI/TIA/EIA-644 规范中的定义，它是一种最为常见的差分接口。这种标准只对适合于 LVDS 应用的驱动器和接收机电气特性进行了规定。因此，它只是一种电气标准，常被一些更高级的协议标准当作其接口或物理层。 　　在高速模拟数字转换器(ADC)中使用该传输方案可在保持转换器高性能的同时实现高速数据输出。独立 ADC 必须能够驱动以PCB走线形式存在的容性负载、以及接收电路的输入逻辑。此处，ADC 输出级的

当共模信号较难处理或对系统有负面影响的时候，需要进行信号调理。部分系统的设计会将模拟变换器输出的单端信号转为全差分信号，然后将这些信号传送到差分输入ADC。这种设计的优点是，大部分混入差分线路的噪声会同时出现在两条线路上 (假设差分线路都是按差分方式平衡布局)。 　　输入信号转为数字信号之后，便必须传送到DSP或ASIC/FPGA，以便进行处理。全差分输出信号电路通过两条对称的线路输出及吸收电流。低电压差分信号 (LVDS) 便是这种信号。ADC12QS065 芯片就采用了 LVDS 技术，可解