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资源分类
搜索资源列表
用VHDL实现查找表方式的FIR滤波器
用VHDL实现查找表方式的FIR滤波器 查表法更容易更方便的实现FIR
所属分类:
专业指导
发布日期:2009-05-12
文件大小:8192
提供者:
qgl220
怎样用VHDL写TESTBENCH
怎样用VHDL写TESTBENCH 怎样用VHDL写TESTBENCH怎样用VHDL写TESTBENCH怎样用VHDL写TESTBENCH
所属分类:
专业指导
发布日期:2009-05-29
文件大小:13631488
提供者:
meic266
用VHDL语言仿真音乐设计
用VHDL语言仿真音乐设计(包含多个模块)
所属分类:
嵌入式
发布日期:2009-06-19
文件大小:231424
提供者:
Terry360108703
毕业设计 用VHDL语言实现异步通信接口的设计
用VHDL语言实现异步通信接口的设计.doc
所属分类:
专业指导
发布日期:2010-03-29
文件大小:462848
提供者:
a2811675
用VHDL语言设计组合逻辑电路
实验4:用VHDL语言设计组合逻辑电路(熟悉用VHDL语言设计4位全加器的方法。首先创建一个1位全加器实体,然后例化此1位全加器4次,创建一个更高层次的4位加法器。1位全加器的VHDL语言描述见例4-45,4位加法器的VHDL语言程序如例4-46,P161-162。)
所属分类:
专业指导
发布日期:2010-04-03
文件大小:1048576
提供者:
vb123jia
VHDL\第三章 用VHDL语言设计基本逻辑电路.ppt
VHDL\第三章 用VHDL语言设计基本逻辑电路.ppt
所属分类:
专业指导
发布日期:2010-04-23
文件大小:1048576
提供者:
dou19890806_
用 VHDL 设计数字系统实例
用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例用 VHDL 设计数字系统实例
所属分类:
专业指导
发布日期:2010-05-03
文件大小:574464
提供者:
hillox352009
用VHDL编写的计算器
用VHDL编写的计算器用VHDL编写的计算器
所属分类:
专业指导
发布日期:2010-07-30
文件大小:22528
提供者:
ltjliao
用VHDL实现FFT设计(英)
用VHDL实现FFT设计(英) 用VHDL实现FFT设计(英)
所属分类:
硬件开发
发布日期:2011-04-06
文件大小:368640
提供者:
Augusdi
用VHDL语言设计基于FPGA器件的高采样率FIR滤波器
用VHDL语言设计基于FPGA器件的高采样率FIR滤波器
所属分类:
硬件开发
发布日期:2011-04-06
文件大小:2097152
提供者:
Augusdi
用VHDL作RTL级的硬件设计
用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL级的硬件设计,用VHDL作RTL
所属分类:
硬件开发
发布日期:2011-10-12
文件大小:28311552
提供者:
devpearl110
用VHDL语言实现数字频率计系统
用VHDL语言实现数字频率计系统,FPGA,EDA
所属分类:
嵌入式
发布日期:2012-11-22
文件大小:1048576
提供者:
lsw59
用VHDL语言仿真闹钟设计
用VHDL语言仿真闹钟设计很经典对于高手来说当然是简单,但对与初学者来说就有点困难了
所属分类:
嵌入式
发布日期:2008-12-20
文件大小:295936
提供者:
maoweixi
一种用VHDL语言实现的帧同步算法
由于VHDL对设计的描述具有相对独立性,因此设计者可以不懂硬件的结构,只需知道设计的目标。这种设计方法集设计、模拟、综合为一体的设计方法,能有效地缩短电路设计周期,减少可能发生的错误,降低了开发成本,在未来现代数字系统中将会起着越来越重要的作用。用VHDL来进行数字系统设计既方便又简单,还具有良好的可移植性和维护性,代表着现代数字系统设计的走向。
所属分类:
其它
发布日期:2020-08-05
文件大小:67584
提供者:
weixin_38633083
用VHDL设计有限状态机的方法
以离心机定时顺序控制器的设计为例,阐述了用VHDL设计有限状态机的方法,讨论了如何消除状态机输出信号的“毛刺”。
所属分类:
其它
发布日期:2020-08-05
文件大小:88064
提供者:
weixin_38663701
用VHDL设计乐曲发生器
用VHDL设计乐曲发生器,含有原理,奏出简单的音乐
所属分类:
专业指导
发布日期:2011-01-06
文件大小:83968
提供者:
amangu
一种用VHDL设计嵌入式Web Server的方案
近几年嵌入式Internet开始迅猛发展,但绝大多数嵌入式Internet都使用微控制器和相应的软件来实现。本文介绍一种基于硬件来实现嵌入式Web Server的方案。该方案的核心思想是用VHDL语言来设计实现,并且用FPGA进行验证。
所属分类:
其它
发布日期:2020-08-31
文件大小:126976
提供者:
weixin_38642864
嵌入式系统/ARM技术中的一种用VHDL设计嵌入式Web Server的方案
摘要:近几年嵌入式Internet开始迅猛发展,但绝大多数嵌入式Internet都使用微控制器和相应的软件来实现。本文介绍一种基于硬件来实现嵌入式Web Server的方案。该方案的核心思想是用VHDL语言来设计实现,并且用FPGA进行验证。 关键词:VHDL Internet协议 控制信息协议 数据报最近几年随着Internet应用的迅猛发展,Internet的通信协议,特别是TCP/IP协议,已成为嵌入式Internet的主体构架;然而,仅仅使用嵌入TCP/IP协议对许我应用来说远远不
所属分类:
其它
发布日期:2020-12-10
文件大小:83968
提供者:
weixin_38565003
用VHDL设计有限状态机的方法
火龙果软件工程技术中心 摘要:以离心机定时顺序控制器的设计为例,阐述了用VHDL设计有限状态机的方法,讨论了如何消除状态机输出信号的“毛刺”。关键词:VHDL状态机EDA离心机毛刺 现代数字系统的设计一般都采用自顶向下的模块化设计方法。即从整个系统的功能出发,将系统分割成若干功能模块。在自顶向下划分的过程中,最重要垢是将系统或子系统按计算机组成结构那样划分成控制器和若干个受控制的功能模块。受控部分通常是设计者们所熟悉的各种功能的电路,设计较为容易。主要任务是设计控制器,而其控制功能可以用限
所属分类:
其它
发布日期:2021-03-03
文件大小:188416
提供者:
weixin_38543749
用VHDL设计有限状态机的方法
火龙果软件工程技术中心 摘要:以离心机定时顺序控制器的设计为例,阐述了用VHDL设计有限状态机的方法,讨论了如何消除状态机输出信号的“毛刺”。关键词:VHDL状态机EDA离心机毛刺 现代数字系统的设计一般都采用自顶向下的模块化设计方法。即从整个系统的功能出发,将系统分割成若干功能模块。在自顶向下划分的过程中,最重要垢是将系统或子系统按计算机组成结构那样划分成控制器和若干个受控制的功能模块。受控部分通常是设计者们所熟悉的各种功能的电路,设计较为容易。主要任务是设计控制器,而其控制功能可以用限
所属分类:
其它
发布日期:2021-02-04
文件大小:188416
提供者:
weixin_38519619
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