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基于FPGA的数字频率计设计
本文要设计一个8位十进制数字频率计,需要由四种器件来组成,即:测频控制信号发生器(FTCTRL)、有时钟使能的十进制计数器(CNT10)、32位锁存器(REG32B)、除法器模块(division). 因为是8位十进制数字频率计,所以计数器CNT10需用8个,7段显示LED7也需用8个. 频率测量的基本原理是计算每秒钟内待测信号的脉冲个数。 为此,测频控制信号发生器FTCTRL应设置一个控制信号时钟CLKK,一个计数使能信号输出端CNT_EN、一个与CNT_EN输出信号反向的锁存输出信号Loa
所属分类:
硬件开发
发布日期:2009-06-09
文件大小:129024
提供者:
maochu
10.4_4位无小数点频率计.rar
/**************************************************************************** 4位不带小数点的频率计 ****************************************************************************/ #include #include int value=0,n=0; int n,n1,n2,n3,n4; int LEDData [] = { 0xC0,
所属分类:
其它
发布日期:2009-06-15
文件大小:15360
提供者:
xllin
1秒频率计电路图的制作
频率计电路图,用protel99se打开,74393,7408,7474组成的电路。
所属分类:
专业指导
发布日期:2009-06-19
文件大小:26624
提供者:
wanqiyou
74系列频率计 用74系列数字器件设计一个频率计
用74系列数字器件设计一个频率计,该频率计测量频率小于10KHz,测量数据显示3秒以上,被测信号为幅值小于10V的脉冲或幅值小于10V的正弦交流电压。基本电路主要由放大整形电路、时基电路、闸门电路和逻辑控制电路组成。设计过程是运用EWB软件完成电路设计部分。
所属分类:
专业指导
发布日期:2009-07-14
文件大小:228352
提供者:
blueclue888
课程设计数字频率计的设计
一、设计任务与要求 1.用74系列数字器件设计一个频率计,该频率计测量频率小于10KHz,测量数据显示3秒以上,被测信号为幅值小于10V的脉冲或幅值小于10V的正弦交流电压。基本电路主要由放大整形电路、时基电路、闸门电路和逻辑控制电路组成。设计过程是运用EWB软件完成电路设计部分。 2.整形电路:将输入频率为周期的信号(如正弦波、三角波等)进行整形,使之成为矩形脉冲。 时基电路:作用是产生一个标准时间信号 (高电平持续时间为1s)。 闸门电路:闸门开通,被测脉冲信号通过闸门,计数器开始计数,直
所属分类:
专业指导
发布日期:2009-10-22
文件大小:556032
提供者:
qqqq784954642
89S51 00~60秒2位简易秒计时器设计
1)掌握单片机最小系统的设计方法; 2)掌握数码管扫描原理与实现方法; 3)掌握独立按键的使用方法; 4)掌握单片机内部定时/计数器的原理与编程方法; 5)利用2位数码管显示秒计数值00~60,每秒钟计数器加1,数码管同时显示当前结果,可由按键控制计数的启停以及归零。
所属分类:
硬件开发
发布日期:2009-12-19
文件大小:284672
提供者:
xsqdag1986022555
数电课程设计数字频率计
1.概述 数字频率计是通过一个频率稳定度高的频率源作为基准时钟,对比测量其他信号的频率。通常是计算每秒内的脉冲个数,也就是我们所称的闸门时间为1秒。闸门时间不定,但闸门时间影响频率计的准确度,闸门时间越长,得到的频率值就越准确,但闸门时间越长则没测一次频率的间隔就越长。
所属分类:
专业指导
发布日期:2010-01-17
文件大小:223232
提供者:
kevinzzj
脉搏计 VHDL 课程设计
脉搏计 VHDL 设计用十五秒测六十秒的脉搏脉搏计 VHDL 设计用十五秒测六十秒的脉搏
所属分类:
专业指导
发布日期:2010-03-24
文件大小:391168
提供者:
lichunyang1224
单片机 30秒倒计时 报警
交通信号计时器。精确秒倒计时,从“30”计到“00”,蜂鸣器发声报警
所属分类:
硬件开发
发布日期:2010-06-08
文件大小:24576
提供者:
buyaoming
纯vhdl语言 频率计
纯vhdl语言 频率计 可测试可变输入信号频率,没两秒测一次(好像是,记不太清啦)led显示
所属分类:
专业指导
发布日期:2011-02-16
文件大小:1048576
提供者:
zhangqbqq
用单片计数实现对输入脉冲计数的数字频率计
通过一秒的定时,对输入的信号的脉冲实现计数,然后通过LCD显示出来
所属分类:
C++
发布日期:2011-08-15
文件大小:82944
提供者:
wcl719236538
数字频率计的设计VHDL
设计性实验 实验一、数字频率计的设计 二、实验内容 本次实验要求设计一个数字频率计,频率测量范围为1Hz~50MHz,采用100MHz的基准时钟。刷新时间不大于2秒(最长2秒刷新一次频率显示)。功能示意框图如图3-1: 图3-1 数字频率计功能示意图 三、实验提示 本次实验要求设计一个数字频率计,对输入频率进行测量。根据实验的要求,频率测量的范围为1Hz~50MHz,跨度较大,考虑到若完全输出至少需要8位,位数较多,因此可考虑分档显示,用三到四位显示数值,一位显示档位。 本实验要实现一个数字频
所属分类:
其它
发布日期:2011-12-12
文件大小:5120
提供者:
wcdsd
频率计VERILOG
基于Xilinx FPGA的频率计Verilog代码,频率计显示使用6位数码管,测频范围10Hz至100MHz,有1秒、0.1秒、0.01秒三档,档位选择通过复位按钮复用选择。
所属分类:
硬件开发
发布日期:2012-03-18
文件大小:167936
提供者:
simple_wyj
用pic控制led一秒闪烁
通过tmr0口产生1ms的脉冲作为tmr1的输入脉冲,改变tmr1的计数值就可以很轻松的获得足够长周期的脉冲信号
所属分类:
嵌入式
发布日期:2012-04-29
文件大小:81920
提供者:
longquan363
欣计8000L数据采集器
连接PC电脑导出导入数据数据采集器 扫描速率:100线/秒 扫描模式:激光扫描模式 其他性能:扫描景深:4cm-21cm, 解析度:0.125mm - 1.0mm
所属分类:
其它
发布日期:2012-05-30
文件大小:454656
提供者:
mmsysc
基于EDA的4位十进制频率计原理与设计
根据频率的定义和频率测量的基本原理,测定信号的频率必须有一个脉宽为1秒的对输入信号脉冲计数允许的信号;1秒计数结束后,计数值锁入锁存器的锁存信号和为下一测频计数周期作准备的计数器清0信号。这3个信号可以由一个测频控制信号发生器产生,即图7-1中的TESTCTL,它的设计要求是,TESTCTL的计数使能信号CNT_EN能产生一个1秒脉宽的周期信号,并对频率计的每一计数器CNT10的ENA使能端进行同步控制。当CNT_EN高电平时,允许计数;低电平时停止计数,并保持其所计的脉冲数。在停止计数期间,
所属分类:
硬件开发
发布日期:2012-06-02
文件大小:68608
提供者:
mfs1184396251
加速度计和陀螺仪指南
在这篇文章中我将概括这么几个基本并且重要的话题: - 加速度计(accelerometer)检测什么 - 陀螺仪(gyroscope,也称作 gyro)检测什么 - 如何将传感器ADC读取的数据转换为物理单位(加速度传感器的单位是g,陀螺仪的单位是 度/秒) - 如何结合加速度传感器和陀螺仪的数据以得到设备和地平面之间的倾角的准确信息 在整篇文章中我尽量将数学运算降低到最少。
所属分类:
C
发布日期:2012-09-03
文件大小:528384
提供者:
feixiangtiakongn
52单片机频率计
52单片机频率计,定时器0计时,定时器1计脉冲数,定时器2波特率发生器,晶振为8MHZ,串口传输波特率为600。定时器0为50ms溢出一次,20次后(1秒)通过串口发送所测频率。定时器1没有使用中断,最大计数65535。
所属分类:
硬件开发
发布日期:2012-10-29
文件大小:14336
提供者:
songzhiyu18
VHDL频率计报告
(1)提高测量频率范围,如10Hz~100KHz或更高、更低频率,提高频率的测量绝对值误差,如达到±1Hz。 (2)可以设置量程分档显示,如X1档(显示范围1Hz~9999Hz),X10档(显示范围0.001KHz~9.999KHz),X100档(显示范围0.100KHz~999.9KHz)...可以自定义各档位的范围。量程选择通过程序自动选择量程。 (3)测量响应时间小于等于10秒,将测量出的频率以十进制格式在实验板上的4个数码管上显示。 。 (4)若是方波能够测量方波的占空比,并通过数码管
所属分类:
其它
发布日期:2012-12-23
文件大小:15728640
提供者:
keithno11
196KC 三秒计按键次数数
计时三秒,在此时间内记录按键的次数,7号第二个程序
所属分类:
嵌入式
发布日期:2013-07-24
文件大小:11264
提供者:
forillusion
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