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卷积码的译码算法——维特比译码
该资料描述了卷积码的译码算法,特别是对维特比译码有较详尽的讲解。同时也有相关例题分析和卷积码性能分析。对于初学者来说很有参考价值。
所属分类:
其它
发布日期:2009-04-29
文件大小:1048576
提供者:
sanlygirl
用MATLAB实现的维特比译码
用MATLAB代码实现了卷积编码,BPSK调制,以及维特比译码,其中主要实现维特比译码,附加了Word文档说明。
所属分类:
其它
发布日期:2009-09-22
文件大小:78848
提供者:
liuyinging
卷积码编码译码 维特比译码
基于matlab的卷积码编码程序 可直接运行 并有维特比译码程序 可以实现信道卷积码编译码过程
所属分类:
其它
发布日期:2009-11-24
文件大小:2048
提供者:
matthewgao1986
基于VCP的DSP维特比译码器的设计与实现.pdf
基于VCP的DSP维特比译码器的设计与实现
所属分类:
硬件开发
发布日期:2010-03-03
文件大小:437248
提供者:
stuartliuhao
维特比译码 加比选
维特比译码的硬件实现方案,采用加比选算法
所属分类:
硬件开发
发布日期:2011-04-04
文件大小:637952
提供者:
qhh198833
卷积码及其维特比译码算法的软件实现
卷积码及其维特比译码算法的软件实现,原理和仿真
所属分类:
专业指导
发布日期:2011-12-04
文件大小:169984
提供者:
g1119x
(2,1,2)类型的维特比译码在C语言中的实现
这是我在大学期间做的一个有关编码译码过程在vc环境中的实现,该程序实现了2,1,2的维特比译码过程,希望能够帮助大家理解~
所属分类:
C/C++
发布日期:2011-12-08
文件大小:3072
提供者:
naruto_xcc
卷积码及其维特比译码算法的软件实现
卷积码及其维特比译码算法的软件实现
所属分类:
专业指导
发布日期:2012-04-06
文件大小:169984
提供者:
wriyjs
matlab实现的维特比译码
matlab实现的维特比译码,已用数字通信第二版实例验证通过
所属分类:
硬件开发
发布日期:2012-10-17
文件大小:4096
提供者:
tangminnudt
(2,1,3)维特比译码器
(2,1,3)卷积码的维特比译码器,使用VHDL硬件描述语言,在Altera公司的Quartus II开发环境下实现的。里面是完整的工程,打开就能运行,给输入序列就能实现译码。具有一定的纠错性能。
所属分类:
硬件开发
发布日期:2013-02-20
文件大小:2097152
提供者:
caoyan1990
维特比译码器
维特比译码器,卷积码编码器的译码,Matlab编写,亲测通过
所属分类:
其它
发布日期:2014-05-22
文件大小:2048
提供者:
stoneballking
卷积码 编码 维特比译码
卷积码编码 维特比译码 分组交织 去交织 编码输出至txt
所属分类:
其它
发布日期:2015-06-05
文件大小:252928
提供者:
hit1120510108
维特比译码
完整的维特比译码的教学资料,并结合详细的实例进行解释,看了就能完全掌握维特比译码的知识
所属分类:
3G/移动开发
发布日期:2016-03-21
文件大小:1048576
提供者:
lcstlcst
MATLAB信道编码实例,维特比译码软判决与硬判决分析
利用matlab的communication toolbox实现AWGN信道下采用QPSK调制和卷积码编码,然后接收端采用维特比译码并且采用硬判决的系统最终得到的误码率曲线,并且采用BERtool工具将其与理论值进行比较。
所属分类:
软件测试
发布日期:2017-12-20
文件大小:3072
提供者:
y_cug
一种卷积码维特比译码算法的软件实现
一种卷积码维特比译码算法的软件实现,广泛用于无线通信领域
所属分类:
其它
发布日期:2008-12-17
文件大小:247808
提供者:
kennyliu
维特比译码verilog程序
(2,1,3)卷积码的维特比译码程序,verilog语言编写,模块可以直接使用
所属分类:
硬件开发
发布日期:2018-04-22
文件大小:22528
提供者:
polyhedronx
维特比译码器的设计-经典
本文在综合了国内外近年来在维特比译码算法以及相关实现技术研究进展的基础上,从降低复杂度和功耗的角度,自主独立完成了维特比译码器行为级设计,并下载到Xinlix公司的Virtxell系列xcZvl000器件中,经验证功能正确。
所属分类:
其它
发布日期:2020-08-19
文件大小:192512
提供者:
weixin_38550722
结构优化的维特比译码器的实现方案
针对维特比译码器译码过程中速度制约的问题,设计了一种结构优化的维特比译码器。该结构通过蝶形单元的直通互连,使得在状态转移过程中不需要对路径度量值进行大范围存储,简化了路径度量值的存储与读取逻辑。并且可以根据不同的应用要求灵活配置蝶形处理单元的复用次数。最后,结合FPGA平台,利用Verilog硬件描述语言和Vivado软件对译码器进行设计与实现。综合实现结果表明,该译码器占用1 564个LUT单元,能够在100 MHz系统时钟下进行有效译码。
所属分类:
其它
发布日期:2020-10-16
文件大小:801792
提供者:
weixin_38553466
基础电子中的卷积码编码和维特比译码性能的对比分析
摘要:本文对比了在加性高斯白噪声(AWGN)信道下经BPSK调制后的数据不编码与添加卷积编码后接收到的信道输出的误码性能,并通过对比对卷积码性能进行分析。采用MATLAB自编函数对卷积码以及维特比译码进行仿真,且对其性能进行分析。由于卷积码有性能floor,编码增益随信噪比降低而体现不明显。 1.引言 卷积码的编码器是由一个有k位输入、n位输出,且具有m位移位寄存器构成的有限状态的有记忆系统,通常称它为时序网络。编码器的整体约束长度为v,是所有k个移位寄存器的长度之和。具有这样的编码
所属分类:
其它
发布日期:2020-10-20
文件大小:173056
提供者:
weixin_38654315
吉比特平衡加选延比式维特比译码器设计
针对60 GHz无线个域网,提出了一种平衡加选延比式维特比译码架构,打破了原有维特比译码器的速率瓶颈。基于该推荐架构,实现了一种8路并行基-2(3,1,7)维特比译码器。在TSMC.13 CMOS工艺下,该译码器以0.104 nJ/bit和4.33 mm2的能耗资源花销,实现了高达4 Gb/s的吞吐率。
所属分类:
其它
发布日期:2020-10-17
文件大小:415744
提供者:
weixin_38517728
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