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  1. 多功能数字钟----数字电路实验报告

  2. 1、用中规模集成电路设计一个数字钟的计数,译码,显示电路。 2、设计六十进制的秒计数器和分计数电路。 3、时计数器采用二十四进制,从00开始计数到23后再回到00。 4、设计校时装置,能对时分秒分别校正。 5、设计整点报时电路。
  3. 所属分类:专业指导

    • 发布日期:2009-06-09
    • 文件大小:698368
    • 提供者:goodmanfreesky
  1. 数电课程设计多功能数字钟

  2. ① 设计一个数字钟。要求用六位数码管显示时间,格式为00:00:00。 ②具有60进制和24进制(或12进制)计数功能,秒、分为60进制计数,时为24进制(或12进制)计数。 ③有译码、七段数码显示功能,能显示时、分、秒计时的结果。 ④设计提供连续触发脉冲的脉冲信号发生器, ⑤具有校时单元、闹钟单元和整点报时单元。 ⑥确定设计方案,按功能模块的划分选择元、器件和中小规模集成电路,设计分电路,画出总体电路原理图,阐述基本原理。
  3. 所属分类:专业指导

    • 发布日期:2009-07-23
    • 文件大小:1048576
    • 提供者:shang111213
  1. 数电课程设计多功能数字钟

  2. 数电课程设计多功能数字钟 课程设计专用,24页WORD,格式保证好,下了觉不后悔
  3. 所属分类:专业指导

    • 发布日期:2009-09-14
    • 文件大小:1048576
    • 提供者:lzg0179
  1. 数字逻辑 课程设计 多功能数字钟

  2. 1.1 设计目的 数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确性和直观性,且无机械装置,具有更更长的使用寿命,因此得到了广泛的使用。数字钟从原理上讲是一种典型的数字电路,其中包括了组合逻辑电路和时序电路。 因此,我们此次设计与制做数字钟就是为了了解数字钟的原理,从而学会制作数字钟,而且通过数字钟的制作进一步的了解各种在制作中用到的中小规模集成电路的作用及实用方法,且由于数字钟包括组合逻辑电路和时叙电路,通过它可以进一步学习与掌握各种组合逻辑电路与时序电路的
  3. 所属分类:专业指导

    • 发布日期:2009-12-20
    • 文件大小:816128
    • 提供者:qq784954642
  1. 多功能数字钟课程设计

  2. 多功能数字钟课程设计,定时控制; 仿广播电台正点报时; 报整点时数; 触摸报整点时数 附带仿真
  3. 所属分类:嵌入式

    • 发布日期:2010-01-05
    • 文件大小:701440
    • 提供者:taolei372817455
  1. 数字逻辑 课程设计 VHDL 多功能数字钟(1)

  2. 数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我根据我老师的设计自己改编的,内部结构变化挺大的,功能也比较全。 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒。 (一)计时:正常工作状态下,每日按24h计时制计时并显示,蜂鸣器无声,逢整点报时。 (二)校时:在计时显示状态下,k=1,进入“小时”校准状态,之后按下“k=1”则进入“分”校准状态,继续按下“k=1”则进入“调秒”状态,第三次按下“k键”又恢复到正常计时显示状态。 (1)“小时”
  3. 所属分类:专业指导

    • 发布日期:2010-01-06
    • 文件大小:233472
    • 提供者:ktboy0502
  1. 数字逻辑 课程设计 VHDL 多功能数字钟(2)

  2. 数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我同学根据老师那个改编的,功能很强大!同时免费赠送设计报告以及.scf .vhd文件 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒 (一)计时:正常工作状态下,每日按24h计时制计时并显示,蜂鸣器无声,逢整点报时。 (二)校时:在计时显示状态下,按下“set键”,进入“小时”校准状态,之后按下“k键”则进入“分”校准状态,继续按下“k键”则进入“秒复零”状态,第三次按下“k键”又恢复到正常计时
  3. 所属分类:专业指导

    • 发布日期:2010-01-06
    • 文件大小:154624
    • 提供者:ktboy0502
  1. 数字逻辑 课程设计 VHDL 多功能数字钟

  2. 数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我老师的设计,网上很难找到,但设计的很绝!已有设计报告 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒 (一)计时:正常工作状态下,每日按24h计时制计时并显示,蜂鸣器无声,逢整点报时。 (二)校时:在计时显示状态下,按下“set键”,进入“小时”校准状态,之后按下“k键”则进入“分”校准状态,继续按下“k键”则进入“秒复零”状态,第三次按下“k键”又恢复到正常计时显示状态。 (1)“小时”校准
  3. 所属分类:专业指导

    • 发布日期:2010-01-06
    • 文件大小:98304
    • 提供者:ktboy0502
  1. 多功能数字钟设计,课程设计报告

  2. 大二多功能数字钟课程设计报告,内容详细有借鉴意义
  3. 所属分类:专业指导

    • 发布日期:2010-12-27
    • 文件大小:31744
    • 提供者:no1wudi2010
  1. 课程设计多功能数字钟

  2. 这是一个具功能于一身的多功能数字钟,和市场上的数字钟相差无几!希望对你有所帮助!!
  3. 所属分类:C

    • 发布日期:2011-04-24
    • 文件大小:53248
    • 提供者:lwb19900710
  1. 多功能数字钟的电路设计

  2. 数字电子技术基础 课程设计 多功能数字钟的电路设计
  3. 所属分类:专业指导

    • 发布日期:2011-05-20
    • 文件大小:1048576
    • 提供者:lwdwyw
  1. 多功能数字钟

  2. 多功能数字钟 数字逻辑课程设计报告 数字电子技术基础简明教程,电工电子技术实验
  3. 所属分类:专业指导

    • 发布日期:2011-09-18
    • 文件大小:320512
    • 提供者:huangqiuxin
  1. 数电课程设计多功能数字钟的电路设计

  2. 数电课程设计 多功能数字钟的电路设计 BY郑美如3206009209
  3. 所属分类:嵌入式

    • 发布日期:2012-04-17
    • 文件大小:480256
    • 提供者:samluyu
  1. 数电课程设计多功能数字钟

  2. 数电课程设计多功能电子钟!
  3. 所属分类:专业指导

    • 发布日期:2013-01-02
    • 文件大小:53248
    • 提供者:napolean7
  1. 用Verilog语言编写的多功能数字钟

  2. 用Verilog语言编写的多功能数字钟 《数字电子技术课程设计》报告
  3. 所属分类:专业指导

    • 发布日期:2013-06-19
    • 文件大小:147456
    • 提供者:u011132877
  1. 多功能数字钟的设计与制作

  2. 数字电子技术课程设计 具有校时功能的多功能数字钟 两种设计方案对比分析选择出更好的方案 并采用Proteus仿真
  3. 所属分类:其它

    • 发布日期:2013-07-05
    • 文件大小:1048576
    • 提供者:u011309243
  1. 数电课程设计(多功能数字钟)

  2. 这是关于数字电路的课程设计。使用VHDL语言编写,实现了多功能数字钟。
  3. 所属分类:专业指导

    • 发布日期:2013-07-08
    • 文件大小:2097152
    • 提供者:u011340195
  1. 基于FPGA用Verilog HDL语言实现的多功能数字钟

  2. 这是一个基于FPGA,用Verilog HDL语言实现的多功能数字钟,课程设计的项目。
  3. 所属分类:其它

    • 发布日期:2017-12-05
    • 文件大小:1048576
    • 提供者:rushierer
  1. 多功能数字钟课程设计

  2. 多功能数字钟课程设计 主体电路是由功能部件或单元电路组成的。在设计这些电路或选择部件时,尽量选用同类型的器件,如所有功能部件都采用TTL集成电路或都采用CMOS集成电路。整个系统所用的器件种类应尽可能少。
  3. 所属分类:专业指导

    • 发布日期:2009-01-08
    • 文件大小:302080
    • 提供者:yoyo657038407
  1. 基于EWB的多功能数字钟设计与实现

  2. 用方波信号发生器发出1HZ的稳定的方波信号作为CP信号输入 ,秒计数器满60向分计数器进位,分计数器满60向小时进位,小时计数器按“23翻0”规律计数,计数器经译码器送到显示器;计数出现误差可用校时电路进行校时、校分、校秒。并具有可整点报时与定时闹钟的功能。
  3. 所属分类:专业指导

    • 发布日期:2009-02-18
    • 文件大小:549888
    • 提供者:xr_long
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