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atmega128中文资料
ATMEL公司的 8位系列单片机的最高配置的一款单片机,应用极其广泛 ATmega128主要特性如下: · 高性能、低功耗的 AVR 8 位微处理器 · 先进的 RISC 结构 – 133 条指令 – 大多数可以在一个时钟周期内完成 – 32 x 8 通用工作寄存器 + 外设控制寄存器 – 全静态工作 – 工作于16 MHz 时性能高达16 MIPS – 只需两个时钟周期的硬件乘法器 · 非易失性的程序和数据存储器 – 128K 字节的系统内可编程Fla
所属分类:
硬件开发
发布日期:2010-03-01
文件大小:7340032
提供者:
lincomail
atmega128中文资料
atmega128中文资料 ATMEL公司的 8位系列单片机的最高配置的一款单片机,应用极其广泛 ATmega128主要特性如下: · 高性能、低功耗的 AVR 8 位微处理器 · 先进的 RISC 结构 – 133 条指令 – 大多数可以在一个时钟周期内完成 – 32 x 8 通用工作寄存器 + 外设控制寄存器 – 全静态工作 – 工作于16 MHz 时性能高达16 MIPS – 只需两个时钟周期的硬件乘法器 · 非易失性的程序和数据存储器 – 128
所属分类:
硬件开发
发布日期:2010-03-18
文件大小:7340032
提供者:
zzh0416
MSP430用户手册
1 MSP430系列 1.1 特性与功能 1.2 系统关键性能 1.3 MSP430系列的各型号 2 结构概述 2.1 CPU 2.2 代码存储器 2.3 数据存储器(RAM) 2.4 运行控制 2.5 外围模块 2.6 振荡器、倍频器和时钟发生器 3 系统复位、中断和运行模式 3.1 系统复位和初始化 3.2 中断系统结构 3.3 中断处理 3.3.1 SFR中的中断控制位 3.3.2 外部中断 3.4 运行模式 3.5 低功耗模式 3.5.1 低功耗模式0与模式1,LPM0和LPM1 3.
所属分类:
C
发布日期:2010-06-04
文件大小:4194304
提供者:
sk009009
EDA—EDA技术实用教程(pdf影印)
学习VHDL和FPGA的经典资料 第 1 章 概述 1.1 EDA 技术及其发展 1.2 EDA 技术实现目标 1.3 硬件描述语言VHDL 1.4 VHDL 综合 1.5 基于VHDL 的自顶向下设计方法 1.3 EDA 技术的优势 1.3 EDA 的发展趋势 【习题】 第 2 章 EDA 设计流程及其工具 2.1 设计流程 2.1.1 设计输入(原理图/HDL 文本编辑) 2.1.2 综合 2.1.3 适配 2.1.4 时序仿真与功能仿真 2.1.5 编程下载 2.1.6 硬件测试 2.2
所属分类:
硬件开发
发布日期:2010-06-07
文件大小:8388608
提供者:
zt839486421
VHDL实用教程,硬件描述语言
第1 章绪 论 ....................................................................................................................1 § 1.1 关于EDA...............................................................................................................1
所属分类:
硬件开发
发布日期:2010-07-14
文件大小:4194304
提供者:
angus36
EDA—EDA技术实用教程
综合 1.5 基于VHDL 的自顶向下设计方法 1.3 EDA 技术的优势 1.3 EDA 的发展趋势 【习题】 第 2 章 EDA 设计流程及其工具 2.1 设计流程 2.1.1 设计输入(原理图/HDL 文本编辑) 2.1.2 综合 2.1.3 适配 2.1.4 时序仿真与功能仿真 2.1.5 编程下载 2.1.6 硬件测试 2.2 ASIC 及其设计流程 2.2.1 ASIC 设计方法 2.2.2 一般ASIC 设计的流程 2.3 常用EDA 工具 2.3.1 设计输入编辑器 2.3.2
所属分类:
硬件开发
发布日期:2010-11-19
文件大小:8388608
提供者:
sundyqt
msp430书稿开发板
第一章 超低功耗单片MSP430B - 11 - 1.1 单片机概述 - 11 - 1.1.1 MSP430系列单片机的特点 - 11 - 1.1.2 MSP430操作简介 - 11 - 1.1.3 MSP430系列单片机在系统中的应用 - 12 - 1.2 片内主要模块介绍 - 12 - 1.2.1时钟模块 - 13 - 1.2.1.1 MSP430F449的三个时钟源可以提供四种时钟信号 - 13 - 1.2.1.2 MSP430F449时钟模块寄存器 - 14 - 1.2.1.3 FLL
所属分类:
电信
发布日期:2011-03-17
文件大小:12582912
提供者:
lantingele
用定时器中断 配置时钟乘法器
用定时器中断 配置时钟乘法器 //这个例子演示了如何初始化并切换到C8051F41x //时钟乘法器。 // - 针脚: // P1.4 - > SW // P2.1 - > LED // P3.0 - > C2D(调试接口) //所有其他未使用的端口引脚
所属分类:
C
发布日期:2011-07-06
文件大小:10240
提供者:
liu20082450
FPGA基本内部结构
FPGA内部比较复杂,根据Datasheet上的分类,主要包括以下几个部分: l 输入/输出模块 Input/Output Blocks (IOB) l 可配置逻辑单元 Configurable Logic Blocks (CLB) l Bram Block SelectRAM l 18 x 18 乘法器 (18-Bit x 18-Bit Multipliers) l 全局时钟网络 (Global Clock Mux) l 数字时钟管理模块 (DCM) l 布线资源 Routing Resou
所属分类:
硬件开发
发布日期:2011-07-19
文件大小:151552
提供者:
liaiqin880524
Spartan 系列 FPGA用户指南中文版
Spartan-3 系列架构由以下五个基本的可编程功能单元组成: • 可配置逻辑模块 (CLB) 包含灵活的查找表 (LUT),这些查找表用来实现用作触发器或 锁存器的逻辑单元和存储单元。CLB 可以执行多种逻辑功能,并且可以存储数据。 • 输入 / 输出模块 (IOB) 控制器件的 I/O 引脚与内部逻辑之间的数据流。IOB 支持双向数 据流和三态操作。支持多种信号标准,包括若干高性能差分标准。包括双倍数据速率 (DDR) 寄存器。 • Block RAM 提供 18Kb 双端口模块形式的数
所属分类:
嵌入式
发布日期:2011-08-26
文件大小:10485760
提供者:
xiaxing1987
MSP430手册
1 MSP430系列 1.1 特性与功能 1.2 系统关键性能 1.3 MSP430系列的各型号 2 结构概述 2.1 CPU 2.2 代码存储器 2.3 数据存储器(RAM) 2.4 运行控制 2.5 外围模块 2.6 振荡器、倍频器和时钟发生器 3 系统复位、中断和运行模式 3.1 系统复位和初始化 3.2 中断系统结构 3.3 中断处理 3.3.1 SFR中的中断控制位 3.3.2 外部中断 3.4 运行模式 3.5 低功耗模式 3.5.1 低功耗模式0与模式1,LPM0和LPM1 3.
所属分类:
电信
发布日期:2012-07-10
文件大小:2097152
提供者:
aladingshendenggao
VHDL 应用教程
学习VHDL的入门书籍 目录 第1 章绪 论 ....................................................................................................................1 § 1.1 关于EDA.................................................................................................
所属分类:
专业指导
发布日期:2013-02-25
文件大小:4194304
提供者:
trondai
(熟读专家系列)《ModelSim电子系统分析及仿真》
《ModelSim电子系统分析及仿真》主要内容简介:ModelSim是优秀的HDL仿真软件之一,它能提供友好的仿真环境,是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/Tk技术和单一内核仿真技术,编译仿真速度快,编译的代码与平台无关,便于保护IP核,个性化的图形界面和用户接口,为用户加快调错提供强有力的手段,是FPGA/ASIC设计的首选仿真软件。《ModelSim电子系统分析及仿真》以ModelSim 6.1f版软件为例,由浅入深、循序渐进地
所属分类:
硬件开发
发布日期:2013-08-15
文件大小:48234496
提供者:
u011708448
msp430x2xx中文版用户指南
官方用户指南中文版,非常详细,很有用,以下是目录 perface...................................................................................................................................... 21 1 简介 ..........................................................................
所属分类:
硬件开发
发布日期:2015-05-22
文件大小:4194304
提供者:
zengxianyu18
FU6811-18-31芯片资料全.pdf
FU68XX芯片数据手册 双核:电机专用引擎 ME 和 8051 内核。ME 硬件自动完成电机 FOC/BLDC 运算控制; 8051内核用于参数配置和日常事务处理 指令周期大多为 1T 或 2T 16Kx8bit Flash ROM、带 CRC 校验功能、支持程序自烧录和代码保护功能 256x8bit IRAM,4Kx8bit XRAM ME:集成低通滤波器(LPF)、比例积分器(PI)、SVPWM/SPWM、FOC 模块 单周期 16*16 位乘法器,
所属分类:
C
发布日期:2019-10-04
文件大小:26214400
提供者:
weixin_45563085
DS_M0518_Series_SC_Rev1.00.pdf
DS_M0518_Series_SC_Rev1.00NuMicroTMM0518规格书 nuvOTon 概述 特性 定时器控制器 概述 特性 发生器和捕捉时钟 概述 特性 基本 发生器和捕获定时器 概述 特性 看门定时狗 概述 特性 窗口看门狗定时器 概述 特性 接口控制器 概述 特性 总线控制器 概述 特征 串行外围设备接口 概述 特性 模拟数字转换 概述 特性 應用電路 电器特性 绝对最大额定值 NuMicroTMM0518规格书 nuvOTon 电气特性 电气特性 外部 高速晶振 外部
所属分类:
其它
发布日期:2019-09-14
文件大小:2097152
提供者:
weixin_38743968
DS_NUC122_Series_SC_V2.01.pdf
DS_NUC122_Series_SC_V2.01nuvT。n NUC122 串行外围设备接口 概述 特征 定时器控制器 概述 特征 接凵控制器 概述 特征 看门狗定时器 概述 特征 设备控制器 概述 特征 电气特性 绝对最大额定值 直流电气特性 交流特性 外部 高速晶体交流特性 外部 高速晶体 外部 低速晶体 内部 高速振荡器 内部 低高速振荡器 模拟特性 和电源管理规格 低压复位规格 欠压检测规格 上电复位规格 规格 电气特性 封装信息 历史版本信息 图 图 框图 图功能框图 图 电源分配图
所属分类:
其它
发布日期:2019-09-14
文件大小:1048576
提供者:
weixin_38743481
PTBO132XXS(1).pdf
带 12 位 ADC 单片机 第 0.01 版 2016 年 12 月 1 日 PTB O132XXS 数据手册L口尸迪浦 目录 1.功能 特性 系统特性 特 封装信息 2.系统概述和方框图 10 3.引脚功能说明 11 4.器件电器特性……………………16 直流交流电气特性 绝对最大值范围 频率与关系由线图 频率与关系曲线图 频率与温度关系曲线图 频率与温度关系曲线图校准到 工作电流 与系统时钟 关系曲线图 工作电流 与系统时钟 关系山线图 工作电流 与系统时钟 关系曲线图 工作电流 与系统
所属分类:
嵌入式
发布日期:2019-09-03
文件大小:1048576
提供者:
qq_35351713
ADI推出搭载时钟乘法器的四通道时钟转换器
导读:ADI近日推出搭载时钟乘法器的多重服务型自适应四通道时钟转换器AD9554,该器件可以为多种系统提供抖动清除和同步功能,包括同步光纤网络(SONET/SDH)。 AD9554与维持多个器件不同的时钟配置相比,其输入端嵌入的交叉点开关带来了更大的灵活性,降低了拥有成本。AD9554功耗仅为940 mW,同时还能在430 kHz至941 MHz的输出范围内产生最多8个输出时钟,与4个2 kHz至1 GHz外部输入参考时钟同步,其环路带宽低至0.1 Hz.4个模数锁相环(ADPLL)可减少
所属分类:
其它
发布日期:2020-10-20
文件大小:120832
提供者:
weixin_38714641
ADI推出搭载时钟乘法器的四通道时钟转换器
导读:ADI近日推出搭载时钟乘法器的多重服务型自适应四通道时钟转换器AD9554,该器件可以为多种系统提供抖动清除和同步功能,包括同步光纤网络(SONET/SDH)。 AD9554与维持多个器件不同的时钟配置相比,其输入端嵌入的交叉点开关带来了更大的灵活性,降低了拥有成本。AD9554功耗仅为940 mW,同时还能在430 kHz至941 MHz的输出范围内产生多8个输出时钟,与4个2 kHz至1 GHz外部输入参考时钟同步,其环路带宽低至0.1 Hz.4个模数锁相环(ADPLL)可减少外
所属分类:
其它
发布日期:2021-01-20
文件大小:121856
提供者:
weixin_38738983
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