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  1. EDA实验报告 异步清除十进制加法计数器的设计

  2. 异步清除是指复位信号有效时,直接将计数器的状态清零。在本设计中,复位信号为clr,低电平有效;时钟信号时clk,上升沿是有效边沿。在clr清除信号无效的的前提下,当clk的上升沿到来时,如果计数器原态是9(“1001”),计数器回到0(“0000”)态,否则计数器的状态将加1。
  3. 所属分类:专业指导

    • 发布日期:2011-05-19
    • 文件大小:104448
    • 提供者:xiancc