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  1. 24进制计数器(基于VHDL语言)

  2. 24进制计数器(基于VHDL语言)用VHDL语言书写

  3. 所属分类：C/C++

    • 发布日期：2010-06-04
    • 文件大小：144384
    • 提供者：swp0314

  1. 60进制和24进制计数器基于VHDL语言编写

  2. 60进制和24进制计数器基于VHDL语言编写 60进制和24进制计数器基于VHDL语言编写

  3. 所属分类：C/C++

    • 发布日期：2010-06-04
    • 文件大小：234496
    • 提供者：swp0314

  1. 基于EDA的数字时钟设计

  2. 本系统由秒计数器、分钟计数器、小时计数器、整点报时、分的调整以及小时的调整并能显示小时、分钟、秒。采用自顶向下的设计方法，子模块利用VHDL语言设计，顶层文件用原理图的设计方法。显示：小时采用24进制，而分钟和秒均60进制。

  3. 所属分类：嵌入式

    • 发布日期：2011-11-01
    • 文件大小：549888
    • 提供者：xlkang1987

  1. 24进制计数器

  2. 这是基于VHDL语言设计的24进制计数器，通过对输入脉冲实现计数。

  3. 所属分类：专业指导

    • 发布日期：2014-09-13
    • 文件大小：1048576
    • 提供者：mting1106