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  1. 单片机应用技术选编（7）

  2. 内容简介 　　 《单片机应用技术选编》(7) 选编了1998年国内50种科技期刊中有关单片机开发应用的文 章共510篇，其中全文编入的有113篇，摘要编入的397篇。全书共分八章，即单片机综合 应用技术；智能仪表与测试技术；网络、通信与数据传输；可靠性与抗干扰技术；控制系统 与功率接口技术；电源技术；实用设计；文章摘要。 　　 本书具有重要实用价值，书中介绍的新技术、新器件以及单片机应用系统的软、硬件资 料有助于减少产品研制过程中的重复性劳动，提高单片机应用技术水平，是从事单片机应用 开发技

  3. 所属分类：硬件开发

    • 发布日期：2010-05-19
    • 文件大小：13631488
    • 提供者：zgraeae

  1. 中国移动公司笔试面试资料

  2. 1.cpu和内存信号时序（使能，时钟，读写，地址，数据），考虑建立时间保持时间，传输延时 2.高速信号的完整性?如何实现端接，解耦怎样处理？ 3.一个芯片输入管脚图，分析计算和一个TTL电平连接的电阻阻值范围 4.复位信号的处理方法,写出你在设计中如何防止复位信号中的抖动? 5.有一个同步帧信号周期为5ms,长度为1us,现在有一个5ns的干扰信号,给定一个EPLD时钟32Mhz,设计一个抗干扰模块. 6.DSP与外设的读写问题,现在给定两个SDRAM和一个DPRAM,要求画出时钟树,写出设计

  3. 所属分类：C

    • 发布日期：2010-11-16
    • 文件大小：549888
    • 提供者：l383512287

  1. Altera FIFO开发资料

  2. altera_ug_fifo.pdf audio_dac_fifo.rar FIFO中文应用笔记.pdf FIFO基础知识.doc FPGASoPC软硬件协同设计纵横谈.pdf FPGA的VGA视频输出工程文件// freedev_vga FPGA的VGA视频输出工程文件.rar FreeDev FPGA音频开发环境和平台构建.pdf Nios系统基础上的UItra DMA数据传输模式.doc SD_Card_Audio// Audio_DAC_FIFO_altera的ip核 DE2_SD_C

  3. 所属分类：硬件开发

    • 发布日期：2013-07-26
    • 文件大小：12582912
    • 提供者：originator

  1. ARM嵌入式系统开发典型模块（高清完整版）

  2. 第1部分　硬件典型模块 第1章　基于ARM的最小系统模块　3 1.1　嵌入式系统简介　3 1.1.1　嵌入式系统的概念　3 1.1.2　嵌入式系统的结构　3 1.1.3　嵌入式系统的特点　5 1.1.4　嵌入式系统的发展趋势　6 1.2　最小系统结构及框图　7 1.3　最小系统的电源设计　8 1.4　最小系统的时钟系统设计　14 1.5　最小系统的复位系统设计　17 1.6　最小系统的存储器系统设计　20 1.7　最小系统的软件设计　24 1.7.1　ARM嵌入式操作系统简介及选择　24 1.

  3. 所属分类：硬件开发

    • 发布日期：2014-10-25
    • 文件大小：8388608
    • 提供者：jsntghf

  1. 异步FIFO在FPGA与DSP通信中的运用

  2. 利用异步FIFO实现FPGA与DSP进行数据通信的方案。FPGA在写时钟的控制下将数据写入FIFO，再与DSP进行握手后，DSP通过EMIFA接口将数据读入。文中给出了异步FIFO的实现代码和FPGA与DSP的硬件连接电路。经验证，利用异步FIFO的方法，在FPGA与DSP通信中的应用，具有传输速度快、稳定可靠、实现方便的优点。

  3. 所属分类：其它

    • 发布日期：2020-08-07
    • 文件大小：306176
    • 提供者：weixin_38666785

  1. 异步FIFO在FPGA与DSP通信中的运用

  2. 利用异步FIFO实现FPGA与DSP进行数据通信的方案。FPGA在写时钟的控制下将数据写入FIFO，再与DSP进行握手后，DSP通过EMIFA接口将数据读入。文中给出了异步FIFO的实现代码和FPGA与DSP的硬件连接电路。经验证，利用异步FIFO的方法，在FPGA与DSP通信中的应用，具有传输速度快、稳定可靠、实现方便的优点。

  3. 所属分类：其它

    • 发布日期：2020-10-23
    • 文件大小：232448
    • 提供者：weixin_38596117

  1. DSP与FPGA异步数据传输方法

  2. 国内GPS卫星信号模拟源大多基于“DSP+FPGA”架构进行开发研制，DSP与FPGA是两个独立的时钟域系统，存在异步数据交互的问题。基于解决DSP计算所得导航电文以及载波控制字、伪码控制字向FPGA传输时发生数据丢失问题得目的，提出采用异步FIFO来缓存大量导航电文数据还有同步器来同步所传输的载波控制字和伪码控制字的方法。通过采用Altera公司的FIFO内核来进行外围接口信号和控制逻辑设计以及两级触发器级联来实现同步器的试验设计方法，得到所设计的缓存导航电文的异步FIFO输出的数据结果正确以

  3. 所属分类：其它

    • 发布日期：2021-01-28
    • 文件大小：1048576
    • 提供者：weixin_38582793