一、硬件电路设计 　　本文选用CPLD 是ALTERA 公司的EPM240T100，结合MAX232 接口芯片进行串口通信设计，框图如下图1 所示。 图1 CPLD串口通信模块硬件设计 　　二、VHDL程序模块设计及描述 　　使用VHDL 对CPLD 进行编程，设计3 个模块，波特率发生模块，接收器，发送器。 　　1. 波特率发生模块 　　波特率发生器实际是一个分频器，如前所述，本文设计的波特率为19.2kb/ 秒，设计使用的时钟频率为10MHz，所以计数器进行计数时计数到260

摘要：介绍了基于CPLD芯片EPM7128设计的数据合并转换器。其中，控制串行口数据合并时间的计数器电路和并行数据转换成串行数据的移位电路都是在CPLD中完成的，数据块合并由相应的软件实现，最终形成CPM流输出。 关键词：CPLD 数据合并转换器 串行口 PCM流数据交换机的传送速率很高，当其和串行口通信时，在发送前把数据分为两部分分别发送到串行口，然后经过数据合并转换器把各个串行口的数据合并在一起并转换成PCM流。本文介绍了基于CPLD芯片EPM7128设计的数据合并转换器。1 数据合并

摘要：介绍了基于CPLD芯片EPM7128设计的数据合并转换器。其中，控制串行口数据合并时间的计数器电路和并行数据转换成串行的移位电路都是在CPLD中完成的，数据块合并由相应的软件实现，最终形成PCM流输出。关键词：CPLD　数据合并转换器　串行口　PCM流   数据交换机的传送速率很高，当其和串行口通信时，在发送前把数据分为两部分分别发送到串行口，然后经过数据合并转换器把各个串行口的数据合并在一起并转换成PCM流。本文介绍了基于CPLD芯片EPM7128设计的数据合并转换器。