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  1. EDA/PLD中的低频数字相位（频率）测量的CPLD实现

  2. 在电子测量技术中，测频测相是最基本的测量之一。相位测量仪是电子领域的常用仪器，当前测频测相主要是运用等精度测频、PLL锁相环测相的方法。研究发现，等精度测频法具有在整个测频范围内保持恒定的高精度的特点，但是该原理不能用于测量相位。PLL锁相环测相可以实现等精度测相，但电路调试较复杂。因此，选择直接测相法作为低频测相仪的测试方法。 　　设计的低频测相仪，满足以下的技术指标：a .频率20-20KHz；b .输入阻抗≥100KΩ；c.相位测量绝对误差≤1度； d.具有频率测量和数字显示功能；e.显

  3. 所属分类：其它

    • 发布日期：2020-11-08
    • 文件大小：122880
    • 提供者：weixin_38746293

  1. EDA/PLD中的基于VHDL的99小时定时器设计及实现

  2. 0 引言 　　传统的定时器硬件连接比较复杂，可靠性差，而且计时时间短，难以满足需要。本设计采用可编程芯片和VHDL语言进行软硬件设计，不但可使硬件大为简化，而且稳定性也有明显提高。由于可编程芯片的频率精度可达到50 MHz，因而计时精度很高。本设计采用逐位设定预置时间，其最长时间设定可长达99小时59分59秒。完全可以满足用户的需要，使用也更为方便。 　　1 系统原理 　　本定时器的核心器件为EP1C6Q240C8芯片。该芯片有选位、置位、启动、复位、倒计时等功能，显示采用2个3位LED数

  3. 所属分类：其它

    • 发布日期：2020-11-07
    • 文件大小：249856
    • 提供者：weixin_38691742

  1. EDA/PLD中的EDA的参数可设置兆功能块实现法

  2. 参数可设置兆功能块实现法就是设计者可以根据实际电路的设计需要，选择LPM（Library of Parameterized Modue1s，参数可设置模块库，简称LPM）库中的适当模块，并为其设定适当的参数以满足自己设计需要的一种实现方法。作为EDIF标准的一部分，LPM形式得到了EDA工具的良好支持，LPM中功能模块的内容很丰富。 　　在EDA的设计中，以图形或硬件描述语言模块形式调用兆功能块进行设计，使得基于EDA技术的电子设计能够有效地利用其他优秀电子工程技术人员的硬件设计成果，更使得设

  3. 所属分类：其它

    • 发布日期：2020-11-16
    • 文件大小：30720
    • 提供者：weixin_38598613

  1. EDA/PLD中的EDA的原理图设计实现法

  2. 原理图设计实现法就是用原理图表达自己的设计思想，并使用EDA工具提供的图形编辑器以原理图的方式进行设计输入的一种实现方法。原理图输入法的实现方式简单、直观、方便，并且可利用许多现成的单元器件或自行设计的元器件。　　  来源:ks99

  3. 所属分类：其它

    • 发布日期：2020-11-16
    • 文件大小：19456
    • 提供者：weixin_38661100

  1. EDA/PLD中的基于CPLD的异步串行收发器设计

  2. 摘要：介绍了基于ＣＰＬＤ的异步串行收发器的设计方案，着重叙述了用混合输入（包括原理图和ＶＨＤＬ）实现该设计的思想，阐述了在系统可编程（ＩＳＰ）开发软件的应用方法与设计流程，并给出了ＶＨＤＬ源文件和仿真波形。 关键词：异步串行收发器；混合输入；在系统可编程；CPLD；ispLSI1016传统数字系统的设计主要基于标准逻辑器件并采用“Ｂｏｔｔｏｍ－Ｕｐ”（自底向上）的方法构成系统。这种“试凑法”设计无固定套路可寻，主要凭借设计者的经验。所设计的数字系统虽然不乏构思巧妙者，但往往要用很多标准器件

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：92160
    • 提供者：weixin_38652870