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EDA课程设计报告--八位频率计
在电子技术中,频率是最基本的参数之一,并且与许多电参量的测量方案、测量结果都有十分密切的关系,因此,频率的测量就显得更为重要。测量频率的方法有多种,其中电子计数器测量频率具有精度高、使用方便、测量迅速,以及便于实现测量过程自动化等优点,是频率测量的重要手段之一。数字式频率计的测量原理有两类:一是直接测频法,即在一定闸门时间内测量被测信号的脉冲个数;二是间接测频法即测周期法,如周期测频法。直接测频法适用于高频信号的频率测量,通常采用计数器、数据锁存器及控制电路实现,并通过改变计数器阀门的时间长短
所属分类:
硬件开发
发布日期:2009-12-09
文件大小:278528
提供者:
yueh5
EDA课程设计 数字时钟的设计(VHDL)
数字时钟的设计(EDA课程设计) 内含:实验目的 掌握VHDL语言的基本运用 掌握MAX+plusII的简单操作并会使用EDA实验箱 功能设计、系统设计、功能分析、创新点、VHDL代码
所属分类:
专业指导
发布日期:2010-01-10
文件大小:129024
提供者:
shaxiaozisha
基于FPGA的数字时钟设计
EDA技术在电子系统设计领域越来越普及,本设计主要利用VHDL和C语言在FPGA实验板上设计一个电子数字钟,它的计时周期为24小时,显示满刻度为23时59分59秒、。总的程序由几个各具不同功能的单元模块程序拼接而成,其中包括分频程序模块、时分秒计数模块、处理器及外设模块,并且使用QuartusII运用VHDL语言对分频和计数两个模块进行硬件电路设计和电路波形仿真,运用sopc技术嵌入内核并创建了系统所需的外部设备FLASH和SRAM软件通过使用NiosII运用C语言进行编程然后下载到硬件电路中
所属分类:
C
发布日期:2010-06-16
文件大小:1048576
提供者:
mavellous1986
简易数字时钟的设计vhdl
①设计一个具有时、分、秒计时,6位时钟显示电路; ②该计时电路为24小时计时制。 实验报告的形式
所属分类:
数据库
发布日期:2011-05-26
文件大小:249856
提供者:
qianjunbb
EDA 数字时钟实验设计报告
用VHDL语言设计数字时钟电路, 1、正常的显示时、分、秒计时功能。 2、可引入秒脉冲进行校时、校分,并可用RESET信号给秒清零。 3、实现整点报时,当计时器道59分50秒开始鸣响,四声低声,一声高声。
所属分类:
专业指导
发布日期:2011-07-04
文件大小:48128
提供者:
liviolina
EDA实验报告—数字时钟设计
一份完整的EDA实验报告——数字时钟设计,含源代码(VHDL语言)。中南大学的同学下载后可以直接使用。
所属分类:
硬件开发
发布日期:2011-07-04
文件大小:227328
提供者:
happyhjun
EDA/SOPC 技术实验讲义
第一章 EDA_VHDL 实验/设计与电子设计竞赛 4 1-1、 应用QuartusII 完成基本组合电路设计 5 1-2. 应用QuartusII 完成基本时序电路的设计 6 1-3. 设计含异步清0 和同步时钟使能的加法计数器 7 1-4. 7 段数码显示译码器设计 8 1-5. 8 位数码扫描显示电路设计 9 1-6. 数控分频器的设计 10 1-7. 32 位并进/并出移位寄存器设计 10 1-8. 在QuartusII 中用原理图输入法设计8 位全加器 11 1-9. 在Quartu
所属分类:
硬件开发
发布日期:2012-04-18
文件大小:3145728
提供者:
xiaosong89
EDA技术实验报告(多个实验)
EDA技术课程期末实验汇总。内有全加器的设计、含异步清0和同步时钟使能的十进制计数器、秒表的设计,以及序列检测器、数字频率计的设计。并有详细的VHDL语言代码,结构原理图,波形仿真图。
所属分类:
嵌入式
发布日期:2012-10-24
文件大小:651264
提供者:
ning_dashuai
数字时钟设计VHDL
设计一个可以计时的数字时钟,其显示时间范围是00:00:00~23:59:59,且该时钟具有暂停计时、清零等功能。
所属分类:
嵌入式
发布日期:2012-11-22
文件大小:57344
提供者:
lsw59