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  1. Verilog_HDL教程

  2. 第1章 EDA技术综述 1 本章内容简介 1 1.1 引言 1 1.2 EDA技术及其发展 2 1.3 设计方法与设计技术 3 1.3.1 Top-down设计 3 1.3.2 Bottom-up设计 5 1.3.3 IP复用技术与SOC 5 1.4 EDA设计的实现 6 1.5 硬件描述语言 7 思考与练习 9 第2章 EDA设计软件与设计流程 10 本章内容简介 10 2.1 EDA软件工具概述 10 2.1.1 集成的CPLD/FPGA开发工具 10 2.1.2 输入工具（Design

  3. 所属分类：嵌入式

    • 发布日期：2009-12-21
    • 文件大小：4194304
    • 提供者：yanlihui13579

  1. 单片机应用技术选编（7）

  2. 内容简介 　　 《单片机应用技术选编》(7) 选编了1998年国内50种科技期刊中有关单片机开发应用的文 章共510篇，其中全文编入的有113篇，摘要编入的397篇。全书共分八章，即单片机综合 应用技术；智能仪表与测试技术；网络、通信与数据传输；可靠性与抗干扰技术；控制系统 与功率接口技术；电源技术；实用设计；文章摘要。 　　 本书具有重要实用价值，书中介绍的新技术、新器件以及单片机应用系统的软、硬件资 料有助于减少产品研制过程中的重复性劳动，提高单片机应用技术水平，是从事单片机应用 开发技

  3. 所属分类：硬件开发

    • 发布日期：2010-05-19
    • 文件大小：13631488
    • 提供者：zgraeae

  1. 基于FPGA和DSP的数字滤波器设计

  2. 硕士学位论文，包含IIR滤波器，FIR滤波器内容以及分布式（DA）算法及其硬件实现。

  3. 所属分类：硬件开发

    • 发布日期：2010-05-30
    • 文件大小：2097152
    • 提供者：jx7758158

  1. FPGA数字信号处理实现原理及方法

  2. 本书全面而又系统地介绍了基于fpga实现数字信号处理的原理及方法。全书包括12章和11个实验，主要内容包括数字信号处理设计导论、fpga的硬件结构及运算功能、信号及其处理理论概述、cordic算法原理及实现、fir滤波器和iir滤波器的设计、其他常用数字滤波器的设计、重定时信号流图、数字通信信号处理原理及实现、自适应信号处理理论基础、基于fpga的自适应信号处理实现、信号同步原理及实现、基于acceldsp的数字信号处理的实现和实验部分。本书参考了大量最新的设计资料，内容新颖、理论和应用并重，

  3. 所属分类：硬件开发

    • 发布日期：2011-02-25
    • 文件大小：3145728
    • 提供者：wuweigreat

  1. FIR数字滤波器的FPGA实现

  2. 为了研究不同结构的 FIR 数字滤波器 FPGA 实现对数字多普勒接收机中 FPGA 器件资源消耗及其实现的滤波 器的速度性能 在 Xilinx ISE10.1 开发平台中 采用 Verilog HDL 语言分别实现了 FIR 数字滤波器的改进的串行结构 并行结构以及 DA 结构,并在 ModelSim 仿真验证平台中仿真了实现设计 结果表明 改进串行结构的实现消耗资源少 但滤波速度慢 并行结构的实现滤波速度快但消耗资源多 而 DA 算法的实现速度仅取决于输入数据的宽度 所以滤 波速度通常较快

  3. 所属分类：电信

    • 发布日期：2011-05-26
    • 文件大小：447488
    • 提供者：hudiemama

  1. Verilog_HDL经典教程实用手册

  2. 第1章 EDA技术综述 1 本章内容简介 1 1.1 引言 1 1.2 EDA技术及其发展 2 1.3 设计方法与设计技术 3 1.3.1 Top-down设计 3 1.3.2 Bottom-up设计 5 1.3.3 IP复用技术与SOC 5 1.4 EDA设计的实现 6 1.5 硬件描述语言 7 思考与练习 9 第2章 EDA设计软件与设计流程 10 本章内容简介 10 2.1 EDA软件工具概述 10 2.1.1 集成的CPLD/FPGA开发工具 10 2.1.2 输入工具（Design

  3. 所属分类：嵌入式

    • 发布日期：2011-06-02
    • 文件大小：4194304
    • 提供者：heirfr

  1. Verilog_HDL教程.pdf

  2. 第1章 EDA技术综述 1 本章内容简介 1 1.1 引言 1 1.2 EDA技术及其发展 2 1.3 设计方法与设计技术 3 1.3.1 Top-down设计 3 1.3.2 Bottom-up设计 5 1.3.3 IP复用技术与SOC 5 1.4 EDA设计的实现 6 1.5 硬件描述语言 7 思考与练习 9 第2章 EDA设计软件与设计流程 10 本章内容简介 10 2.1 EDA软件工具概述 10 2.1.1 集成的CPLD/FPGA开发工具 10 2.1.2 输入工具（Design

  3. 所属分类：嵌入式

    • 发布日期：2012-03-12
    • 文件大小：4194304
    • 提供者：lzj1987

  1. EDA/SOPC 技术实验讲义

  2. 第一章 EDA_VHDL 实验/设计与电子设计竞赛 4 1-1、 应用QuartusII 完成基本组合电路设计 5 1-2. 应用QuartusII 完成基本时序电路的设计 6 1-3. 设计含异步清0 和同步时钟使能的加法计数器 7 1-4. 7 段数码显示译码器设计 8 1-5. 8 位数码扫描显示电路设计 9 1-6. 数控分频器的设计 10 1-7. 32 位并进/并出移位寄存器设计 10 1-8. 在QuartusII 中用原理图输入法设计8 位全加器 11 1-9. 在Quartu

  3. 所属分类：硬件开发

    • 发布日期：2012-04-18
    • 文件大小：3145728
    • 提供者：xiaosong89

  1. Altera DSP Builder开发资料

  2. Builder设计初步.pdf Builder设计深入.pdf DSP Builder7.2 Release Notes and Errata (PDF).pdf DSP Builder7.2 参考手册 (PDF).pdf DSP Builder7.2 用户指南(PDF).pdf DSP Builder经验.doc DSP Builder设计论文// Matlab_simulink在FPGA设计中的应用.kdh 从Simulink模型自动生成VHDL代码_省略_基于DSPBuilder的FP.

  3. 所属分类：硬件开发

    • 发布日期：2013-07-26
    • 文件大小：35651584
    • 提供者：originator

  1. VLSI数字信号处理-设计与实现

  2. 目 录 第一章绪论 1.1 引言 1.2本书各章内容简介 第二章计算机算术运算及其实现 2.1 引言 2.2算术运算的数的系统 2.2.1普通基数的数的系统 2.2.2带符号数字的数的系统 2.2.3定点数的表示法 2.2.4剩余数系统 2.3二进制加法器 2.3.1基本的加法／减法器 2.3.2多级进位存储加法器树 2.3.3流水线加法器 2.4二进制乘法器 2.4.1 Baugh-Wooley补码阵列乘法器的数学原理 2.4.2 8×8位Baugh-Wooley补码阵列乘法器的VHDL实

  3. 所属分类：其它

    • 发布日期：2009-02-20
    • 文件大小：3145728
    • 提供者：luofei23

  1. 分布式运算单元的原理及其实现方法

  2. 随着FPGA集成度的不断提高，在单片FPGA中完成复杂的数字信号处理过程变成了现实。譬如：FIR滤波器、FFT以及雷达信号处理中的数字脉冲压缩、数字鉴相等，都可以在单片FPGA中实现。在基于Xilinx XC4000系列FPGA设计的DSP中，分布式运算单元DA扮演着重要的角色。本文介绍其原理及其实现方法。

  3. 所属分类：其它

    • 发布日期：2020-07-27
    • 文件大小：124928
    • 提供者：weixin_38624519

  1. FIR数字滤波器设计及其FPGA实现

  2. 以FPGA为硬件平台，利用FPGA的DSP开发工具DSP Builder对数字滤波器进行建模设计及系统模型仿真，生成VHDL工程文件，编制相应顶层文件，使其符合滤波器硬件系统。利用QuartusⅡ对项目进行综合、编译和调试，生成原理图模块和RTL电路图。通过对5 kHz方波信号进行仿真滤波，并将VHDL下载到硬件系统中进行硬件实现，有效地提取到5 kHz的正弦信号。

  3. 所属分类：其它

    • 发布日期：2020-08-31
    • 文件大小：208896
    • 提供者：weixin_38703866

  1. FIR数字滤波器设计及其FPGA实现

  2. 以FPGA为硬件平台，利用FPGA的DSP开发工具DSP Builder对数字滤波器进行建模设计及系统模型仿真，生成VHDL工程文件，编制相应顶层文件，使其符合滤波器硬件系统。利用QuartusⅡ对项目进行综合、编译和调试，生成原理图模块和RTL电路图。通过对5 kHz方波信号进行仿真滤波，并将VHDL下载到硬件系统中进行硬件实现，有效地提取到5 kHz的正弦信号。实验结果表明，该设计很好地达到了FIR滤波器的性能，为数字滤波器的设计与实现提供了新的途径和方法。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：209920
    • 提供者：weixin_38665944

  1. 基于优化DA算法滤波器的设计及其FPGA实现

  2. 由于传统MAC方法在设计数字滤波器时频繁使用乘法器，导致整个系统运行速率下降，而一般DA算法在设计高阶滤波器时存在查找表规模过大以至于难以实现的问题。提出一种优化的DA算法来克服这一缺陷，为此设计了一个18阶的线性相位结构的FIR低通滤波器，并用Verilog HDL语言在FPGA上实现，在第三方仿真平台Modelsim工具上仿真。仿真结果与MATLAB计算的理论值进行对比，验证了此优化算法的正确性。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：335872
    • 提供者：weixin_38562079

  1. 分布式运算单元的原理及其实现方法

  2. 摘要：以Xilinx公司的XC4000系列FPGA（现场可编程门阵列）为例，介绍了分布式运算单元DA（DistributedArithmetic）在高速DAP设计中的原理及实现方法。    随着FPGA集成度的不断提高，在单片FPGA中完成复杂的数字信号处理过程变成了现实。譬如：FIR滤波器、FFT以及雷达信号处理中的数字脉冲压缩、数字鉴相等，都可以在单片FPGA中实现。在基于XilinxXc4000系列FPGA设计的DAP中，分布式运算单元DA扮演着重要的角色。本文介绍其原理及其实现方法。  

  3. 所属分类：其它

    • 发布日期：2021-02-03
    • 文件大小：192512
    • 提供者：weixin_38500948

  1. FIR数字滤波器的FPGA实现研究

  2. 为了研究不同结构的FIR数字滤波器FPGA实现对数字多普勒接收机中FPGA器件资源消耗及其实现的滤波器的速度性能，在Xilinx ISE10.1开发平台中，采用Verilog HDL语言分别实现了FIR数字滤波器的改进的串行结构、并行结构以及DA结构,并在ModelSim仿真验证平台中仿真了实现设计。结果表明，改进串行结构的实现消耗资源少但滤波速度慢，并行结构的实现滤波速度快但消耗资源多，而DA算法的实现速度仅取决于输入数据的宽度，所以滤波速度通常较快且消耗的资源较少。

  3. 所属分类：其它

    • 发布日期：2021-01-30
    • 文件大小：811008
    • 提供者：weixin_38635979