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搜索资源列表

  1. 基于cpld—vhdl的电子钟

  2. 这是一款基于cpld的vhdl电子钟，可使用于多种型号的cpld、FPGA开发板，也可任意修改实现其他功能。

  3. 所属分类：硬件开发

    • 发布日期：2009-09-03
    • 文件大小：345088
    • 提供者：yangjia880313

  1. 《EDA》技术I实验指导书

  2. 很好的《EDA》技术I实验指导书！ 《EDA技术I》实验教学大纲 1 第一部分：《电子设计自动化设计》实验说明 3 一、设计题目选择的要求 3 二、提交设计报告的要求 3 三、设计题目 3 四、实验考核方式说明 4 第二部分：基于GEXIN EDAPRO/240H实验仪实验 5 题目一 MAX+PLUSII基本操作 5 题目二 QUARTUSⅡ基本操作 5 题目三 FPGA compiler基本操作 6 题目四 4bit二进制加法器设计 6 题目五 4bit频率计设计 7 题目六 计数器设计

  3. 所属分类：交通

    • 发布日期：2009-12-03
    • 文件大小：2097152
    • 提供者：huangluxing163

  1. FPGA/VHDL快速工程实践入门与提高

  2. FPGA/VHDL技术是近年来计算机与电子技术领域的又一场革命。本书以Altera公司的FPGA/CPLD为主详细介绍了FPGA的相关知识、MAX+PLUS Ⅱ开发环境和VHDL语言基础,并以交通灯逻辑控制、电子钟与LED显示、LCD液晶显示及计算机ISA接口和PCI接口的设计等为例，由浅入深地详述了如何应用FPGA/VHDL进行电子设计。书中的大多数电路图和源程序已经过实例验证，读者可以直接应用于自己的设计。本书的特点是强调实用性和先进性，力求通俗易懂。 本书适合于计算机、电子、控制及信息等

  3. 所属分类：硬件开发

    • 发布日期：2010-03-10
    • 文件大小：3145728
    • 提供者：dljaye

  1. 基于单片机的FPGA电路结构可重配置应用

  2. 原创设计，原理图，技术资料，详细说明，FPGA代码及单片机ASM代码，资料齐全。 本系统通过对两个FPGA的实例：电子钟、抢答器（有VHDL 原代码），利用单片机控制进行重配置。

  3. 所属分类：硬件开发

    • 发布日期：2011-02-11
    • 文件大小：1048576
    • 提供者：yc118108824

  1. FPGA时钟、正弦波和方波实验报告

  2. FPGA时钟、正弦波和方波实验报告。主要是基于FPGA的电子钟的设计和基于DDS原理的正弦波和方波的FPGA设计。

  3. 所属分类：硬件开发

    • 发布日期：2011-03-19
    • 文件大小：939008
    • 提供者：roadbest

  1. FPGA经典27例

  2. 经典的FPGA开发实例，适合初学者，程序包含了URAT、FSK调制、MSK调制解调、电子钟、DAC0832等程序

  3. 所属分类：其它

    • 发布日期：2011-12-16
    • 文件大小：1048576
    • 提供者：superlong22

  1. 基于FPGA的电子钟设计与实现

  2. 设计一个电子钟, 要求具有计时及校时功能, 同时要求: a) 计时采用12 h 方式, 显示小时、分和秒; b) 采用双键校时法: Mode 键和Set 键, 前者选择时钟模式, 包括计时, 秒、分及小时校对, 后者作为校时时钟输入。 图1 电子钟功能模块图 在设计过程中先将系统模块化, 然后逐步实现。根据系统功能,可划分为3 个模块: 计时模块、校时模块及显示模块, 其中计时模块又包括小时、分及秒计时[ 2] 。系统功能模块图如图1。电子钟计时实质讲就是计数器, 其中分、秒计时分别为60 进

  3. 所属分类：嵌入式

    • 发布日期：2012-11-04
    • 文件大小：939008
    • 提供者：waj19912

  1. 基于FPGA的数字时钟的设计

  2. 电子钟是人们日常生活中常用的计时工具，而数字式电子钟又有其体积小、重量轻、走时准确、结构简单、耗电量少等优点而在生活中被广泛应用。

  3. 所属分类：其它

    • 发布日期：2014-05-28
    • 文件大小：228352
    • 提供者：qq_15904409

  1. 基于FPGA的电子钟设计verilog版（全功能，Altera开发板验证通过）

  2. 基于FPGA的电子钟设计verilog版，用Quartus工具开发，采用模块化设计，含按键去抖、Altera开发板实测通过，简单修改引脚和频率即可使用，含详细注释。

  3. 所属分类：硬件开发

    • 发布日期：2016-03-01
    • 文件大小：3072
    • 提供者：yangdong500239

  1. EDA课程设计报告(数字电子时钟)

  2. EDA技术在硬件实现方面融合了大规模集成电路制造技术，IC版图设计技术、ASIC测 试与封装技术、FPGA /CPLD编程下载技术、自动检测技术等；EDA技术为现代电子理论和设计的表达与实现提供了可能性。在现代技术的所有领域中，纵观许多得以飞速发展的科学技术，多为计算机辅助设计，而非自动化设计。显然，最早进入设计自动化的技术领域之一是电子技术，这就是为什么电子技术始终处于所有科学技术发展最前列的原因之一。不难理解，EDA技术已不是某一学科的分支，或某种新的技能技术，应该是一门综合性学科。它融合

  3. 所属分类：讲义

    • 发布日期：2017-12-29
    • 文件大小：321536
    • 提供者：love__remember

  1. FPGA多功能数字电子钟

  2. a）计数显示功能 分、秒：60 进制，二位数码管显示（十进制）； 时：24 进制，二位数码管显示（十进制）。 b）具有清零功能 复位键按下，系统复位，显示皆为0。 c）校时功能 时校准键：小时递增循环； 分校准键：分钟递增循环； 秒校准键：秒递增循环。

  3. 所属分类：嵌入式

    • 发布日期：2019-01-06
    • 文件大小：321536
    • 提供者：qq_35522101

  1. FPGA数字电子钟-project

  2. a）计数显示功能 分、秒：60 进制，二位数码管显示（十进制）； 时：24 进制，二位数码管显示（十进制）。 b）具有清零功能 复位键按下，系统复位，显示皆为0。 c）校时功能 时校准键：小时递增循环； 分校准键：分钟递增循环； 秒校准键：秒递增循环。

  3. 所属分类：嵌入式

    • 发布日期：2019-01-07
    • 文件大小：3145728
    • 提供者：qq_35522101

  1. FPGA课程设计任务书-数字电子钟设计 .doc

  2. EDA技术在电子系统设计领域越来越普及，本设计主要利用VHDL和C语言在FPGA实验板上设计一个电子数字钟，它的计时周期为24小时，显示满刻度为23时59分59秒、。总的程序由几个各具不同功能的单元模块程序拼接而成，其中包括分频程序模块、时分秒计数模块、处理器及外设模块，并且使用QuartusII运用VHDL语言对分频和计数两个模块进行硬件电路设计和电路波形仿真，运用sopc技术嵌入内核并创建了系统所需的外部设备FLASH和SRAM软件通过使用NiosII运用C语言进行编程然后下载到硬件电路中,

  3. 所属分类：专业指导

    • 发布日期：2020-05-17
    • 文件大小：1048576
    • 提供者：shaxiaoziii

  1. 电子测量中的基于NIOSⅡ的万年历设计

  2. 摘要: 本文介绍了一种基于片上可编程系统（SOPC）设计万年历的方法。在FPGA 芯片上，通过配置NIOS 软核处理器和相关接口模块，实现了嵌入式系统的硬件结构。系统用液晶模块显示万年历等汉字字符，用8 个七段数码管显示电子钟的日期和时间，并可通过按键对其进行调整。具有高集成度、设计灵活和可移植性较好等特点。 　　1 引言 　　SOPC代表了当今电子设计的发展方向，它可以将处理器、存储器、I/O接口、硬件协处理器和普通的用户逻辑等系统设计需要的功能模块都集成到一个FPGA芯片里，构建一个可编

  3. 所属分类：其它

    • 发布日期：2020-11-10
    • 文件大小：279552
    • 提供者：weixin_38665814

  1. 北邮数字逻辑课程设计FPGA代码.zip

  2. 电子钟、药片装瓶系统FPGA扩展实验，仅供学弟学妹参考，禁止直接当作大作业提交。电子钟、药片装瓶系统FPGA扩展实验，仅供学弟学妹参考，禁止直接当作大作业提交

  3. 所属分类：讲义

    • 发布日期：2020-12-11
    • 文件大小：4194304
    • 提供者：CatSeven7

  1. 基于NIOSⅡ的万年历设计

  2. 摘要: 本文介绍了一种基于片上可编程系统（SOPC）设计万年历的方法。在FPGA 芯片上，通过配置NIOS 软核处理器和相关接口模块，实现了嵌入式系统的硬件结构。系统用液晶模块显示万年历等汉字字符，用8 个七段数码管显示电子钟的日期和时间，并可通过按键对其进行调整。具有高集成度、设计灵活和可移植性较好等特点。 　　1 引言 　　SOPC代表了当今电子设计的发展方向，它可以将处理器、存储器、I/O接口、硬件协处理器和普通的用户逻辑等系统设计需要的功能模块都集成到一个FPGA芯片里，构建一个可编

  3. 所属分类：其它

    • 发布日期：2021-01-20
    • 文件大小：385024
    • 提供者：weixin_38584642