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深入了解 LabVIEW FPGA
NI 通过LabVIEW FPGA 模块和可重复配置I/O(RIO)硬件设备,为测量和控制系统中整合FPGA 技术的 灵活性提供了直观且现成可用的解决方案。您可以使用LabVIEW图形化编程定义FPGA 芯片上的逻辑 功能,您不需要任何的有关底层硬件描述语言(HDLs)的知识,如VHDL 或是Verilog,也不需要了解板 卡级硬件设计,就可以将FPGA 芯片嵌入到NI 可重复配置I/O 系列硬件目标当中。另外,LabVIEW还 可以让您轻松地集成图象采集/分析、运动控制,以及CAN 和RS2
所属分类:
硬件开发
发布日期:2009-05-20
文件大小:286720
提供者:
irico_zb
FPGA、CPLD常用protel库
FPGA、CPLD常用protel库,包含了fpga和CPLD常用的protel库,使用非常方便,不用自建元件库了。
所属分类:
硬件开发
发布日期:2009-08-13
文件大小:935936
提供者:
clz168
ARM、DSP、FPGA的技术特点和区别
ARM、DSP、FPGA的技术特点和区别 ARM、DSP、FPGA的技术特点和区别
所属分类:
硬件开发
发布日期:2010-05-29
文件大小:147456
提供者:
hello_red
Xilinx FPGA开发全攻略—工程师创新设计宝典 (基础篇)
Xilinx FPGA开发全攻略—工程师创新设计宝典 (基础篇) 前言 2 第一章、为什么工程师要掌握FPGA开发知识? 5 第二章、FPGA基本知识与发展趋势 7 2.1 FPGA结构和工作原理 7 2.1.1 梦想成就伟业 7 2.1.2 FPGA结构 8 2.1.3 软核、硬核以及固核的概念 15 2.1.4 从可编程器件发展看FPGA未来趋势 15 第三章、FPGA主要供应商与产品 17 3.1.1 赛灵思主要产品介绍 17 第四章、FPGA开发基本流程 29 4.1 典型FPGA开发
所属分类:
硬件开发
发布日期:2010-05-31
文件大小:5242880
提供者:
Hacker3269
FPGA、SOPC开发快速入门教程(pdf)
FPGA、SOPC开发快速入门教程,非常好的一本教程,特别适合初学者
所属分类:
硬件开发
发布日期:2010-06-05
文件大小:2097152
提供者:
l443638374
FPGA开发全攻略_上
FPGA开发全攻略— 工程师创新设计宝典 上册 基础篇 2009年2月 1.0版 前言 2 第一章、为什么工程师要掌握FPGA开发知识? 5 第二章、FPGA基本知识与发展趋势 7 2.1 FPGA结构和工作原理 7 2.1.1 梦想成就伟业 7 2.1.2 FPGA结构 8 2.1.3 软核、硬核以及固核的概念 15 2.1.4 从可编程器件发展看FPGA未来趋势 15 第三章、FPGA主要供应商与产品 17 3.1.1 赛灵思主要产品介绍 17 第四章、FPGA开发基本流程 29 4.1
所属分类:
硬件开发
发布日期:2010-10-31
文件大小:6291456
提供者:
ppabcdqq
ALtera FPGA、CPLD应用(基础篇).part1
ALtera FPGA、CPLD应用(基础篇).part1 ALtera FPGA、CPLD应用(基础篇).part1
所属分类:
硬件开发
发布日期:2011-04-05
文件大小:49283072
提供者:
Augusdi
ALtera FPGA、CPLD应用(基础篇).part2
ALtera FPGA、CPLD应用(基础篇).part2
所属分类:
硬件开发
发布日期:2011-04-05
文件大小:35651584
提供者:
Augusdi
FPGA、CPLD常用protel库
FPGA、CPLD常用protel库 FPGA、CPLD常用protel库
所属分类:
硬件开发
发布日期:2011-04-05
文件大小:312320
提供者:
Augusdi
FPGA开发全攻略(上册)
FPGA开发全攻略(上册前言 2 第一章、为什么工程师要掌握FPGA开发知识? 5 第二章、FPGA基本知识与发展趋势 7 2.1 FPGA结构和工作原理 7 2.1.1 梦想成就伟业 7 2.1.2 FPGA结构 8 2.1.3 软核、硬核以及固核的概念 15 2.1.4 从可编程器件发展看FPGA未来趋势 15 第三章、FPGA主要供应商与产品 17 3.1.1 赛灵思主要产品介绍 17 第四章、FPGA开发基本流程 29 4.1 典型FPGA开发流程与注意事项 29 4.2 基于FPGA
所属分类:
硬件开发
发布日期:2012-06-26
文件大小:4194304
提供者:
xbjj2010
基于Verilog的FPGA与USB 2.0高速接口.jpg
基于Verilog的FPGA与USB 2.0高速接口,USB (通用串行总线)是英特尔、微软、IBM、康柏等公司1994年联合制定的一种通用串行总线规范,它具有数据传输速度快,成本低,可靠性高,支持即插即用和热插拔等优点,迅速得到广泛应用。 在高速的数据采集或传输中,目前使用较多的都是采用USB 2.0 接口 控制器和 FPGA 或DSP实现的,本设计在USB 2.0接口芯片CY7C68013的Slave FIFO模式下
所属分类:
其它
发布日期:2020-01-21
文件大小:31744
提供者:
u013088618
FPGA整洁代码之道3-信号命名和定义应该明确.pdf
FPGA A 整洁代码之 道 3- 信号命名和定义应该 明确 在设计中,我们不断的给目录、源代码、文件、函数、变量、参数、类、封包进 行命名与定义。当一件工作需要进行的次数非常之多,足以证明它是不可或缺的 基本工作。我们一定要知道一点,基础工作是整个项目的基石。忽视抑或是轻视 基础工作是一件非常错误的工作理念。我们需要用最严谨认真的态度去对待,同 时作为回报,它将令你的作品显得专业而优雅。33 flag2<=1b1; 34 end else if(end cntbegin 36 flag2
所属分类:
专业指导
发布日期:2019-08-24
文件大小:126976
提供者:
drjiachen
ARM、FPGA和DSP的特点和区别是什么?
ARM、FPGA和DSP的特点和区别
所属分类:
其它
发布日期:2020-08-14
文件大小:84992
提供者:
weixin_38694299
FPGA/EPLD的自上而下设计方法
FPGA/EPLD的自上而下(Top-Down)设计方法: 传统的设计手段是采用原理图输入的方式进行的,如图1所示。通过调用FPGA/EPLD厂商所提供的相应物理元件库,在电路原理图中绘制所设计的系统,然后通过网表转换产生某一特定FPGA/EPLD厂商布局布线器所需网表,通过布局布线,完成设计。原理图绘制完成后可采用门级仿真器进行功能验证。 图1:传统的设计手段与Top-Down设计工具的比较 然而,工程师的最初设计思想不是一开始就考虑采用某一FPGA/EPLD厂商的某一特定型号器件
所属分类:
其它
发布日期:2020-10-19
文件大小:122880
提供者:
weixin_38608025
基于FPGA和USB 2.0的高速数据采集系统
基于FPGA和USB2.0的高速实时数据采集系统,采用计算机的USB接口作为数据传输接口。软件设计工作包括MCU的固件程序设计、计算机上USB接口驱动程序设计、计算机上应用程序设计等几部分。MCU在FPGA和计算机之间起桥梁的作用,既要对USB接口进行控制,实现与计算机的通信,接受计算机的控制,又要对它与FPGA的接口进行设置和控制,还会与FPGA进行对话以实现对FPGA的工作模式进行设置。
所属分类:
其它
发布日期:2020-10-24
文件大小:455680
提供者:
weixin_38687648
EDA/PLD中的ACTEL为低功耗的IGLOO系列FPGA提供ARM CORTEX-M1处理器
Actel公司宣布特为其IGLOO系列现场可编程门阵列 (FPGA) 而优化ARM Cortex-M1处理器核,成功协助系统设计人员大大延长其手持及便携式设计的电池寿命。低功耗FPGA系列与专为FPGA应用而设计并广泛流行的工业标准32位ARM处理器相结合,为设计人员提供了理想的低功耗集成平台,可迅速开发便携式产品。而且,作为唯一一家向客户免费提供业界标准处理器核的FPGA供应商,Actel还可让设计人员充分利用ARM架构现成的庞大软件和设计工具资源,从而提高成本效益、缩短开发周期及降低开发成
所属分类:
其它
发布日期:2020-12-05
文件大小:63488
提供者:
weixin_38735790
基于DRAM、FPGA的专用LCD显示接口设计与实现
基于DRAM、FPGA的专用LCD显示接口设计与实现、电子技术,开发板制作交流
所属分类:
其它
发布日期:2021-02-03
文件大小:219136
提供者:
weixin_38700790
基于FPGA、ADC和高速DAC的振动模拟器的设计方法
基于FPGA、ADC和高速DAC的振动模拟器的设计方法、电子技术,开发板制作交流
所属分类:
其它
发布日期:2021-02-03
文件大小:169984
提供者:
weixin_38649315
基于DSP、FPGA和MCU的新型的实时数据采集处理系统设计
基于DSP、FPGA和MCU的新型的实时数据采集处理系统设计、电子技术,开发板制作交流
所属分类:
其它
发布日期:2021-02-03
文件大小:177152
提供者:
weixin_38625442
FPGA全局时钟资源相关原语及使用
FPGA全局时钟资源一般使用全铜层工艺实现,并设计了专用时钟缓冲与驱动结构,从而使全局时钟到达芯片内部的所有可配置单元(CLB)、I/O单元(IOB)和选择性块RAM(Block Select RAM)的时延和抖动都为。为了适应复杂设计的需要,Xilinx的FPGA中集成的专用时钟资源与数字延迟锁相环(DLL)的数目不断增加,的Virtex II器件多可以提供16个全局时钟输入端口和8个数字时钟管理模块(DCM)。 与全局时钟资源相关的原语常用的与全局时钟资源相关的Xilinx器件原语包括
所属分类:
其它
发布日期:2021-01-19
文件大小:65536
提供者:
weixin_38547151
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