运用时序交错式类比数位转换器（timeinterleavedADC）在每秒高达数十亿次的同步取样类比讯号是一个技术上的挑战，除此之外，对於混合讯号电路的设计也需要非常谨慎小心。基本上，时序交错的目标是利用转换器数目与取样频率相乘而不影响解析度以及动态的效能。 　　本文将探讨运用时序交错式类比数位转换器时所出现的技术挑战，并对此提供实用的系统设计解决方案。本文也将说明可以解决目前已知问题的创新元件的特色及设计技术。同时利用快速傅立叶转换（FFT）计算法算出7GSPS速率及两个转换器晶片在「交错解

运用时序交错式类比数位转换器（timeinterleavedADC）在每秒高达数十亿次的同步取样类比讯号是一个技术上的挑战，除此之外，对於混合讯号电路的设计也需要非常谨慎小心。基本上，时序交错的目标是利用转换器数目与取样频率相乘而不影响解析度以及动态的效能。 　　本文将探讨运用时序交错式类比数位转换器时所出现的技术挑战，并对此提供实用的系统设计解决方案。本文也将说明可以解决目前已知问题的创新元件的特色及设计技术。同时利用快速傅立叶转换（FFT）计算法算出7GSPS速率及两个转换器晶片在「交错解