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搜索资源列表

  1. RISC-V.rar

  2. 开源架构RISC-V的手册和源码，由于官网和GitHub较慢，实在不堪故放在此以便再次查看。如果其他同学有兴趣，可以到官网下载，其实速度偶尔也还可以。《手把手教你设计CPU——RISC-V处理器》这本书好像还挺好的，目前没看多少，放在这里提醒一下自己。

  3. 所属分类：C

    • 发布日期：2019-06-14
    • 文件大小：27262976
    • 提供者：liuxhcsdn

  1. RISC-V_CPU:RISC-V 32i CPU和汇编器-源码

  2. RISC-V 32i CPU和汇编器 这是HKUST ELEC-5140高级计算机体系结构的课程项目材料之一，鼓励学生增强结构模型并改善其性能。 该项目正在运行，由维护。 任何讨论或建议，将不胜感激！ 项目树 RV32i目录包含一个用verilog编写的RISC-V CPU的Vivado项目，该项目实现了5级单问题处理器，支持31条基本指令。 RISC-V_Assembler目录包含一个汇编程序，用于将RISC-V指令汇编转换为十六进制格式，可以在Vivado仿真过程中通过$readmemh轻

  3. 所属分类：其它

    • 发布日期：2021-03-13
    • 文件大小：299008
    • 提供者：weixin_42161450

  1. riscv-zig:用Zig编写的RISC-V模拟器-源码

  2. RV64IM仿真器 该存储库包含一个库，用于仿真具有乘法扩展的RISC-V 64 CPU。 告诫：此处包含的RISC-V的实现未经过合规性测试。 它可能会产生错误的结果，并且最肯定不会拒绝所有无效的指令。 （C）2021年朗索实验室。 去做 也支持RV32（应该很容易） 已实施的特权指令 更好的文档

  3. 所属分类：其它

    • 发布日期：2021-03-12
    • 文件大小：15360
    • 提供者：weixin_42128676

  1. aosp-riscv:AOSP-RISCV-源码

  2. aosp-riscv 概述 T-Head已将Android 10移植到RISC-V架构上。 Android的主要目的是为运营商，OEM和开发人员创建一个开放的软件平台，以使他们的创新想法成为现实，并推出成功的现实世界产品，以改善用户的移动体验。 图1. RISC-V 64（XuanTie 910）上的AOSP 芯片 ICE EVB是T-Head开发的基于XuanTie C910的高性能SoC板。 ICE SoC已集成3个XuanTie C910内核（RISC-V 64）和1个GPU内核； 具

  3. 所属分类：其它

    • 发布日期：2021-03-07
    • 文件大小：58720256
    • 提供者：weixin_42121412

  1. echOS:Arm 64的实验-源码

  2. 操作系统 工装 我记不清我安装的所有工具了，随时随便添加任何cargo install cargo-xbuild 路线图 文件系统实施 安装时间文件系统选择 模块化 基于URI的用户陆地系统调用系统 加密安全的随机系统调用 能够随机提供所有/大多数类型 研究与资源 文件系统 除了RISC-V作为潜在的GPU 好的，那么基于向量的处理器吗？ 好吧，猜猜是什么？ 图像是基于矢量的，我可以用[[u8; 400]; 600] [[u8; 400]; 600] [[u8; 400]; 600

  3. 所属分类：其它

    • 发布日期：2021-03-06
    • 文件大小：10240
    • 提供者：weixin_42117340

  1. single-cycle-cpu：单周期RISC-V微处理器-源码

  2. single-cycle-cpu：单周期RISC-V微处理器

  3. 所属分类：其它

    • 发布日期：2021-02-22
    • 文件大小：41984
    • 提供者：weixin_42116713

  1. Altair：使用nMigen的RV32I RISC-V软处理器-源码

  2. 牵牛星 Altair是实现的CPU内核。 Altair是免费的开放式硬件，已获得许可的两节BSD许可。 有关完整的版权和许可信息，请参阅LICENSE文件。

  3. 所属分类：其它

    • 发布日期：2021-02-17
    • 文件大小：45056
    • 提供者：weixin_42131890

  1. RISC-V-CPU-源码

  2. RISC-V-CPU Struktura： |----> ps2_interface2.sv |----> keyboard.sv ----| | |----> scancode_to_ascii.s

  3. 所属分类：其它

    • 发布日期：2021-02-11
    • 文件大小：10485760
    • 提供者：weixin_42150341

  1. warp-v：WARP-V是用TL-Verilog编写的开源RISC-V CPU内核生成器-源码

  2. 您可以根据自己的需要调整开源RISC-V核心IP！ 总览 WARP-V是用TL-Verilog编写的开源CPU核心生成器，支持RISC-V和MIPSI。它是一种演示和探索工具，可以利用新兴的“事务级设计”方法实现灵活性。 它可以实现单级低功耗微控制器或中型7级CPU。 甚至指令集体系结构（ISA）都是可配置的。 WARP-V是一个不断发展的CPU组件及其各种组成的库。 它由有兴趣通过开源硬件和革命性设计方法改变硅产业的社区推动。 WARP-V仅包含CPU核心逻辑，而当前不支持虚拟内存，高速缓存

  3. 所属分类：其它

    • 发布日期：2021-02-10
    • 文件大小：2097152
    • 提供者：weixin_42144707

  1. rumio：使用Rust轻松控制MMIO和CPU寄存器-源码

  2. rumio 轻松控制MMIO和CPU寄存器。 | | 此板条箱提供了各种宏，可以为块和CPU寄存器生成不错的API。 它主要是为了代替箱，以提供更好的API并使工作更轻松。 用法 有关更多更新和更大的示例，请查看。 定义CPU寄存器 CPU寄存器仅对使用位域存储其数据的控制寄存器有用。 例如，RISC-V体系结构的控制状态寄存器。 #![feature(asm)] mod mstatus { use rumio :: cpu :: {RegisterRead, RegisterWri

  3. 所属分类：其它

    • 发布日期：2021-02-09
    • 文件大小：25600
    • 提供者：weixin_42128315

  1. TencentOS-tiny：腾讯物联网终端操作系统-源码

  2. 一，TencentOS Tiny简介 是腾讯针对物联网领域开发的实时操作系统，具有低吞吐量，低资源占用，交换，安全可靠等特点，可有效提升物联网终端产品开发效率。TencentOS tiny提供精简的RTOS内核，内核而且，基于RTOS内核提供了丰富的物联网组件，内部集成主流物联网协议栈（如CoAP / MQTT / TLS / DTLS / LoRaWAN / NB-IoT等），可助力物联网终端设备及业务快速接入腾讯云物联网平台。 1，TencentOS tiny整体架构 TencentOS

  3. 所属分类：其它

    • 发布日期：2021-02-08
    • 文件大小：343932928
    • 提供者：weixin_42116847

  1. riscv_vhdl：便携式RISC-V片上系统实现：RTL，调试器和模拟器-源码

  2. 基于兼容RISC-V体系结构的可合成处理器的片上系统模板。 该存储库提供基于BSD许可下分发的64位CPU“火箭芯片”的开源片上系统实现。 SOC源文件包括通用外围设备，FPGA CAD项目文件，Windows / Linux调试器自己的实现以及一些示例，这些示例可帮助在几乎所有FPGA板上运行固件。 卫星导航（GPS / GLONASS / Galileo）模块已存入此存储库中，可以单独进行请求。 什么是Rocket-chip和 ？ RISC-V（发音为“风险五”）是一种新的指令集体系结构

  3. 所属分类：其它

    • 发布日期：2021-02-05
    • 文件大小：11534336
    • 提供者：weixin_42113380

  1. CS2X：将C＃子集转换为非.NET语言和运行时。 （由罗斯林提供技术支持）-源码

  2. CS2X（开发中） 将C＃子集转换为非.NET语言，平台，运行时和环境。 （由罗斯林提供技术支持） CS2X正在轨道框架的开发中进行积极的测试： 这提供了真实的测试，并且随着事情的进展，这里将测试和支持更多功能。 WASM演示 渲染1280x720图像，然后打印花费多长时间（以秒为单位）。 目标 该项目将着重于使用修改后的类型系统来编译C＃子集，以编写CPU和GPU程序。 用于各种目标的定制标准库。 文献资料 CPU目标 C89 原生C性能 C89：现代，传统和嵌入式平台（x86，

  3. 所属分类：其它

    • 发布日期：2021-02-05
    • 文件大小：377856
    • 提供者：weixin_42116604

  1. RuscV：Rustで书かれたRisc-V CPUで启动する何か-源码

  2. RuscV：Rustで书かれたRisc-V CPUで启动する何か

  3. 所属分类：其它

    • 发布日期：2021-02-04
    • 文件大小：9216
    • 提供者：weixin_42131890

  1. jor1k：运行Linux的在线OR1K模拟器-源码

  2. 约克 jor1k是用运行LinuxJavascr ipt编写的OpenRISC 1000模拟器。 它几乎可以在任何现代Web浏览器中运行。 打开尝试看看它是否在浏览器中运行。 可以在页面上找到更多信息。 演示版 主页面 在浏览器中C代码 来自伊利诺伊大学的C代码 具有， ， ， 对称多处理（随着增加的核心而不稳定） 简单的 RTEMS（实时操作系统） RISC-V CPU实现的简单。 等待直到第一条消息出现在终端中，然后在下拉菜单中选择bbl。 项目链接 报告任何问题或功能请求 包含更多详细

  3. 所属分类：其它

    • 发布日期：2021-02-03
    • 文件大小：957440
    • 提供者：weixin_42141437

  1. 一个32位RISC-V / MIPS ISA可重定向CPU核心和SoC, 1.63 DMIPS/MHz - f32c/f32c-源码

  2. f32c is a retargetable, scalar, pipelined, 32-bit processor core which can execute subsets of either RISC-V or MIPS instruction sets. It is implemented in parametrized VHDL which permits synthesis with different area / speed tradeoffs, and includes

  3. 所属分类：其它

    • 发布日期：2021-01-27
    • 文件大小：4194304
    • 提供者：weixin_38714370

  1. neorv32:小型且可定制的满量程32位RISC-V软核CPU和SoC，采用独立于平台的VHDL编写-源码

  2. NEORV32 RISC-V处理器 概述 NEORV32处理器是基于RISC-V NEORV32 CPU的可定制的类似微控制器的片上系统（SoC）。 该处理器可在较大的SoC设计中用作辅助处理器，也可作为现成的独立定制微控制器使用。 :books: 有关详细信息，请参阅 。 该软件框架基于doxygen的文档可从在线获得。 :label: 在此存储库的根目录中，项目的更改日志以形式提供。 要查看稳定版本之间的更改，请访问项目的。 :rocket: 文件夹提供了针对各种FPGA板的示

  3. 所属分类：其它

    • 发布日期：2021-03-31
    • 文件大小：5242880
    • 提供者：weixin_42122838

  1. Unnamed-Simulator:看起来很奇怪的CPU是什么？-源码

  2. 未命名的CPU模拟器 这里存储了不同的CPU设计及其设计说明。 使用不同的硬件描述语言，Verilog，System C和System Verilog进行实验； 使用不同的硬件设计技术，数据转发，自动验证等进行实验。 微架构 architecture03是用System Verilog编写的四级流水线RISC-V RV32I CPU，具有数据转发功能，以最大程度地减少停顿。 和4KiB Direct-Mapped Cache。 有关详细，请参见 。 [已完成]数据转发 [已完成]带延迟的内存

  3. 所属分类：其它

    • 发布日期：2021-03-31
    • 文件大小：9437184
    • 提供者：weixin_42123237

  1. simple-riscv-cpu:简单的RISC-V RV32I CPU-源码

  2. simple-riscv-cpu:简单的RISC-V RV32I CPU

  3. 所属分类：其它

    • 发布日期：2021-03-29
    • 文件大小：20480
    • 提供者：weixin_42117340