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  1. Altera的TimeQuest时序分析器

  2. TimeQuest 时序分析器是 一种 ASIC 功能时序分析器，支持业界标准 Synopsys 设计约束 (SDC) 格式。TimeQuest 分析器支持收集应用程序接口 (API) ，可以直接访问设计中的端口、引脚、单元或者节点。您可以利用 TimeQuest 分析器中指定的任何有效约束或者工具命令语言 (Tcl) 命令来使用收集 API 。

  3. 所属分类：专业指导

    • 发布日期：2009-07-09
    • 文件大小：1048576
    • 提供者：whj5878088

  1. ALTERA FPGA,SDC时序约束命令

  2. 很好的ALTERA FPGA原英文版资料

  3. 所属分类：硬件开发

    • 发布日期：2010-04-21
    • 文件大小：867328
    • 提供者：maojng