目 录 前 言 2 1 总则 3 2 职责 3 3 目的 3 4 内容 4 4.1 基本原则 4 4.1.1 RTL级代码风格 4 4.1.2 组合时序电路分开原则 4 4.1.3 复位 5 4.2 命名规则 5 4.2.1 基本命名标准 5 4.2.2 命名准则 6 4.3 VERILOG HDL源代码文件结构 10 4.3.1 VERILOG HDL 代码文件文件头 10 4.3.2 VERILOG HDL 代码文件宏定义 13 4.3.3 VERILOG HDL 代码文件模块名及