为发展TD—SCDMA，需要发展全线的TD产业链，其中射频芯片是一个重要的瓶颈。在TD-SCDMA系统收发信机设计中，将采用零中频结构，这就要求本振信号的频率与系统射频频率相同。所以片上锁相环的设计非常关键。文章研究的就是在锁相环反馈电路上的动态分频器，部分器件工作在GHz以上，整个分频器可以实现射频条件下小数分频。

随着3G的到来，通信系统及通信行业产生了很大的变化，TD—SCDMA作为3G标准之一已开始应用，这使中国在3G发展中有了更多的话语权，一方面可以大幅降低设备的价格，另一方面具有国家安全战略意义。为发展TD—SCDMA，需要发展全线的TD产业链，其中射频芯片是一个重要的瓶颈。在TD-SCDMA系统收发信机设计中，将采用零中频结构，这就要求本振信号的频率与系统射频频率相同。所以片上锁相环的设计非常关键。文章研究的就是在锁相环反馈电路上的动态分频器，部分器件工作在GHz以上，整个分频器可以实现射频条件

在射频CMOS电路中，锁相环(PLL)是重要的组成模块之一，主要是通过频率合成，产生本振信号。用于TD-SCDMA的PLL模块需要更宽的频率范围和多种频率本振信号。因此更需要在通过小数分频等多种方式实现低功耗情况下，更快的锁频功能。双模分频器(Prescaler)工作在电路较高频率，功耗也较大，研究和开发双模分频器对于降低整片功耗，提升PLL性能有着重要意义。

随着3G的到来，通信系统及通信行业产生了很大的变化，TDSCDMA作为3G标准之一已开始应用，...文章研究的就是在锁相环反馈电路上的动态分频器，部分器件工作在GHz以上，整个分频器可以实现射频条件下小数分频。