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TMS320C6000系列DSP的软件优化技术
TMS320C6000系列DSP的软件优化技术
所属分类:
C
发布日期:2010-10-23
文件大小:709632
提供者:
lee_junfneg
TMS320C6000系列DSP的软件优化技术
本文主要介绍TMS320C6000系列DSP的软件优化技术。
所属分类:
其它
发布日期:2020-08-11
文件大小:632832
提供者:
weixin_38519082
DSP中的TMS320C6000嵌入式系统优化编程的分析
嵌入式系统是指操作系统和功能软件集成于计算机硬件系统之中。简单的说就是系统的应用软件与系统的硬件一体化,类似与BIOS的工作方式。具有软件代码小,高度自动化,响应速度快等特点。特别适合于要求实时的和多任务的体系。本文分析了TMS320C6000的硬件设计和指令系统的特点,结合应用开发过程中遇到的问题,对这种高速并行DSP器件开发方法进行了总结。 1 TMS320C6000的硬件设计与指令系统 TMS320C6000系列DSP是TI公司最新推出的一种并行处理的数字信号处理器。它是基于TI的
所属分类:
其它
发布日期:2020-10-23
文件大小:134144
提供者:
weixin_38693476
基于DSP的实时圆检测算法的设计实现与优化
霍夫圆变换是图像处理中人眼检测的一种常见方法,但是其处理的数据量多,处理速度慢,在移植到DSP上后难以满足实时性要求。对此,提出了一种将两阶段霍夫圆变换算法应用到 TMS320C6000系列 DSP上的实现与优化方法。首先,在算法上对霍夫圆变换使用MarrHildreth算子增强等方法进行改进以保证检测的准确率;之后根据 DSP的特点,利用C代码优化、浮点定点转换和软件流水等技术对算法进行深度优化。实验结果表明,程序的运行时间明显缩短,为视线检测的实时性实现创造了良好的条件。
所属分类:
其它
发布日期:2020-10-16
文件大小:396288
提供者:
weixin_38562392
单片机与DSP中的基于TMS320C6000系列DSP的维特比译码程序优化设计
摘要:在软件无线电技术中,经常采用DSP芯片实现信道解码,但维特比译码算法在DSP上的运行速度限制了DSP译码在高速实时系统中的应用。针对TMS320C6000系列DSP的特点,提出了一种优化的译码程序设计方案。利用DSP的并行运算能力,极大地缩短了译码器中“加比选”单元的运算时间。优化后的程序比优化前的译码速度上提高约4倍。当在167MHz的TMS320C6701上运行的时候,对(2,1,7)卷积码的译码速度可以达到870kbps。 关键词:数字信号处理器 维特比译码器 软件无线电
所属分类:
其它
发布日期:2020-12-10
文件大小:193536
提供者:
weixin_38523618
单片机与DSP中的TMS320C6000系列DSP的软件优化技术
1 DSP系统的软件优化流程 DSP系统的软件优化流程如图1所示。整个工作流程分为3个阶段: 第1阶段,直接根据需要用高级C语言实现DSP功能,测试代码的正确性。然后,移植到C6X平台,利用C6X开发环境Profile测试程序的运行时间。若不满足要求,则进入下一阶段。 第2阶段,利用C6X提供的优化方式和其他各种优化技巧,如使用不同的编译器选项使能软件流水,循环展开,字存取代替半字存取等,优化C语言代码。如果还不能满足要求,则进入第3阶段。 第3阶段,将C语言代码中耗
所属分类:
其它
发布日期:2020-12-09
文件大小:333824
提供者:
weixin_38670501
单片机与DSP中的TMS320C6000系列DSP维特比译码程序优化设计
卷积码因为其编码器简单、编码增益高以及具有很强的纠正随机错误的能力,在通信系统中得到了广泛的应用。基于最大似然准则的维特比算法(VA)是在加性高斯白噪声(AWGN)信道下性能最佳的卷积码译码算法,也是常用的一种算法。 一般来说,实现软判决维特比译码可以有三种方案供选择:专用集成电路(ASIC)芯片、可编程逻辑阵列(FPGA)芯片以及数字信号处理器(DSP)芯片。参考文献[3]对这三种方案的优劣做了详细的比较。使用DSP芯片实现译码是最为灵活的一种方案,但速度也是最慢的,因为整个译码过程都是由软
所属分类:
其它
发布日期:2020-12-08
文件大小:176128
提供者:
weixin_38556416
TMS320C6000系列DSP的软件优化技术
TMS320C6000系列DSP的软件优化技术、电子技术,开发板制作交流
所属分类:
其它
发布日期:2021-02-03
文件大小:803840
提供者:
weixin_38718262