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EDA技术数据选择器电路设计
1、数据选择器的工作原理。 2、基于FPGA和EDA软件的数字电路设计方法与工作流程 3、使用VHDL设计数据选择器的方法。 4、VHDL相关语法知识 5、EDA实验开发系统相关知识。 6、在EDA软件( Max+PlusII软件)平台上VHDL程序的功能仿真的方法。
所属分类:
嵌入式
发布日期:2009-05-25
文件大小:616448
提供者:
s617015380
数字电路EDA入门,VHDL程序实例集
数字电路EDA入门,VHDL程序实例集。本书遵循基本、实用、工具、创新。
所属分类:
专业指导
发布日期:2009-10-27
文件大小:3145728
提供者:
baoshan999
EDA实验肯定能用的到的资料
本书第一、二、三章介绍如何应用EDA工具完成电路原理图设计、印制电路板设计。目前已有很多CAD软件可以辅助进行印制电路板的设计,如ORCAD等,在此选择目前广泛使用的Protel 99SE来进行学习。第四、五、六、七、八章介绍应用EDA工具对可编程逻辑器件进行设计,包括数字电路设计方法、可编程逻辑器件、VHDL语言、EDA开发工具使用、可编程模拟器件及应用,此部分内容在编写时分别介绍了Altera公司的MAX+plusⅡ、Lattice公司的ispDesignExpert两种较新的开发系统软件
所属分类:
专业指导
发布日期:2009-10-29
文件大小:1048576
提供者:
coffin2
一种基于vhdl的eda密码锁
Keywords Digital password2lock FPGA VHDL MAX+ PLUS Ⅱ 为了进一步减少现有数字密码锁系统的规模,提高其性能的灵活性,本文利用 EDA技术,用VHDL 语言, 在MAX+ PLUSⅡ环境下,设计了一种新型的数字密码锁,它体积小、功耗低、价格便宜、安全可靠,维护和 升级都十分方便,具有较好的应用前景
所属分类:
硬件开发
发布日期:2009-12-25
文件大小:178176
提供者:
yutong1024
基于VHDL十位奇偶校验器的设计
设计一个奇偶检验器,要求模拟串行数据输入,并可对其进行奇偶校验。例如对于1位开始位、8位数据位和1位奇偶校验位的10位串行数据,由1个按键根据时序逐个输入,数码管应实时提示当前应输入的数据序号;奇校验或偶校验模式应能设置,odd代表奇校验,eve表示偶校验;显示格式例子:显示odd-9表示当前模式为奇校验,当前应输入第9位(即数据位的第8位)数据;显示odd-PASS则表示奇校验通过;显示odd-FFFF则表示奇校验失败。校验通过时发出嘀-嘀-嘀三声提示。
所属分类:
硬件开发
发布日期:2010-06-23
文件大小:1048576
提供者:
lncsumq
VHDL语言及设计——EDA技术
VHDL语言及设计内容系统全面,注重结合实例解决问题,是难度适中较为实用的应用参考资料
所属分类:
专业指导
发布日期:2010-10-21
文件大小:6291456
提供者:
mhf20101225
VHDL语言及设计2
VHDL语言及设计内容系统全面,结合实例讲解问题,难度适中,是很好的应用参考资料
所属分类:
专业指导
发布日期:2010-10-21
文件大小:9437184
提供者:
mhf20101225
EDA技术与应用(VHDL、CPLD、数字系统)
用用EDA技术作为开发手段,实现一个数字系统的设计。系统采用了顶层图形设计思想,签于硬件描述语言VHDL,以可编程器件为核心 具有体积小 、可靠性高、灵活性强等特点。将EDA技术与传统电子设计方法进行比较,总结出EDA技术的优势
所属分类:
专业指导
发布日期:2010-10-23
文件大小:276480
提供者:
feixiangdemeng3
全加器电路设计的VHDL语言
EDA实验——全加器电路设计的VHDL语言源程序
所属分类:
专业指导
发布日期:2010-12-30
文件大小:114688
提供者:
GanYanlei
EDA技术与VHDL-潘松
潘松、黄继业的《EDA技术与VHDL》(第2版)完整PPT:第1章 概述;第2章PLD硬件特性与编程技术;第3章VHDL基础;第4章 Quartus使用方法;第5章 VHDL状态机;第6章 16位CISC CPU设计;第7章 VHDL语句;第8章 VHDL结构;第9章 DSP Builder设计初步;第10章 DSP Builder设计深入。各章节内容完整,我自己按照这个学习了一遍。
所属分类:
嵌入式
发布日期:2011-09-20
文件大小:11534336
提供者:
pinger112
基于VHDL语言的EDA秒表作业设计
基于VHDL语言的EDA秒表作业设计,包括分频、秒表主体和数码管显示译码器,附有工程文件和管脚信息(EDA大作业西电02105143)
所属分类:
嵌入式
发布日期:2013-05-14
文件大小:433152
提供者:
vanilla452517383
VHDL 试验文档 PPT格式
VHDL 试验文档 一、实验目的: 1、掌握VHDL语言的输入、编译、调试环境。 2、掌握波形文件建立方法,VHDL程序设计仿真方法。 二、实验要求 熟练掌握MAX+plus II软件的使用方法。能够熟练的进行VHDL语言的输入、编译、调试全过程,能够通过建立的波形文件进行程序的时序仿真。 三、所需实验设备 1、实验用电脑一台; 2、EDA软件MAX+plus II一套。
所属分类:
嵌入式
发布日期:2009-02-18
文件大小:438272
提供者:
mrchenlang
VHDL 在EDA中的应用
VHDL在EDA中的 应用,实战经验非常实用的哦
所属分类:
专业指导
发布日期:2009-03-30
文件大小:48128
提供者:
xinlovetang
基于单片机、EDA技术的波形发生器的设计
本设计中涉及到单片机汇编语言、VHDL语言的运用,充分地利用了二者的优点,制作了一套波形发生系统。
所属分类:
其它
发布日期:2020-08-10
文件大小:234496
提供者:
weixin_38504687
数字系统设计中VHDL语言设计问题探讨
从描述方法、设计规则、时序等方面分析了用硬件描述语言VHDL在EDA设计中容易出现问题的原因,并提出了相应的解决方案。
所属分类:
其它
发布日期:2020-10-26
文件大小:146432
提供者:
weixin_38743602
单片机与DSP中的基于单片机、EDA技术的波形发生器的设计
该波形发生器以单片机(MCS8031)为中心控制单元,由键盘输入模块、数码管显示模块、D/A波形发生模块、幅值调整模块组成。采用DDFS技术,先将要求的波形数据存储于EEPROM中,这样可以保证掉电以后波形数据不丢失。 为了达到所要求的高速度,采用FPGA(ALTEAR 公司的 EPF10K10LC84-4, 晶振频率可达 40MHz)来实现波形的发生,通过DDFS技术(直接数字频率合成技术)、VHDL语言和单片机汇编语言编程技术的完美结合实现了对正弦波、方波和三角波三种波形的频率、幅值的
所属分类:
其它
发布日期:2020-11-09
文件大小:191488
提供者:
weixin_38730840
EDA/PLD中的FPGA设计的SPI自动发送模块技术
一、摘要: SPI 接口应用十分广泛,在很多情况下,人们会用软件模拟的方法来产生SPI 时序或是采用带SPI 功能模块的MCU。但随着可编程逻辑技术的发展,人们往往需要自己设计简单的SPI 发送模块。本文介绍一种基于FPGA 的将并行数据以SPI 串行方式自动发送出去的方法。 二、关键字: VHDL、FPGA、SPI、串行数据输出选择模块、移位脉冲产生模块、SPI 时钟采集信号和无相移的SPI 基准时钟产生模块、SPI 时钟输出选择模块、8bit SPI 时钟采集生成模块、16
所属分类:
其它
发布日期:2020-11-07
文件大小:209920
提供者:
weixin_38552083
EDA/PLD中的Verilog HDL语言在FPGA/CPLD开发中的应用
1 引言 近30年来,由于微电子学和计算机科学的迅速发展,给EDA(电子设计自动化)行业带来了巨大的变化。特别是进入20世纪90年代后,电子系统已经从电路板级系统集成发展成为包括ASIC、FPGA和嵌入系统的多种模式。可以说EDA产业已经成为电子信息类产品的支柱产业。EDA之所以能蓬勃发展的关键因素之一就是采用了硬件描述语言(HDL)描述电路系统。就FPGA和CPLD开发而言,比较流行的HDL主要有Verilog HDL、VHDL、ABEL-HDL和 AHDL 等,其中VHDL和Verilo
所属分类:
其它
发布日期:2020-11-25
文件大小:144384
提供者:
weixin_38638163
EDA/PLD中的使用LeonardoSpectrum综合Xilinx FPGA的VHDL程序
摘 要: 本文总结了使用LeonardoSpectrum综合Xilinx FPGA的VHDL程序应用,以及在VHDL中使用不同类型RAM的方法。关键词: LeonardoSpectrum;FPGA;VHDLLeonardoSpectrum 是Mentor Graphics公司设计的功能强大的EPLD/FPGA/ASIC综合工具,支持大部分EPLD/FPGA厂商的产品。LeonardoSpectrum支持VHDL、Verilog、EDIF的综合、优化和定时分析,可以运行在Windows 98/
所属分类:
其它
发布日期:2020-12-10
文件大小:61440
提供者:
weixin_38652270
EDA/PLD中的Actel 优化图形HDL设计输入环境
Actel公司和HDL Works公司宣布针对Actel的Libero集成设计环境 (IDE) 设计流程,优化HDL Works的EASE设计输入工具。EASE图形HDL设计输入环境为FPGA和ASIC的VHDL、Verilog和混合语言设计提供快速和准确的途径,进行设计输入、修改和维护。此外,两家公司还宣布HDL Works已加入成为Actel EDA联盟计划的一员。 优化的HDL工具流程对于Actel所有生成和维护复杂HDL设计的客户都非常重要,而Siemens正是深谙这种需要的客户之一。
所属分类:
其它
发布日期:2020-12-10
文件大小:55296
提供者:
weixin_38677227
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