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搜索资源列表

  1. EDA VHDL 八位加法器

  2. EDA VHDL 八位加法器 EDA VHDL 八位加法器

  3. 所属分类：其它

    • 发布日期：2009-05-16
    • 文件大小：183296
    • 提供者：ffgy5731

  1. 由VHDL编写的加法器代码

  2. 由VHDL编写的加法器代码实例。 由VHDL编写的加法器代码实例。 由VHDL编写的加法器代码实例。

  3. 所属分类：其它

    • 发布日期：2009-05-26
    • 文件大小：662
    • 提供者：yanyinhong

  1. VHDL8位加法器（含test_bench)

  2. 用VHDL语言描述的8位加法器，还包含一个test_bench。

  3. 所属分类：其它

    • 发布日期：2009-09-25
    • 文件大小：73728
    • 提供者：wuwupeak

  1. 数字设计 VHDL adder 加法器

  2. 数字设计 VHDL adder 加法器 自己测试 完全有用 VHDL编写

  3. 所属分类：其它

    • 发布日期：2009-11-09
    • 文件大小：34816
    • 提供者：lekko111

  1. 32位二进制快速进位加法器 VHDL 源代码

  2. 32位二进制快速进位加法器 VHDL 源代码 32位二进制快速进位加法器 VHDL 源代码

  3. 所属分类：其它

    • 发布日期：2010-01-26
    • 文件大小：6144
    • 提供者：fubo200511

  1. 用VHDL实现四位加法器仿真

  2. 计算机组成原理实验内容：用VHDL实现四位加法器

  3. 所属分类：嵌入式

    • 发布日期：2010-03-21
    • 文件大小：183296
    • 提供者：bingo1103

  1. VHDL 32位超前进位加法器

  2. 包括4位超前几位加法器，32位超前进位加法器及测试程序和电路图

  3. 所属分类：其它

    • 发布日期：2010-05-01
    • 文件大小：257024
    • 提供者：xvlei_2417

  1. 带控制端口的加法器 vhdl

  2. 带控制端口的加法器 vhdl请注意: 第1例到第6例的源描述都是从第8例的程序包中 提取出来的,不能单独编译,这些例子的编译与 模拟请参考第8例.

  3. 所属分类：专业指导

    • 发布日期：2010-05-21
    • 文件大小：22528
    • 提供者：hejiaqiang301

  1. 八位加法器基于VHDL

  2. 八位加法器基于VHDL语言书写 八位加法器基于VHDL语言书写

  3. 所属分类：其它

    • 发布日期：2010-06-04
    • 文件大小：136192
    • 提供者：swp0314

  1. 四位加法器和比较器基于VHDL语言

  2. 四位加法器和比较器基于VHDL语言 四位加法器和比较器基于VHDL语言

  3. 所属分类：其它

    • 发布日期：2010-06-04
    • 文件大小：123904
    • 提供者：swp0314

  1. VHDL加法器，全加器

  2. VHDL加法器，需要的拿去，全加，书上手打过来的，很辛苦，需要的顶一下吧

  3. 所属分类：其它

    • 发布日期：2010-10-18
    • 文件大小：1024
    • 提供者：ruisheng536

  1. 元件例化方式串行四位加法器

  2. 哈哈，VHDL实现四位串行加法器，自己模拟吧.经测试很好用。恩，还不够20个字么

  3. 所属分类：专业指导

    • 发布日期：2010-12-10
    • 文件大小：2048
    • 提供者：lxyl_1124

  1. VHDL加法器和减法器的原理

  2. 内含有 加法和减法 还有乘法的算法程序，是基于VHDL的希望对大家有用

  3. 所属分类：其它

    • 发布日期：2011-04-09
    • 文件大小：44032
    • 提供者：boboxiaojie

  1. 用VHDL设计快速BCD码加法器.pdf

  2. 用VHDL设计快速BCD码加法器.pdf用VHDL设计快速BCD码加法器.pdf

  3. 所属分类：专业指导

    • 发布日期：2011-05-10
    • 文件大小：61440
    • 提供者：yellow88488

  1. vhdl多功能加法器

  2. 设计一个多功能的1位加法器，有控制信号M、S2、S1、S0。 当M=1，做算术运算: 在S2、S1、S0的控制下能完成两个1位二进制数A、B的以下算术运算： A加B，A加1，A加B加低位来的进位，B加1，A加 ，A加0，A加A ，A加 加1。 当M=0，做逻辑运算: 在S2、S1、S0的控制下能完成两个1位二进制数A、B的以下逻辑运算：A+B，AA+B，A·B等。

  3. 所属分类：硬件开发

  1. vhdl加法器设计（8421BCD转5421BCD）

  2. vhdl加法器设计，输入为8421BCD，内部转换为5421BCD相加，结果转换为5421BCD输出。

  3. 所属分类：其它

    • 发布日期：2011-12-01
    • 文件大小：66560
    • 提供者：zhy2214

  1. vhdl 加法器设计

  2. 串行 四位 加法器，实现vhdl 语言的设计

  3. 所属分类：硬件开发

    • 发布日期：2012-03-06
    • 文件大小：142336
    • 提供者：binshao199023

  1. VHDL加法器

  2. 用VHDL语言设计的加法器.

  3. 所属分类：专业指导

    • 发布日期：2012-12-23
    • 文件大小：32768
    • 提供者：crg870527

  1. VHDL加法器

  2. 由VHDL语言编写的代码，有逐级进位和超前进位加法器的对比，有仿真波形（xilinx）；

  3. 所属分类：其它

    • 发布日期：2013-05-05
    • 文件大小：300032
    • 提供者：jingmoxiao

  1. 基于VHDL的加法器的设计

  2. 次设计为基于VHDL的加法器的设计，网页上总之有太多的

  3. 所属分类：其它

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