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LPC435x中文介绍
LPC435x是指NXP的LPC4350和LPC4357两款芯片,可统称为LPC435x系列芯片。 LPC435x是ARM的Cortex-M4微控制器的嵌入式应用,其中包括了ARM Cortex-M0协处理器,高达1 MB的闪存,高达264 KB的SRAM,先进的可配置外设,如国家可配置定时器(SCT)和串行通用I / O(SGPIO)接口,2个高速USB控制器,以太网,LCD,外部存储器控制器,以及多种模拟和数字外设。 LPC435x的操作在CPU频率高达204 MHz的。 ARM Cort
所属分类:
Linux
发布日期:2012-12-15
文件大小:23552
提供者:
runqrs
LPC4357中文介绍
LPC4357是LPC43xx系列产品中的一款,拥有以下性能特征。 LPC43xx是ARM的Cortex-M4微控制器的嵌入式应用,其中包括了ARM Cortex-M0协处理器,高达1 MB的闪存,高达264 KB的SRAM,先进的可配置外设,如国家可配置定时器(SCT)和串行通用I / O(SGPIO)接口,2个高速USB控制器,以太网,LCD,外部存储器控制器,以及多种模拟和数字外设。 LPC43xx的操作在CPU频率高达204 MHz的。 ARM Cortex-M4的是新一代的32位核心
所属分类:
嵌入式
发布日期:2012-12-15
文件大小:23552
提供者:
runqrs
LPC4350中文介绍
LPC4350是LPC43xx系列产品中的一款,拥有以下性能特征。 LPC43xx是ARM的Cortex-M4微控制器的嵌入式应用,其中包括了ARM Cortex-M0协处理器,高达1 MB的闪存,高达264 KB的SRAM,先进的可配置外设,如国家可配置定时器(SCT)和串行通用I / O(SGPIO)接口,2个高速USB控制器,以太网,LCD,外部存储器控制器,以及多种模拟和数字外设。 LPC43xx的操作在CPU频率高达204 MHz的。 ARM Cortex-M4的是新一代的32位核心
所属分类:
嵌入式
发布日期:2012-12-15
文件大小:23552
提供者:
runqrs
lpc43xx系列 sgpio模拟spi例程
lpc43xx系列 sgpio模拟spi例程,官方发布的资料
所属分类:
C
发布日期:2013-10-07
文件大小:194560
提供者:
dyq831020
lpc431x lpc433x lpc432x lpc435x 系列 sgpio模拟spi例程
lpc431x lpc433x lpc432x lpc435x 系列 sgpio模拟spi例程 lpc43xx系列 sgpio模拟spi例程,官方发布的资料
所属分类:
C
发布日期:2014-04-25
文件大小:194560
提供者:
yang96019
LPC43xx中文用户手册(完整)pdf
LPC43xx 是针对嵌入式应用的 ARM Cortex-M4 微控制器,配有 1 个 ARM Cortex-M0 协处 理器、高达 264 kB SRAM、高级可配置外设 (如状态可配置定时器 (SCT) 和串行通用 I/O (SGPIO) 接口)、 2 个高速 USB 控制器、以太网、液晶显示器、 1 个外部存储控制器和多个 数字和模拟外设。 LPC43xx 系列的 CPU 工作频率高达 204 MHz。 ARM Cortex-M4 是下一代 32 位微控制器内核,具有低功耗、易调试、易集
所属分类:
嵌入式
发布日期:2016-04-05
文件大小:16777216
提供者:
maizezhen
基于CPLD的SGPIO总线实现及应用.pdf
分析了SGPIO总线的数据传输机制,用CPLD模拟SGPIO总线协议来实现并行数据的串行传输,并将其与串并数据转换集成芯片进行对比,说
所属分类:
其它
发布日期:2019-09-05
文件大小:518144
提供者:
weixin_38743968
基于CPLD的SGPIO总线实现及应用
分析了SGPIO总线的数据传输机制,用CPLD模拟SGPIO总线协议来实现并行数据的串行传输,并将其与串并数据转换集成芯片进行对比,说明了前者的应用优势,并且指出了其应用场合。采用Lattice Diamond IDE进行了Verilog HDL代码编写和综合,并用ModelSim进行时序仿真,最终下载到CPLD器件进行测试。
所属分类:
其它
发布日期:2020-08-31
文件大小:237568
提供者:
weixin_38559203
基于CPLD的SGPIO总线实现及应用
分析了SGPIO总线的数据传输机制,用CPLD模拟SGPIO总线协议来实现并行数据的串行传输,并将其与串并数据转换集成芯片进行对比,说明了前者的应用优势,并且指出了其应用场合。采用Lattice Diamond IDE进行了Verilog HDL代码编写和综合,并用ModelSim进行时序仿真,最终下载到CPLD器件进行测试。结果证明了采用CPLD实现SGPIO总线协议的可行性以及将其应用到板级之间数据通信的优越性。
所属分类:
其它
发布日期:2020-10-17
文件大小:239616
提供者:
weixin_38566180