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基于verilog的信号发生器
基于verilog的信号发生器,基于数字直接调频(DDS)技术,内含源代码
所属分类:
专业指导
发布日期:2009-06-04
文件大小:288768
提供者:
lucas470
verilog 程序写的10k,20k,30k,......100k信号发生器
verilog 程序写的10k,20k,30k,......100k信号发生器
所属分类:
专业指导
发布日期:2009-08-11
文件大小:8192
提供者:
azhangbinlml
基于51单片机的DDS函数信号发生器
本程序功能: DDS文件夹内的程序,完成直接数字频率合成功能,有正弦,三角,方波三种波形,并能扫频. 可通过键盘操作设置频率参数和选择波形种类和控制运行. 由两部分组成,"C"文件夹内,是用于在 51 单片机上运行的 C语言程序, "Verilog"文件夹内,是用Verilog语言编写的 FPGA 程序. DDS的工作原理,请参阅有关资料,本光盘中的 "ESD-5电子综合设计实验箱使用说明书.DOC" 文档中,有简单介绍. 运行方法: 运行 Keil ,将该例中的 sweep.c 和 disp
所属分类:
硬件开发
发布日期:2010-06-05
文件大小:1027072
提供者:
zhengdaobaozengna
频率可变 dds信号发生器 verilog sopc nios2
频率可变 dds信号发生器 verilog sopc nios2 正弦波 方波 三角波
所属分类:
iOS
发布日期:2010-07-19
文件大小:8388608
提供者:
tfriends
EDA实验报告_正弦信号发生器_序列检测器
EDA最后一次实验报告内容_用 QuartusII 设计正弦信号发生器_序列检测器的VHDL设计.docEDA最后一次实验报告内容_用 QuartusII 设计正弦信号发生器_序列检测器的VHDL设计.docEDA最后一次实验报告内容_用 QuartusII 设计正弦信号发生器_序列检测器的VHDL设计.doc
所属分类:
数据库
发布日期:2011-04-21
文件大小:718848
提供者:
ylimh_hmily
基于VERILOG HDL的信号发生器
用VERILOG HDL编程实现各种信号波形输出
所属分类:
硬件开发
发布日期:2011-12-14
文件大小:1048576
提供者:
boyuan12
基于VerilogHDL的信号发生器的设计
基于VerilogHDL的信号发生器的设计
所属分类:
其它
发布日期:2012-03-26
文件大小:896000
提供者:
shulizhu123
基于FPGA的DDS信号发生器的设计
本次实验中所到的实验模块有FPGA核心板,AD/DA模块,4*4键盘模块,51单片机模块。用Verilog在MaxpluII中实验了很久。
所属分类:
硬件开发
发布日期:2012-05-29
文件大小:224256
提供者:
xiaohesdu
基于Verilog HDL 的信号发生器的设计
基于Verilog HDL 的信号发生器的设计
所属分类:
硬件开发
发布日期:2012-06-01
文件大小:896000
提供者:
oldcat0225
基于fpga的正余弦信号发生器
利用FPGA产生正交两路信号 也可以只产生一路信号 信号波形稳定 频率可调
所属分类:
硬件开发
发布日期:2012-06-04
文件大小:636928
提供者:
lucksea001
基于FPGA 的任意信号发生器
:目前我们使用的信号发生器主要由集成式DDS 芯片或FPGA 加高速D/A 的方案来实 现。集成式DDS 芯片使用不灵活,而对于FPGA 加高速D/A 的设计方案,由于D/A 芯片的 价格过高导致信号发生器的成本增加。本文提出了一种基于DDS 思想,利用PWM 原理实 现任意信号发生器的解决方案,将正弦波输入比较器产生矩形波,解决了实验用信号发生器 由于使用高速D/A 芯片导致成本增加的问题。同时研制出了原理样机,证明了本方案的可 行性。 关键词: FPGA;DDS 思想;PWM 信号;任意信
所属分类:
硬件开发
发布日期:2012-12-11
文件大小:453632
提供者:
noodles5320
数字系统实践 秒信号发生器
数字系统实践,用Verilog语言编写程序,在FPGA上实现面信号发生器
所属分类:
专业指导
发布日期:2014-02-22
文件大小:156672
提供者:
lutaiwei98
基于DDS的信号发生器设计代码
verilog HDL编写的基于FPGA的信号发生器设计
所属分类:
嵌入式
发布日期:2014-05-10
文件大小:672768
提供者:
saichen125
正弦波信号发生器verilog代码
完整的正弦信号发生器verilog程序代码,仿真已通过
所属分类:
硬件开发
发布日期:2015-05-23
文件大小:4194304
提供者:
star1552
基于fpga的正弦信号发生器verilog代码
很简洁易懂的正弦信号发生器verilog代码,附带有modelsim仿真测试脚本文件,已用于我自己的项目中
所属分类:
硬件开发
发布日期:2015-05-23
文件大小:26214400
提供者:
star1552
模55加法器_信号发生器_序列检测器.docx
Verilog作业,模55加法器_信号发生器(fsm)_序列检测器(fsm),包括设计代码,测试代码,仿真波形
所属分类:
电信
发布日期:2020-06-24
文件大小:252928
提供者:
weixin_44712154
模拟技术中的基于SOPC技术的SVPWM信号发生器的实现
摘要:本文提出了一种基于SOPC技术的SVPWM信号发生器的实现策略,采用Verilog HDL定制系统需要的外设,并在FPGA芯片内部嵌入一个Nios11处理器软核,从而采用软硬件协同工作的方式来实现SVP调制算法。该方案结合了SVPWMI与SOPC技术的优点,在高性能的控制系统中有重要的应用价值,为设计高性能的电机控制系统提供了一种全新的实现方法。最后在Altera公司Cyclone 111系列的EP3C25 FPGA芯片上进行实验,验证了系统的可行性与正确性。 1.引言 SVP
所属分类:
其它
发布日期:2020-11-04
文件大小:107520
提供者:
weixin_38656064
verilog语言编写的dds信号发生器
verilog语言编写的dds信号发生器,可以实现波形变换(方波、正弦波、三角波、锯齿波)、频率变换,整幅变换,三大主要功能
所属分类:
硬件开发
发布日期:2020-12-23
文件大小:12582912
提供者:
weixin_49338632
基于FPGA的地震计标定信号发生器的设计与实现
为配合地震计电磁信息采集系统对地震计进行标定,设计一款基于FPGA的地震计标定信号发生器。以Altera EP2C8T144C8型 FPGA和16位串行DAC芯片DAC8560为核心,利用直接数字频率合成技术、m序列生成技术等产生地震计标定所需信号,设计电路对信号进行偏置、滤波、数字程控调幅、电压电流转换以输出特定的电压、电流信号。使用Verilog HDL语言实现系统软件。将标定信号发生器应用于实验室开发的地震电磁信息采集系统,结果表明,系统可产生地震计标定所需正弦波、方波、伪随机二进制信号,
所属分类:
其它
发布日期:2021-01-31
文件大小:578560
提供者:
weixin_38746951
基于SOPC技术的SVPWM信号发生器的实现
摘要:本文提出了一种基于SOPC技术的SVPWM信号发生器的实现策略,采用Verilog HDL定制系统需要的外设,并在FPGA芯片内部嵌入一个Nios11处理器软核,从而采用软硬件协同工作的方式来实现SVP调制算法。该方案结合了SVPWMI与SOPC技术的优点,在高性能的控制系统中有重要的应用价值,为设计高性能的电机控制系统提供了一种全新的实现方法。在Altera公司Cyclone 111系列的EP3C25 FPGA芯片上进行实验,验证了系统的可行性与正确性。 1.引言 SVPWM
所属分类:
其它
发布日期:2021-01-20
文件大小:156672
提供者:
weixin_38621427
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